José Luís Almada Güntzel

Bolsista de Produtividade em Pesquisa do CNPq - Nível 2

  • Endereço para acessar este CV: http://lattes.cnpq.br/3431795837830476
  • Última atualização do currículo em 21/09/2018


Professor Associado do Departamento de Informática e Estatística (INE), no Centro Tecnológico (CTC) da Universidade Federal de Santa Catarina (UFSC). É coordenador do Programa de Pós-Graduação em Ciência da Computação (PPGCC) da UFSC, colíder do Grupo de Pesquisa em Automação do Projeto de Sistemas Computacionais Embarcados, supervisor do Núcleo Interdepartamental de Microeletrônica (NIME) e membro do Laboratório de Computação Embarcada (ECL) da UFSC. Possui graduação em Engenharia Elétrica (1990), mestrado (1993) e doutorado (2000) em Ciência da Computação pela Universidade Federal do Rio Grande do Sul (UFRGS). Em 1996 realizou estágio (doutorado-sanduíche) no Laboratoire d'Informatique, de Robotique et de Micro-électronique de Montpellier (LIRMM), da Université Montpellier 2, Montpellier, França. Entre 2002 e 2007, foi professor adjunto no Departamento de Informática da Universidade Federal de Pelotas (UFPel), onde fundou o Grupo de Arquiteturas e Circuitos Integrados (GACI), do qual é colaborador. É membro da IEEE Circuits and Systems Society, do IEEE Council for Electronic Design Automation (CEDA), da Sociedade Brasileira de Computação (SBC) e da Sociedade Brasileira de Microeletrônica (SBMicro), da qual foi membro da diretoria na gestão 2006-2008. Atualmente, é o coordenador do IEEE Brazil CEDA Chapter e coordenador do Comitê Executivo (Steering Committee) do SBCCI (Symposium on Integrated Circuits and Systems Design).Tem experiência nas áreas de Engenharia Elétrica e Ciência da Computação, com ênfase em Microeletrônica, atuando principalmente nos seguintes temas: Electronic Design Automation (placement & routing, gate sizing, clock tree synthesis, timing analysis etc), arquiteturas VLSI para compressão de vídeos de alta resolução e projeto de sistemas em chip (SoCs) de alta eficiência energética. (Texto informado pelo autor)


Identificação


Nome
José Luís Almada Güntzel
Nome em citações bibliográficas
GÜNTZEL, J. L. A.;GÜNTZEL, J. L.;GÜNTZEL, J.;GÜNTZEL, Jose Luis;GUNTZEL, JOSE LUIS;Giintzel, Jose Luis;GÜNTZEL, JOSÉ LUÍS;GUNTZEL, JOSE L. A.;GÜNTZEL, JOSÉ LUIS

Endereço


Endereço Profissional
Universidade Federal de Santa Catarina, Centro Tecnológico, Departamento de Informática e Estatística.
Campus Universitário - prédio do INE/CTC - sala 421
Trindade
88010970 - Florianópolis, SC - Brasil - Caixa-postal: 476
Telefone: (48) 37216466
Fax: (48) 37219566
URL da Homepage: http://www.inf.ufsc.br/~guntzel


Formação acadêmica/titulação


1995 - 2000
Doutorado em Computação.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Título: Functional Timing Analysis of VLSI Circuits Containing Complex Gates, Ano de obtenção: 2000.
Orientador: Ricardo Augusto da Luz Reis.
Bolsista do(a): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior, CAPES, Brasil.
Palavras-chave: Circuitos Digitais VLSI em tecnologia CMOS; Verificação de Projeto; Análise de timing; portas lógica complexas; geração automática de teste - ATPG.
Grande área: Ciências Exatas e da Terra
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Microeletrônica.
Setores de atividade: Informática; Industria Eletro-Eletrônica.
1990 - 1993
Mestrado em Computação.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Título: Geração de Circuitos Utilizando Matrizes de Células Pré-Difundidas.,Ano de Obtenção: 1993.
Orientador: Ricardo Augusto da Luz Reis.
Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil.
Palavras-chave: Microeletrônica; Ferramentas de CAD para projeto físico; Matrizes Pré-difundidas; Gate Arrays.
Grande área: Ciências Exatas e da Terra
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Hardware.
Setores de atividade: Informática; Industria Eletro-Eletrônica.
1983 - 1990
Graduação em Engenharia Elétrica.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.




Atuação Profissional



IEEE Council on Electronic Design Automation, CEDA, Estados Unidos.
Vínculo institucional

2017 - Atual
Vínculo: Sócio, Enquadramento Funcional: Sócio, Carga horária: 1
Outras informações
Coordenador do IEEE Brazil CEDA Chapter.


Universidade Federal de Santa Catarina, UFSC, Brasil.
Vínculo institucional

2007 - Atual
Vínculo: Servidor Público, Enquadramento Funcional: Professor Associado 4, Carga horária: 40, Regime: Dedicação exclusiva.

Atividades

05/2017 - Atual
Direção e administração, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
coordenador do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
08/2013 - Atual
Ensino, Programa de Pós-Graduação em Ciência da Computação, Nível: Pós-Graduação

Disciplinas ministradas
INE410115 - Circuitos Integrados Digitais
3/2010 - Atual
Pesquisa e desenvolvimento , UNIVERSIDADE FEDERAL DE SANTA CATARINA - UFSC, .

03/2009 - Atual
Conselhos, Comissões e Consultoria, Centro Tecnológico, .

Cargo ou função
Supervisor do Laboratório do NIME - Núcleo Interdepartamental de Microeletrônica.
08/2008 - Atual
Ensino, Bacharelado em Ciências da Computação, Nível: Graduação

Disciplinas ministradas
Circuitos e Sistemas Integrados (ine5442)
08/2007 - Atual
Ensino, Bacharelado em Ciências da Computação, Nível: Graduação

Disciplinas ministradas
Sistemas Digitais (ine5406)
11/2015 - 05/2017
Direção e administração, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
subcoordenador do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
06/2009 - 05/2017
Conselhos, Comissões e Consultoria, Centro Tecnológico, .

Cargo ou função
Representante do INE no Colegiado do Curso de Graduação em Engenharia Eletrônica da UFSC.
08/2015 - 12/2015
Ensino, Programa de Pós-Graduação em Ciência da Computação, Nível: Pós-Graduação

Disciplinas ministradas
INE410126: Tópicos Especiais em Computação: Automacão do Projeto Físico de Circuitos Integrados
05/2014 - 11/2015
Conselhos, Comissões e Consultoria, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
Representante Docente Titular no Colegiado do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
04/2012 - 04/2014
Conselhos, Comissões e Consultoria, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
Representante Docente Suplente no Colegiado do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
2/2008 - 03/2014
Conselhos, Comissões e Consultoria, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
Membro da Comissão de Defesas do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
03/2010 - 12/2012
Ensino, Programa de Pós-Graduação em Ciência da Computação, Nível: Pós-Graduação

Disciplinas ministradas
INE410015: Microeletrônica II
INE410114 - Microeletrônica I
07/2007 - 09/2012
Ensino, Programa de Pós-Graduação em Ciência da Computação, Nível: Pós-Graduação

Disciplinas ministradas
Arquitetura de Computadores (ine641400)
04/2008 - 04/2012
Conselhos, Comissões e Consultoria, Centro Tecnológico, Programa de Pós-Graduação em Ciência da Computação - PPGCC.

Cargo ou função
Representante Docente Titular no Colegiado do Programa de Pós-Graduação em Ciência da Computação (PPGCC).
03/2009 - 07/2009
Ensino, Bacharelado em Ciências da Computação, Nível: Graduação

Disciplinas ministradas
sistemas embarcados (ine5439)
03/2009 - 07/2009
Ensino, Bacharelado em Ciências da Computação, Nível: Graduação

Disciplinas ministradas
INE5439: Sistemas Embarcados
08/2007 - 12/2007
Ensino, Bacharelado em Ciências da Computação, Nível: Graduação

Disciplinas ministradas
Lógica Programável (ine5348)

Universidade Federal de Pelotas, UFPEL, Brasil.
Vínculo institucional

2002 - 2007
Vínculo: Servidor Público, Enquadramento Funcional: Outro (especifique) professor Adjunto III, Carga horária: 40, Regime: Dedicação exclusiva.

Atividades

12/2002 - 5/2007
Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

Cargo ou função
Membro da Comissão de Bibliotecas da UFPel (representante do Instituto de Física e Matemática).
7/2002 - 5/2007
Pesquisa e desenvolvimento , Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

10/2006 - 03/2007
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores II
Técnicas Digitais
8/2002 - 2/2007
Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

Cargo ou função
membro suplente Comissão de Informática do Instituto de Física e Matemática.
7/2002 - 01/2007
Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

Cargo ou função
Membro Titular do Colegiado do Curso de Bacharelado em Ciência da Computação.
5/2006 - 10/2006
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Introdução à Ciência da Computação
Sistemas Digitais
8/2005 - 12/2005
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores II
Técnicas Digitais
Concepção de Circuitos Integrados
3/2005 - 7/2005
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores I
Sistemas Digitais
Projeto de Conclusão de Curso I
Introdução à Ciência da Computação
9/2004 - 1/2005
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores II
Técnicas Digitais
Sistemas Digitais
4/2004 - 8/2004
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Técnicas Digitais
Algoritmos e Programação
11/2002 - 6/2004
Conselhos, Comissões e Consultoria, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

Cargo ou função
membro do Núcleo de Trabalhos de Conclusão de Curso.
9/2003 - 4/2004
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Programação I
Arquiteturas Avançadas
5/2003 - 8/2003
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Algoritmos e Programação
Programação I
Técnicas Digitais
10/2002 - 4/2003
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Programação I
Informática Industrial
Tópicos Especiais em Computação III: Concepção de Circuitos Integrados
10/2002 - 2/2003
Direção e administração, Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.

Cargo ou função
Coordenador Pro Tempore do Colegiado do Curso de Bacharelado em Ciência da Computação.
11/2002 - 11/2002
Ensino, Curso de Especialização em Gráfica Digital, Nível: Especialização

Disciplinas ministradas
Fundamentos de Informática Gráfica
7/2002 - 10/2002
Ensino, Bacharelado Em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Informática Industrial
Algoritmos e Programação
Técnicas Digitais

Universidade Estadual do Rio Grande do Sul, UERGS, Brasil.
Vínculo institucional

2002 - 2002
Vínculo: Colaborador, Enquadramento Funcional: Outro, Carga horária: 4

Atividades

3/2002 - 6/2002
Conselhos, Comissões e Consultoria, Pró Reitoria Acadêmica, .

Cargo ou função
membro da comissão de planejamento do curso de Engenharia de Sistemas Digitais.

Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Vínculo institucional

2001 - 2002
Vínculo: Bolsista recém-doutor, Enquadramento Funcional: Outro, Carga horária: 40

Vínculo institucional

2000 - 2001
Vínculo: Colaborador, Enquadramento Funcional: Outro, Carga horária: 0
Outras informações
colaborador convidado

Vínculo institucional

1993 - 1994
Vínculo: Outro, Enquadramento Funcional: Outro, Carga horária: 0, Regime: Dedicação exclusiva.
Outras informações
Bolsa DTI RHAE

Atividades

3/2001 - 5/2002
Ensino, Computação, Nível: Graduação

Disciplinas ministradas
INF01185 - Concepção de Circuitos Integrados I
INF01113 - Organização de Computadores B
INF01040 - Introdução à Programação
11/2000 - 5/2002
Pesquisa e desenvolvimento , Instituto de Informática, Departamento de Informática Aplicada.

6/1993 - 12/1994
Pesquisa e desenvolvimento , Instituto de Informática, Departamento de Informática Aplicada.


Sociedade Brasileira de Microeletrônica, SBMICRO, Brasil.
Vínculo institucional

2006 - 2008
Vínculo: Colaborador, Enquadramento Funcional: Membro da Diretoria, Carga horária: 1

Vínculo institucional

2003 - 2007
Vínculo: Colaborador, Enquadramento Funcional: Membro do Conselhor, Carga horária: 1

Atividades

09/2007 - Atual
Direção e administração, Diretoria, .

Cargo ou função
Diretor Administrativo.
09/2003 - 09/2006
Direção e administração, Conselho, .

Cargo ou função
Membro do Conselho Administrativo, com mandato 9/2003 a 9/2007.

Université Montpellier 2 - Sciences et Techniques, UM2, França.
Vínculo institucional

1995 - 1996
Vínculo: Outro, Enquadramento Funcional: Outro (especifique) doutorado sanduíche, Carga horária: 0, Regime: Dedicação exclusiva.
Outras informações
Estágio do Doutorado Sanduíche no Laboratoire d'Informatique, de Robotique et de Micro-électronique de Montpellier (LIRMM), com bolsa do acordo CAPES-COFECUB

Atividades

11/1995 - 12/1996
Pesquisa e desenvolvimento , Laboratoire D'informatique de Robotique Et de Micro Électronique de Montpel, .

Linhas de pesquisa
CAD para Microeletrônica
11/1995 - 12/1996
Estágios , Laboratoire D'informatique de Robotique Et de Micro Électronique de Montpel, .

Estágio realizado
estudo e implementação de algoritmos de análise de timing.

Universidade Luterana do Brasil, ULBRA, Brasil.
Vínculo institucional

1998 - 2002
Vínculo: Celetista, Enquadramento Funcional: Professor Adjunto, Carga horária: 16
Outras informações
Contrato celetista por hora-aula ministrada.

Vínculo institucional

1993 - 1995
Vínculo: Celetista, Enquadramento Funcional: Outro (especifique) Professor Adjunto, Carga horária: 12
Outras informações
Contrato celetista por hora-aula ministrada.

Atividades

8/1998 - 5/2002
Ensino, Bacharelado em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Organização de Computadores
Conceitos Básicos de Computação
Arquitetura e Organização de Computadores I
6/2000 - 6/2001
Pesquisa e desenvolvimento , Faculdade de Informática, Bacharelado Em Ciência da Computação.

3/2000 - 6/2001
Direção e administração, Faculdade de Informática, .

Cargo ou função
responsável pelas disciplinas de Arquitetura e Organização de Computadores.
8/1998 - 6/2001
Ensino, Engenharia Elétrica, Nível: Graduação

Disciplinas ministradas
Sistemas Digitais I
Sistemas Digitais II
1/1999 - 1/2001
Conselhos, Comissões e Consultoria, Faculdade de Informática, Bacharelado Em Ciência da Computação.

Cargo ou função
Coordenador do Grupo de Interesse em Arquitetura e Organização de Computadores.
3/1999 - 6/2000
Conselhos, Comissões e Consultoria, Faculdade de Informática, .

Cargo ou função
membro da comissão de reforma curricular.
8/1993 - 7/1995
Ensino, Bacharelado em Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Organização de Computadores


Linhas de pesquisa


1.
CAD para Microeletrônica
2.
Desenvolvimento de Ferramentas de CAD para Geração Automática de Circuitos Integrados
3.
Verificação de Timing de Circuitos VLSI CMOS
4.
Análise de Timing Funcional de Blocos Combinacionais
5.
Síntese de Leiaute de Circuitos Digitais em Tccnologia CMOS
6.
Desenvolvimento de Ferramentas Computacionais para Projeto Físico de Circuitos Integrados
7.
Projeto de Circuitos e Sistemas Integrados
8.
Arquiteturas para Sistemas de Alto Desempenho em Hardware
9.
Desenvolvimento de Modelos, Técnicas e Algoritmos para Verificação de Timing de Circuitos Digitais CMOS
10.
Arquiteturas para Compressão de Imagens Estáticas e Dinâmicas (Vídeo)
11.
Projeto de Sistemas Digitais com VHDL e FPGAs
12.
Teste e Testabilidade de Circuitos e Sistemas Integrados
13.
Técnicas para Análise e Projeto de Arquiteturas Tolerantes a Falhas Não-Permanentes Causadas por Radiação
14.
Sistemas Distríbuidos
15.
Arquiteturas Paralelas
16.
Electronic Design Automation (placement & routing, timing analysis etc)

Objetivo: Development of efficient techniques for timing/power/routing-driven placement and routing of contemporary VLSI circuits containing millions of gates. Development of models and techniques for clock network (tree) estimate and generation. Development of accurate models and efficient techniques to guide incremental optimization (such as static timing analysis). Use of parallel programming techniques to speedup placement, routing, static timing analysis and other physical synthesis steps..
Grande área: Ciências Exatas e da Terra
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Microeletrônica.
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Hardware.
Setores de atividade: Fabricação de equipamentos de informática, produtos eletrônicos e ópticos.
Palavras-chave: Electronic Design Automation (EDA); Placement Algorithms; Routing Algorithms; clock network generation; Static Timing Analysis (STA); Lagrangian Relaxation.
17.
VLSI architectures for high-resolution video coding
18.
Design of energy-efficient SoCs (systems-on-chip)


Projetos de pesquisa


2016 - Atual
Otimização de Desempenho e Energia de Sistemas em Chip - PEOSOC (PQ2015)
Descrição: A maioria dos produtos eletrônicos contemporâneos possuem um SOC (System-on-Chip) como elemento principal de processamento. Um SOC é um sistema integrado fabricado em uma única pastilha de silício e é composto, tipicamente, por um ou mais processadores de propósito geral (CPUs), processadores para aplicações específicas (blocos aceleradores), subsistema de memória (com um ou mais níveis de memória cache e/ou scratchpad), subsistema de interconexão (barramentos, controladores etc) e memória não-volátil para armazenar o software embarcado. Os SOCs que equipam os produtos eletrônicos mais sofisticados como tablets e smartphones devem ser capazes de executar uma miríade de aplicações utilizando a menor quantidade de energia possível, sendo que inúmeras aplicações são computacionalmente intensivas e precisam ser realizadas em tempo real (e.g., gravação e reprodução de vídeos). Em outras palavras, estes SOCs devem apresentar alta eficiência energética. Atualmente, parte significativa da eficiência energética dos SOCs é proporcionada por multiprocessamento heterogêneo, realizado por blocos aceleradores dedicados às tarefas mais críticas tais como compressão/descompressão de fotos e de vídeos e criptografia de dados. A outra parte da eficiência energética dos SOCs advém do uso de diversas técnicas de otimização de potência e de desempenho que são aplicadas durante o projeto dos blocos constituintes (incluso as CPUs) nos diversos níveis de abstração (arquitetural, lógico e físico). Entretanto, o Systems Roadmap de 2013 prevê que para 2026 a potência máxima de um SOC não poderá ultrapassar 2W, restrição que somente poderá ser satisfeita caso as técnicas de otimização existentes forem significativamente aprimoradas. Desta forma, este projeto de pesquisa visa contribuir para o aperfeiçoamento das técnicas de otimização de potência e de desempenho de SOCs, por meio de dois objetivos gerais: 1) Desenvolver técnicas para a otimização de potência e de atraso na síntese física, considerando os desafios a serem enfrentados no projeto de SoCs para os produtos eletrônicos dos próximos anos; 2) Desenvolver técnicas para a otimização da eficiência energética na compressão de vídeos de alta resolução. Para atingir-se o objetivo 1, serão investigados, desenvolvidas e avaliadas soluções inovadoras para as seguintes técnicas de otimização de potência e/ou atraso, a serem aplicadas durante a síntese física de circuitos integrados: - Incremental Timing-Diven Placement (ITP); - Incremental Power-Diven Placement (IPP); - Análise de Timing Estática (STA) Com relação ao objetivo 2, serão investigadas, desenvolvidas e avaliadas soluções de otimização de eficiência energética de blocos aceleradores em hardware a serem usados em produtos eletrônicos sofisticados, tais como tablets e smartphones. Em especial, serão propostas otimizações algorítmicas e consequentes arquiteturas de hardware de blocos aceleradores para os seguintes artefatos usados pelos padrões de compressão de vídeos de alta resolução mais recentes: - Successive Elimination Baseado em SATD; - SATD para Blocos de Tamanho Variável. Como produto científico-tecnológico do projeto, espera-se produzir ao menos 2 técnicas de ITP, uma técnica de IPP e uma técnica de STA, todas com contribuição ao estado-da-arte. Também espera-se produzir um algoritmo de busca inovador, baseado na combinação de SEA com SATD e dois blocos aceleradores de alta eficiência energética: um para calcular estimação de movimento (ME) baseando-se na transformada Hadamard através da SATD (Sum of Absolute Transformed Diferences), e outro bloco para calcular a ME com Blocos de Tamanho Variável baseando-se na transformada Hadamard através da SATD. Espera-se que o grau de inovação científico-tecnológica dos trabalhos conduza a uma produção científica qualificada..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (7) / Mestrado acadêmico: (1) / Doutorado: (3) .
Integrantes: José Luís Almada Güntzel - Coordenador / Ismael Seidel - Integrante / Marcio Monteiro - Integrante / CANCELLIER, LUIZ HENRIQUE - Integrante / GUTH, CHRYSTIAN - Integrante / LIVRAMENTO, VINICIUS - Integrante / NETTO, RENAN - Integrante / André Beims Bräscher - Integrante / MORAES, BRUNO G. - Integrante / Tiago Augusto Fontana - Integrante / Giuseppe Battistella - Integrante / Sheiny Fabre Almeida - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.Número de orientações: 6
2015 - Atual
Técnicas para o Projeto de Blocos Aceleradores de Alta Eficiência Energética Considerando os Avanços Recentes da Tecnologia CMOS (HEESoC)
Descrição: Atualmente, os dispositivos pessoais móveis (Portable Mobile Devices - PMDs), tais como smartphones, tablets e consoles de jogos, respondem por uma parcela significava do mercado de produtos de eletrônica de consumo. Tais produtos são alimentados por baterias e requerem alto desempenho computacional. Como consequência, o projeto de sistemas integrados em chip (Systems on Chip - SoCs) para tais produtos se constitui em grande desafio, dado que os requisitos de alto desempenho e baixo consumo de energia são conflitantes. Para satisfazer tais requisitos, além de processadores de propósito geral, os SoCs precisam fazer de blocos aceleradores, os quais são projetados explorando as caracterísicas específicas das aplicações às quais se destinam (e.g., codificação de vídeo, processamento de sinais), a fim de atingir máxima eficiência energética. Entrentanto, como as aplicações evoluem continuamente com o surgimento de novos padrões (e.g., HEVC), novas técnicas de projeto nos níveis RT (Register-Transfer) e lógico precisam ser desenvolvidas. Além disso, o os blocos aceleradores geralmente são projetados usando um fluxo baseado em standard cells. Entretanto, conforme demonstram as diversas competições lançadas recentemente pela indústria, em importantes Congressos da área de EDA (Electronic Design Automation), diversas técnicas de síntese e otimização associadas ao fluxo standard cell encontram-se defasadas, em função da evolução da tecnologia CMOS. Com o objetivo de contribuir para avançar o estado, o presente projeto irá abordar os seguintes temas: - Dimensionamento (discreto) de portas considerando tecnologias CMOS recentes (e.g., FinFETs); - Posicionamento guiado por restrições de atraso, considerando modelos de atraso mais precisos; - Técnicas de projeto nos níveis RT e lógico para blocos aceleradores no domínio de processamento de sinais digitais, considerando novos padrões (e.g., HEVC)..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (6) / Mestrado acadêmico: (1) / Doutorado: (3) .
Integrantes: José Luís Almada Güntzel - Coordenador / Chrystian de Sousa Guth - Integrante / Ismael Seidel - Integrante / Marcio Monteiro - Integrante / CANCELLIER, LUIZ HENRIQUE - Integrante / LIVRAMENTO, VINICIUS - Integrante / NETTO, RENAN - Integrante / MORAES, BRUNO G. - Integrante / BRASCHER, ANDRE BEIMS - Integrante / Tiago Augusto Fontana - Integrante / Sheiny Fabre Almeida - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.
2014 - 2016
Análise de Timing de Circuitos Integrados Digitais em Tecnologias CMOS FinFET (TA-FinFET)
Descrição: A análise de timing é a principal técnica de verificação dos requisitos temporais dos sistemas integrados digitais contemporâneos, sendo utilizada nas diversas etapas de otimização ao longo do fluxo de projeto industrial. Como a maioria das técnicas de otimização são iterativas e a cada nova iteração os requisitos temporais precisam ser verificados, o número de rodadas de análise de timing que precisam ser executadas tende a ser muito elevado. Além disso, a eficácia de uma técnica de otimização depende, dentre diversos fatores, da precisão da análise de timing. Como consequência, é essencial que a análise de timing seja rápida e precisa. Por outro lado, o contínuo aumento do número de componentes dos sistemas integrados digitais, bem como o aumento do número de parâmetros a serem levados em conta pela análise de timing, dificultam a tarefa de manter os tempos de execução dos analisadores de timing dentro de valores aceitáveis. Para piorar a situação, as tecnologias CMOS mais recentes apresentam variações nos parâmetros de fabricação que levam a variações significativas das características temporais dos componentes dos circuitos, exigindo técnicas estatísticas de análise de timing, naturalmente mais sofisticadas do que as técnicas determinísticas. Em decorrência de tais dificuldades, a análise de timing tem sido alvo de grande interesse tanto por parte da academia quanto da indústria. Prova disto são as diversas publicações recentes sobre o tema e sobretudo, as duas recentes competições internacionais (TAU 2013 Variation Aware Timing Analysis Contest [SIN 13] e PATMOS 2011 Timing Analysis Contest [PAT 11]), organizadas por pesquisadores da academia e da indústria e apoiadas por importantes empresas, tais como Cadence, IBM, Intel e Synopsys. A evolução da tecnologia CMOS baseia-se na redução das dimensões dos transistores, o que conduz à redução do atraso individual das portas e ao aumento do número de transistores por unidade de área, e na redução da tensão de alimentação, como forma de manter a dissipação e o consumo energia dentro de valores aceitáveis. Entretanto, até recentemente, os transistores CMOS eram eminentemente planares. Porém, o tamanho reduzido do canal leva a efeitos de segunda ordem que dificultam sobremaneira o controle da corrente que atravessa o transistor. Apresentada recentemente, a técnica FinFET (transistores de múltiplos gates) foi concebida para aumentar a controlabilidade da corrente do canal, explorando a dimensão vertical e viabilizando a continuidade da evolução da tecnologia CMOS para além dos limites até então previstos, sendo por isso, reconhecida como o passo evolutivo mais significativo dos últimos anos. Entretanto, para a adoção em ampla escala da tecnologia FinFET o fluxo de projeto industrial deve ser reformulado, mediante a adaptação ou alteração das próprias ferramentas de EDA. Neste sentido, a investigação de novas técnicas de análise de timing é uma necessidade premente. Assim, o presente projeto de pesquisa visa colaborar para a adaptação do fluxo de projeto de circuitos e sistemas digitais, a fim de viabilizar a adoção em grande escala da tecnologia CMOS FinFET, propondo um trabalho de mestrado cujo objetivo principal é o desenvolvimento e a validação de uma técnica de análise de timing para circuitos integrados digitais fabricados nas tecnologias CMOS FinFET atuais e vindouras. Como objetivos específicos, espera-se identificar as tendências na variação dos parâmetros de fabricação das tecnologias CMOS em questão, determinar a necessidade do uso de métodos estatísticos (análise de timing estática estatística) na técnica a ser proposta e desenvolver um protótipo de ferramenta de EDA que implemente a técnica proposta e que apresente tempo de execução compatível com o fluxo de projeto industrial contemporâneo..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Mestrado acadêmico: (1) .
Integrantes: José Luís Almada Güntzel - Coordenador / Chrystian de Sousa Guth - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.
Número de produções C, T & A: 1 / Número de orientações: 1
2013 - 2016
Técnicas para o Projeto de Sistemas em Chip Energeticamente Eficientes (PQ 2012)
Descrição: Atualmente, os dispositivos pessoais móveis (Portable Mobile Devices - PMDs), tais como smartphones, tablets e consoles de jogos, respondem por uma parcela significava do mercado de produtos de eletrônica de potência. Tais produtos requerem alto desempenho computacional e são alimentados por baterias. Como consequência, o projeto de sistemas integrados em chip (Systems on Chip - SoCs) para tais produtos se constitui em grande desafio, dado que os requisitos de alto desempenho e baixo consumo de energia são conflitantes. As técnicas de projeto de circuitos integrados digitais que consumam baixa energia e que dissipem baixa potência (geralmente referenciados por "low power design techniques") começaram a ser pesquisadas na década de 1990 e desde então tem sido um tópico de intensa investigação. Os SoCs atuais são muito complexos, sendo compostos por diversos processadores de propósito geral, blocos aceleradores em hardware (i.e., processadores dedicados) e não-raro, um sub-sistema completo de memória, constituído por níveis hierárquicos (incluindo memórias cache privadas e compartilhadas). O uso de blocos aceleradores visa executar com alta eficiência energética tarefas de alto custo computacional (e portanto, com desempenho e baixo consumo de energia). O projeto de tais blocos ainda oferece significativos desafios, uma vez que tarefas de multimidia (e.g., compressão de vídeo) apresentam crescente demanda por eficiência energética, na medida que novos padrões tem sido elaborados. Daí a necessidade de se continuar pesquisando técnicas de projeto low-power para aplicações específicas. Por outro lado, significativo consumo de energia em um SoC atual advém dos acessos às memórias de dados e de instruções e por isso, também é preciso otimizá-lo em função das características particulares da aplicação-alvo. O presente projeto de pesquisa visa contribuir para a elaboração de técnicas inovadoras que permitam o projeto de SoCs energeticamente eficientes nas tecnologias de fabricação CMOS do estado da arte e vindouras, contribuindo com: - Um método de alocação de elementos de programas para sistemas embarcados mono e multiprocessados, considerando as especificidades das aplicações-alvo; - Uma técnica (e seus respectivos algoritmos) para a redução de consumo estático (leakage) em circuitos digitais utilizando dimensionamento discreto de portas (gate sizing); - Técnicas de projeto no nível RT e técnicas de otimização nos níveis lógico e físico para o projeto de blocos aceleradores com alta eficiência energética, voltados a aplicações de codificação de vídeo e processamento de sinais digitais..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (7) / Mestrado acadêmico: (5) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Volpato - Integrante / Chrystian de Sousa Guth - Integrante / Pedro Veit Michel - Integrante / Eduardo Boabaid - Integrante / Rafael Westphal - Integrante / Ismael Seidel - Integrante / SORATO, EDSON - Integrante / LIVRAMENTO, VINICIUS - Integrante / NETTO, RENAN - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.
Número de produções C, T & A: 19 / Número de orientações: 6
2012 - 2015
Brazil IP (Fase II): MFBM: Projeto e prototipagem de um IP-core configurável para block matching em codificação de vídeo
Descrição: Este projeto visa o desenvolvimento de um IP-core capaz de realizar o cálculo de similaridade para block matching para codificação de vídeo em diversos padrões (e.g., MPEG-1/2/4, H.264/AVC, VP8 e HEVC). Para tanto, o IP-core deve ser configurável com relação à métrica de similaridade utilizada (SAD - Sum of Squared Differences, SSD - Sum of Squared Differences e SATD - Sum of Absolute Transformed Differences) e quanto à taxa de amostragens (todas as amostras, subamostragem 2:1 ou subamostragem 4:1). Finalmente, o desenvolvimento da arquitetura do IP-core leva em conta os requisitos de desempenho e as restrições de consumo de energia associadas aos dispositivos pessoais alimentados por bateria, quando executando aplicações multimídia típicas..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (5) / Doutorado: (2) .
Integrantes: José Luís Almada Güntzel - Coordenador / Luiz Claudio Villar dos Santos - Integrante / Bruno - Integrante / LIVRAMENTO - Integrante / Eduardo Boabaid - Integrante / Ismael Seidel - Integrante / André Beims Bräscher - Integrante / Rodrigo Travessini - Integrante / Matheus Valente da Silva - Integrante.
2010 - 2014
Verificação Funcional de Sistemas Integrados de Baixa Potência
Descrição: O aumento da complexidade das aplicações que precisam ser executadas nos dispositivos alimentados por bateria tem agravado as restrições de consumo de energia e de dissipação de potência dos sistemas integrados que os equipam. Para satisfazer a tais restrições, os projetistas são obrigados a fazer uso de técnicas de redução de potência agressivas, tais como clock gating e técnicas baseadas no controle de tensão (Voltage-Based Power Management ? VPM). Em função de causar pouco impacto nos fluxos de projeto, a técnica de clock gating tem sido amplamente utilizada. Porém, com a dominância do consumo estático de potência sobre o consumo dinâmico, observada em tecnologias a partir de 90nm, faz-se necessária a adoção de técnicas eficientes na redução do consumo estático (e.g., VPM). A adoção de técnicas de controle de tensão traz novas demandas tanto em termos de modelagem quanto em termos de verificação do sistema, uma vez que os fluxos e as linguagens de descrição de hardware (HDLs) como VHDL e Verilog não permitem a modelagem explícita de diferentes valores de tensão em um projeto. O presente projeto visa propor e avaliar uma solução para a verificação funcional de sistemas integrados de baixa potência, projetados com o uso de uma técnica VPM..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (1) / Mestrado acadêmico: (1) .
Integrantes: José Luís Almada Güntzel - Coordenador / LIVRAMENTO - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.
Número de produções C, T & A: 4 / Número de orientações: 1
2010 - 2013
SEICE: Técnicas para o Projeto de Sistemas Eletrônicos Integrados Confiáveis e Eficientes
Descrição: O presente projeto visa o desenvolvimento de técnicas para projeto de sistemas eletrônicos integrados confiáveis e eficientes. A confiabilidade refere-se ao funcionamento tolerante a falhas transientes, enquanto que a eficiência refere-se ao uso racional de energia (baixo consumo). Como decorrência deste objetivo principal serão criados modelos executáveis eficientes em ESL de sistemas completos (possivelmente em linguagem SystemC), usando-se o conceito de projeto baseado em plataformas, e de partes críticas de sistemas (e.g., subsistema de memória, blocos aceleradores de hardware), sobre os quais serão desenvolvidas as técnicas para automatização e otimização. Os objetivos específicos deste projeto são: - Propor novas técnicas de modelagem, otimização e verificação de componentes de hardware e software no contexto de MPSoCs. - Investigar técnicas para o projeto de sistemas (em ESL) de baixo consumo, tolerantes a falhas. - Desenvolver técnicas de projeto para operadores aritméticos de baixo consumo, tolerantes a falhas. - Aplicar e/ou desenvolver técnicas inovadoras para o projeto de blocos aceleradores de hardware com baixo consumo de energia, dedicados a aplicações em domínios específicos (compressão de vídeo, transmissão wireless e processamento de sinais)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (4) / Especialização: (0) / Mestrado acadêmico: (7) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Luiz Claudio Villar dos Santos - Integrante / Alexandre Mendonça - Integrante.
2009 - Atual
INCT-Namitec - Instituto Nacional de Ciência e Tecnologia de Sistemas Micro e Nanoeletrônicos (A2.4 - Circuitos e Sistemas Digitais)
Descrição: O Instituto Nacional de Ciência e Tecnologia de Sistemas Micro e Nanoeletrônicos - INCT NAMITEC - é uma rede que reúne as principais instituições que desenvolvem nano e microeletrônica no Brasil. São ao todo 23 centros de pesquisa e universidades, espalhados por 13 estados nas cinco regiões do pais. Com 124 pesquisadores, o NAMITEC tem uma atuação ampla em micro e nanoeletrônica, com pesquisas e ações no estudo de redes de sensores sem fio, sistemas embarcados, projeto de circuitos integrados, estudos de dispositivos, materiais e técnicas de fabricação e formação de recursos humanos, com aplicação em áreas como: -Tecnologia da Informação e Comunicação -Instrumentação Biomédica e Vida Assistida - Redes Veiculares- Ambientes Inteligentes -Indústria Automotiva e Aeroespacial -Produção, Distribuição e Uso de Energia -Ecologia No contexto do INCT NAMITEC, a tarefa A2.4 tem por objetivo o desenvolvimento e o uso de técnicas de projeto, otimização, validação e caracterização de circuitos e sistemas digitais integrados dedicados à detecção e classificação de sons específicos de determinada espécie (por exemplo, espécie de aves, espécie de anuros etc), cujos sons permitem monitorar variáveis ambientais. Para atingir este objetivo, a atividade em questão desenvolve algoritmos, suas implementações e protótipos dos seguintes circuitos digitais: SAD (?Sound Activity Detection?), front end (responsável pela conversão da forma de onda do sinal de áudio no domínio do tempo para um conjunto de características), classificador (baseado em Suport Vector Machines - SVM) e codificação do sinal de áudio (usando técnicas como ADPCM e codificação ?lossless?)..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (4) / Especialização: (0) / Mestrado acadêmico: (4) / Mestrado profissional: (0) / Doutorado: (1) .
Integrantes: José Luís Almada Güntzel - Integrante / Ivan Saraiva Silva - Integrante / Luiz Claudio Villar dos Santos - Integrante / Fernando Rangel de Sousa - Integrante / Ricardo Pezzuol Jacobi - Integrante / KLAUTAU, ALDEBARO - Integrante / Jacobus Swart - Coordenador / Cleonilson Protásio de Souza - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.Número de orientações: 2
2008 - 2012
Brazil IP (Fase I): Concepção, prototipagem e teste de um IP-core para o cálculo da DCT-2D
Descrição: Este projeto trata da concepção, prototipagem e teste de um IP-core denominado DCT-2D, dedicado à codificação de imagens em formato JPEG. O IP-core proposto poderá ser usado em codificadores de imagens no formato JPEG, um dos mais utilizados em aplicações multimídia, como, por exemplo, em câmeras digitais, PDAs e palm-tops. Na primeira etapa, o desenvolvimento do projeto está orientado à prototipagem do IP-core em FPGA e à criação de um demonstrativo de uso. A segunda etapa consiste na síntese com fluxo standard cell e a sua prototipagem em silício..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (5) / Especialização: (1) / Mestrado acadêmico: (2) .
Integrantes: José Luís Almada Güntzel - Integrante / Luiz Claudio Villar dos Santos - Coordenador / Volpato - Integrante / Bruno - Integrante / Jucemar - Integrante / LIVRAMENTO - Integrante / BRUNNO - Integrante / Eduardo Boabaid - Integrante / Fernando Petters - Integrante / Leandro da Silva Freitas - Integrante.
2008 - 2010
SisRas: Sistemas Computacionais com Capacidade de Confiabilidade, Disponibilidade e Utilidade
Descrição: Este projeto tem como objetivos: 1.desenvolver modelos para integração em ferramentas de CAD, que permitam o projeto do hardware capaz de tolerar flutuações elétricas nos dispositivos, flutuações estas advindas da variabilidade e de falhas transientes, e que também minimizem o efeito de ?aging?. 2.desenvolver técnicas e arquiteturas de hardware para garantir a capacidade de RAS em aplicações críticas. Essas técnicas contam com o uso de sensores embarcados em hardware para diagnosticar efeito de ?aging? e de falhas transientes (?soft errors?), além do uso de técnicas de tolerância a falhas nos diversos níveis do projeto. A automatização destas técnicas através de uma ferramenta de CAD também será estudada. 3.modificar e desenvolver algoritmos mais eficientes para as ferramentas de CAD, de forma a permitir a aplicação dos modelos e das técnicas de tolerância desenvolvidos na síntese lógica, na síntese física e na etapa de teste. 4.formar recursos humanos em tecnologia de informação, especialmente no projeto de sistemas integrados confiáveis e disponíveis..
Situação: Em andamento; Natureza: Pesquisa.
2008 - 2009
Tecnologias para Computação Ubíqua: do CMOS nanométrico
Descrição: O objetivo deste projeto é o de propor um cenário concreto de transição tecnológica para a viabilização de sistemas ubíquos, através da hibridização de tecnologias. Objetivos específicos da Linha 1 Modelagem e síntese de memórias robustas e de ultra-baixo consumo, sua caracterização em tecnologias CMOS nanométricas e a captura de seu comportamento energético em níveis superiores de abstração, através de macromodelos a serem utilizados na estimativa de energia gasta ao executar software embarcado. Objetivos específicos da Linha 2 Síntese e caracterização de um sensor de pressão e de um sensor de presença de gases utilizando compostos orgânicos biocompatíveis..
Situação: Concluído; Natureza: Pesquisa.
2007 - 2010
ArqTol: Desenvolvimento de Técnicas para a Análise e Projeto de Arquiteturas Tolerantes a Falhas Não-Permanentes
Descrição: Este projeto tem por objetivo desenvolver, aplicar e avaliar o impacto de técnicas de projeto capazes de aumentar a tolerância de arquiteturas de hardware a falhas não-permanentes. Tais arquiteturas poderão ser implementadas utilizando-se componentes programáveis tipo FPGAs ou pela definição do leiaute das máscaras, para uma implementação CMOS (masked). Como estudo de caso, as técnicas serão aplicadas em arquiteturas voltadas para a compressão de vídeo. Outro objetivo não menos importante deste projeto é o desenvolvimento de modelos e técnicas computacionais que permitam a análise automática do comportamento de circuitos sob efeito de falhas não-permanentes do tipo SETs..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (3) .
Integrantes: José Luís Almada Güntzel - Coordenador / Helen de Souza Franck - Integrante / Volpato - Integrante / Bruno - Integrante / Jucemar - Integrante / Robson - Integrante / Ismael - Integrante / Nihei - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.
Número de produções C, T & A: 8 / Número de orientações: 9
2006 - 2008
SOC-Métodos: Metodologias de Projeto de Circuitos e Sistemas Integrados em Chip
Descrição: O objetivo deste projeto é desenvolver metodologias e ferramentas computacionais para o projeto de arquiteturas para integração em único chip, incluindo desde a especificação arquitetural até o projeto lógico e físico de circuitos integrados e suas respectivas etapas de verificação por ferramentas de CAD. A proposta envolve trabalhos conjuntos entre os lados cooperantes e reforça a complementariedade temática dos grupos do Brasil e do grupo do INESC-ID em Portugal. Diferentes técnicas para aumento de desempenho e redução do consumo de potência em arquiteturas dedicadas para DSP serão exploradas. OBS: Projeto aprovado no escopo do acordo de cooperação internacional Brasil-Portugal (CAPES-GRICES). Processo CAPES 167/06. Instituições envolvidas: pelo lado brasileiro, UFRGS (coordenadora), UFSM, UFPel e UCPel; pelo lado português, INESC-ID (ligado ao Instituto Superior Tecnico de Lisboa - IST) Vigência: janeiro/2006 a dezembro/2007 (renovável por um ano) Benefícios: duas missões de trabalho por ano (em cada sentido) e duas bolsas de estudos (doutorado sanduíche) no sentido Brasil->Portugal..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Integrante / Ricardo Augusto da Luz Reis - Integrante / Sergio Bampi - Coordenador / Eduardo Antônio César da Costa - Integrante / João Baptista dos Santos Martins - Integrante / Luis Miguel Silveira - Integrante / José Carlos Alves Pereira Monteiro - Integrante / Paulo Ferreira Godinho Flores - Integrante.Financiador(es): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro.
2005 - 2007
Desenvolvimento e Prototipação de Arquiteturas para Processamento de Imagens em Sistemas Embarcados (APISE)
Descrição: O foco deste projeto é o desenvolvimento de arquiteturas para a compressão de imagens e vídeo, para o reconhecimento de padrões em imagens e o desenvolvimento de ferramentas computacionais de apoio ao projeto físico destas arquiteturas. Para a compressão de imagens, o padrão JPEG 2000 será investigado e serão desenvolvidas arquiteturas para este padrão. Serão desenvolvidas arquiteturas para a transformada discreta de wavelet (DWT), para a quantização e para a codificação de entropia. Para a compressão de vídeo, o padrão H.264 será investigado e serão desenvolvidas arquiteturas para o estimador de movimento, para o preditor intra-espacial, para a transformada discreta do cosseno (DCT) e para o Codificador de Palavra Variável Adaptativa ao Contexto (CAVLC) e o Codificador Aritmético Binário Adaptativo ao Contexto (CABAC). Estão sendo desenvolvidas arquiteturas para o reconhecimento de padrões em imagens, baseadas em redes neurais artificiais, incluindo o desenvolvimento de operadores aritméticos (multiplicadores e somadores) integrados e de elevado desempenho. As arquiteturas para compressão de imagens e vídeo e para o reconhecimento de padrões estrão sendo implementadas, em um primeiro momento, em dispositivos reconfiguráveis do tipo FPGAs, por conta de sua grande flexibilidade de operação e facilidade para prototipação. Como diversos blocos que serão desenvolvidos terão fortes restrições de desempenho e consumo de energia, será necessário projetá-los no nível físico, não sendo possível apenas a implementação em FPGAs. A fim de permitir o projeto físico destes blocos, serão desenvolvidas ferramentas computacionais de geração automática de leiaute. OBS: Projeto aprovado no contexto do Edital CT-INFO/MCT/CNPq no 031/2004 (Pequenos Grupos). Processo CNPq 506565/2004-1. Vigência: janeiro/2005 a dezembro/2006. Benefício: R$ 143.000,00, (capital, custeio e 4 bolsas de ITI e uma bolsa DTI-G, posteriormente convertida para 4 bolsas de ITI)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (8) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Denis Teixeira Franco - Integrante / Luciano Volcan Agostini - Integrante / André Marcelo Coelho da Silva - Integrante / João Alberto Vortmann - Integrante / Eduardo Macedo Mesquita - Integrante / Ulisses Brisolara Correa - Integrante / Leandro Zanetti Paiva da Rosa - Integrante / Fabiane Konrad Rediess - Integrante / Guilherme Ribeiro Corrêa - Integrante / Matheus Braga Porciuncula - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.
2005 - 2005
Desenvolvimento de Arquiteturas de Microprocessadores para Aplicações Multimídia
Descrição: O objetivo deste projeto era desenvolver uma família de microprocessadores RISC, sendo um primeiro para aplicações genéricas e os demais para processmento gráfico e compressão de imagens dinâmicas. Em função do projeto ter sido contemplado com uma bolsa de IC com duração de apenas 5 meses, foi possível desenvolver apenas duas versões de um microprocessador RISC genérico: uma versão multiciclo e uma pipeline. Estas versões foram desenvolvidas em linguagem VHDL e validadas por meio de simulações usando o software Quartus II da Altera. OBS: Projeto aprovado no contexto do PIBIC CNPq/UFPel Vigência: março/2005 a julho/2005. Benefício: uma bolsa de IC durante o período de vigência acima especificado..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (1) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Fabiane Konrad Rediess - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.
2004 - 2006
Desenvolvimento de Algoritmos e Ferramentas para a Verificação de Timing de Blocos de Hardware
Descrição: Este projeto visou o desenvolvimento de ferramentas de verificação de timing de blocos de hardware implementados no nível de leiaute (IP hardcores). Partindo da experiência adquirida no tema "análise de timing funcional de blocos combinacionais", foram estudando os problemas que surgem quando se deseja realizar a análise de timing funcional de blocos de hardware descritos hierarquicamente. Além de aproveitar algoritmos e técnicas previamente desenvolvidos pelo próprio solicitante, o projeto também tratou da síntese física de blocos de hardware, com a finalidae de se obter subsídios práticos para o desenvolvimento e teste das ferramentas de análise de timing desenvolvidas. OBS: Projeto executado com o apoio financeiro da FAPERGS, por meio do Edital BIC2003. Processo FAPERGS 03/50019.6 Vigência: abril/2004 a fevereiro/2006 (um ano mais uma prorrogação de seis meses) Benefício: uma bolsa de IC da FAPERGS durante o período de vigência acima referido..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (1) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Daniel Lima Ferrão - Integrante / Carolina Gomes Neves - Integrante / Matheus Porciuncula Braga - Integrante.Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Bolsa.Número de orientações: 1
2003 - 2007
Sistemas em Chip : Metodologia de Projeto de Circuitos e Micro-Sistemas Integrados em Tecnologia CMOS
Descrição: Este projeto foca o desafio de integração de sistemas de computação em chips. Esta área engloba uma multiplicidade de técnicas e conhecimentos de engenharia de computação e de engenharia elétrica, com vistas a utilizar a capacidade tecnológica da microeletrônica para soluções de hardware originais. As contribuições do projeto estão no desenvolvimento de métodos de projeto de circuitos mistos analógico-digitais, ferramentas computacionais para sistemas-em-chip (SoC) e no desenvolvimento de circuitos integrados CMOS para aplicações específicas. Fazem parte deste projeto a UFRGS, a UFPel e a UCPel. A coordenação é do Prof. Sergio Bampi (UFRGS). A UFPel está encarregada do desenvolvimento de ferramentas para a Análise de Timing e de Metodologias para o Processamento de Imagens. OBS: Projeto aprovado no contexto da Chamada Conjunta MCT/SEPIN - FINEP - CNPq 01/2002 (Programa de Apoio à Pesquisa, Desenvolvimento e Inovação em Tecnologia da Informação - PDI-TI) Processo CNPq 552121/2002-9 Vigência: janeiro/2003 a dezembro/2006 Benefícios: R$ 669.000,00. Recursos destinados à UFPel: R$ 150.000,00 (capital e custeio), uma bolsa DTI-7G e três bolsas de ITI..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (3) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Integrante / Ricardo Augusto da Luz Reis - Integrante / Sergio Bampi - Coordenador / Michele dos Santos da Silva - Integrante / Carolina Gomes Neves - Integrante / Luciano Volcan Agostini - Integrante / Marcelo Soares Lubaszewski - Integrante / Eric Ericsen Fabris - Integrante / Marcelo Schiavon Porto - Integrante / Roger Endrigo Carvalho Porto - Integrante / Thaísa Leal da Silva - Integrante / Rafael de Lima Petry - Integrante / Eduardo Antônio César da Costa - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.Número de orientações: 4
2003 - 2005
Desenvolvimento de Sistemas em Silício Baseados no Reuso de Blocos de Hardware
Descrição: Este projeto investigou o estado da arte das metodologias de reuso de hardware, focando na análise de timing de sistemas em chip (SoCs) baseados no reuso de blocos de hardware de diferentes fabricantes. Como estudo de caso para esta investigação, foram desenvolvidas arquiteturas e operadores direcionados para o processamento de imagens, tanto em nível RTL quanto em nível de leiaute. Os blocos de hardware desenvolvidos seguiram os padrões industriais de reusabilidade (OCP e/ou VCI). OBS: Projeto aprovado no contexto do Edital Universal 2003. Processo CNPq 478579/2003-9. Vigência: outubro/2003 a outubro/2005. Benefícios: R$ 20.000,00 (metade em capital e metde em custeio)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (3) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Luciano Volcan Agostini - Integrante / Adriel Mota Ziesemer Junior - Integrante / Wagner Altermann - Integrante / Matheus Porciuncula Braga - Integrante / Marcelo Schiavon Porto - Integrante / Thaísa Leal da Silva - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.
2003 - 2004
Síntese e Verificação de Circuitos Integrados Digitais CMOS de Alto Desempenho
Descrição: Este projeto de cooperação internacional teve por objetivo unir as competências individuais dos grupos brasileiro e espanhol, de modo a formar um ambiente de pesquisa mais completo no que se refere aos aspectos de síntese (lógica e física) e verificação de circuitos em tecnologia CMOS estado-da-arte (submicrônica). Com este ambiente teve-se condições de contribuir para a formação de pessoal altamente qualificado em projeto de circuitos integrados CMOS de alto desempenho, bem como no desenvolvimento de ferramentas de CAD, contribuindo-se assim com o Plano Nacional de Microeletrônica - PNM, lançado no ano de 2001 pelo MCT. OBS: Projeto aprovado no contexto do acordo de cooperação internacional Brasil-Espanha (CAPES-MECD). Processo CAPES 51/03. Parceiros Envolvidos: pelo lado brasileiro, UFRGS (coordenadora) e UFPel; pelo lado espanhol, Universidade de Sevilha (Departamento de Tecnologia Eletrónica - DTE). Vigência: janeiro/2003 a dezembro/2004. Benefícios: duas missões de trabalho por ano para professores (em cada sentido) e duas missões de estudo por ano (em cada sentido)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Integrante / Ricardo Augusto da Luz Reis - Coordenador / Sergio Bampi - Integrante / Manuel Bellido - Integrante / Jorge JuanChico - Integrante / Manuel Valencia - Integrante.Financiador(es): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Bolsa.
2002 - 2005
Síntese Automática de Circuitos Integrados Visando Alto Desempenho e Baixo Consumo
Descrição: Este projeto teve por objetivo o desenvolvimento de metodologias e ferramentas para a síntse física, para a análise de timing e para a estimativa de consumo de energia em circuitos integrados CMOS em tecnologias submicrônicas. Em todas as etapas de síntese e também de análise, consideram-se os efeitos de acoplamento crosstalk, responsáveis pela degradação da qualidade dos sinais e por muitos dos problemas de temporização. OBS: Projeto aprovado no contexto da Cooperação Internacional Brasil-Portugal (CAPES-ICCTI, mais tarde renomeado "CAPES/GRICES") Instituições envolvidas: pelo lado brasileiro, UFRGS (coordenadora), UFSM, UFPel e UCPel; pelo lado português, INESC-ID (ligado ao Instituto Superior Tecnico de Lisboa - IST) Processo CAPES 086/02 Vigência: janeiro/2002 a dezembro/2005 Benefícios: duas missões de trabalho por ano para professores (nos dois sentidos) e bolsas de estudos (doutorado sanduíche)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Integrante / Ricardo Augusto da Luz Reis - Coordenador / Sergio Bampi - Integrante / Eduardo Antônio César da Costa - Integrante / João Baptista dos Santos Martins - Integrante / Luis Miguel Silveira - Integrante / José Carlos Alves Pereira Monteiro - Integrante / Arlindo Oliveira - Integrante / António Leal - Integrante.Financiador(es): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Cooperação / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Bolsa / Coordenação de Aperfeiçoamento de Pessoal de Nível Superior - Auxílio financeiro.
2002 - 2003
Desenvolvimento de Ferramentas de CAD para verificação de Circuitos Integrados em Tecnologia Submicrônica
Descrição: Este projeto teve por objetivo o desenvolvimento e a implementação de algoritmos e modelos para a análise de timing de circuitos combinacionais feitos com portas CMOS complexas. Os algoritmos escolhidos consideram o fenômeno dos falsos caminhos, enquanto que os modelos físicos a serem utilizados deverão levar em conta as características da tecnologia CMOS submicrônica. Concluiu-se uma versão inicial de ferramenta de análise de timing capaz de verificar as restrições temporais de blocos combinacionais feitos com portas CMOS estáticas em tecnologia estado-da-arte (submicrônica). OBS: Projeto aprovado no contexto de Edital para Auxílio Recém-Doutor (ARD) da FAPERGS, versão 2001. Processo FAPERGS 01/1575-4. Vigência: agosto/2002 a julho/2003. Benefícios: R$ 10.000,00 reais para compra de equipamento e material bibliográfico e uma bolsa de IC FAPERGS durante um ano..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (2) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Daniel Lima Ferrão - Integrante / Carolina Gomes Neves - Integrante.Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro / Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Bolsa.Número de orientações: 1
2001 - 2002
Estudo e Desenvolvimento de Modelos e Algoritmos para Análise de Timing de Circuitos VLSI.
Descrição: Este projeto teve por objetivo o desenvolvimento e a implementação de algoritmos e modelos para a análise de timing e circuitos combinacionais feitos com portas CMOS complexas. Os algoritmos escolhidos consideram o fenômeno dos falsos caminhos, enquanto que os modelos físicos a utilizados levam em conta as características da tecnologia CMOS submicrônica. OBS: Projeto aprovado no contexto do Edital CNPq/Kit-Enxoval Recém-Doutor do Programa PROTEM-CC. Processo CNPq 680085/01-7. Vigência: junho/2001 a maio/2002. Benefícios: uma bolsa DTI-7A (alocada para José Luís Almada Güntzel, coordenador do projeto), duas bolsas de IC (todas as bolsas com vigência de 12 meses), computador IBM NetVista (Pentium 3), uma passagem aérea nacional, uma passagem aérea internacional, 5 diárias nacionais, 15 diárias internacionais e R$ 1.000,00 para aquisição de material bibliográfico)..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (2) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador / Gustavo Reis Wilke - Integrante / Márcio Bystronski - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa / Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.Número de orientações: 2
2001 - 2001
Estudo e Implementação de Algoritmos e Modelos para Análise de Timing Funcional de Circuitos VLSI
Descrição: Este projeto teve como objetivos o desenvolvimento, a implementação e o teste de modelos e algoritmos para análise de timing funcional de blocos combinacionais contendo portas lógicas complexas. Como resulto final, implementou-se uma ferramenta de análise de timing funcional adequada para circuitos em tecnologia CMOS estado-da-arte e contendo portas complexas. OBS: Projeto aprovado no contexto de solicitação de Bolsa Recém-Doutor (Fluxo Contínuo). Processo CNPq 300003/01-3. Vigência: abril/2001 a maio/2001. (Este projeto foi cancelado, em função da aprovação do projeto referente ao Kit-Enxoval Recém-Doutor do programa PROTEM-CC, o qual também previa a implementação de bolsa para o coordenador) Benefício: uma bolsa de Recém-doutor no valor de R$ 1.800,00..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Coordenador.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Bolsa.


Projetos de desenvolvimento


1999 - 2001
Projeto SuperWulf: Desenvolvimento de um Cluster Baseado em Beowulf
Descrição: Este projeto teve como objetivos desenvolver um cluster (agregado) de computadores, a fim de poder rodar aplicações paralelas e distribuídas. A construção do cluster foi baseada na arquitetura BeoWulf, utilizando software básico de livre uso (linux). Como ambiente de programação, foram utilizadas as bibliotecas PVM e MPI. Este projeto deu suporte para dois trabalhos de conclusão de curso e também serviu para proporcionar aos professores uma experiência em ambientes paralelos. OBS: Projeto aprovado no contexto de chamada interna da Pro-Reitoria de Pesquisa da Universidade Luterana do Brasil (ULBRA), Canoas/RS Benefícios: remuneração equiuvalente a 8 horas/semana para cada professor participante e uma bolsa de IC da ULBRA..
Situação: Concluído; Natureza: Desenvolvimento.
Alunos envolvidos: Graduação: (2) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: José Luís Almada Güntzel - Integrante / Roland Teodorowitch - Integrante / João Carlos Gluz - Coordenador / Francisco Assis Moreira do Nascimento - Integrante / Ricardo Hernandes Fernandes - Integrante.Financiador(es): Universidade Luterana do Brasil - Auxílio financeiro.


Revisor de periódico


2010 - Atual
Periódico: JICS. Journal of Integrated Circuits and Systems (Ed. Português)
2010 - Atual
Periódico: Journal of Electronic Testing


Áreas de atuação


1.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Microeletrônica.
2.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Hardware.
3.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Arquitetura de Sistemas de Computação.


Idiomas


Inglês
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.
Francês
Compreende Bem, Fala Bem, Lê Bem, Escreve Razoavelmente.
Espanhol
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Razoavelmente.
Alemão
Compreende Razoavelmente, Fala Pouco, Lê Razoavelmente, Escreve Pouco.
Italiano
Compreende Razoavelmente, Fala Pouco, Lê Razoavelmente, Escreve Pouco.
Catalão
Compreende Razoavelmente, Fala Pouco, Lê Bem, Escreve Pouco.
Português
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.


Prêmios e títulos


2018
Best Paper Award no SIM2018, categoria "With na undergraduate student as first author", SBC (Sociedade Brasileira de Computação) e SBMicro (Sociedade Brasileira de Microeletrônica).
2017
Coorientador de Trabalho classificado em 3o lugar no CTD2017 da SBC (Concurso de Teses e Dissertações da Sociedade Brasileira de Computação), Sociedade Brasileira de Computação (SBC).
2017
Coorientador da Melhor Tese de Doutorado em Projeto, CAD e Teste de CIs (concurso SBMicro - CEITEC), Sociedade Brasileira de Microeletrônica e CEITEC S.A. Semiconductors.
2017
Third Place no CAD Contest @ ICCAD 2017 (Problem C: Multideck standard cell legalization) - orientador da equipe, IEEE CAS, CEDA, ACM SIGDA.
2017
orientador de trabalho classificado entre os 10 melhores do CTIC2017 (Concurso de Trabalhos de Iniciação Científica), Sociedade Brasileira de Computação (SBC).
2015
2015 International Symposium on Physical Design (ISPD2015) Best Paper nominated, Association for Computer Machinery (ACM).
2015
Paraninfo da Turma de Formandos 2014.2 do curso de Engenharia Eletrônica (1a turma), Universidade Federal de Santa Catarina.
2015
First Place no CAD Contest @ ICCAD 2015 (Problem C: Incremental Timing-Driven Placement) - orientador da equipe, IEEE CAS, CEDA, ACM SIGDA.
2013
First Place in the Discrete Gate Sizing Contest, ACM ISPD - International Symposium on Physical Design 2013, ACM/SIGDA e Intel.
2012
Orientador de Trabalho Classificado em 2o lugar no CTIC/SBC (Concurso de Trabalhos de Iniciação Científica da Sociedade Brasileira de Computação), Sociedade Brasileira de Computação (SBC).
2011
Co-orientador de uma das 10 dissertações finalistas no Concurso de Teses e Dissertações (CTD 2011). Aluno: Alexandre K. I. de Mendonça, Sociedade Brasileira de Computação (SBC).
2011
Orientador de dissertação premiada com "Menção Honrosa" (entre as 3 melhores) no Concurso de Teses e Dissertações do WSCAD2011, Sociedade Brasileira de Computação (SBC).
2008
Best Poster Award - SForum2008, VIII Microelectronics Students Forum (SForum 2008)., Sociedade Brasileira e Computação (SBC) e Sociedade Brasileira de Microeletrônica (SBMicro).
2008
Professor Homenageado da Turma de Formandos 2008/2 do Bacharelado em Ciência da Computação, Universidade Federal de Pelotas.
2007
Patrono da Turma de Formandos 2007/1 do Bacharelado em Ciência da Computação, Universidade Federal de Pelotas.
2006
ALTERA Best Paper Award SPL2006, Altera Corporation e SPL2006 (II Southern Conference on Programmable Logic).
2006
Patrono e Paraninfo da Turma de Formandos 2005/2 do Bacharelado em Ciência da Computação, Universidade Federal de Pelotas.
2006
3o lugar da área de Ciências Exatas e da Terra do XIV Congresso de Iniciação Científica (Trabalho orientado), Universidade Federal de Pelotas (Pró-Reitoria de Pesquisa e Pós-Graduação).
2006
Patrono da Turma de Formandos 2006/1 do Bacharelado em Ciência da Computação, Universidade Federal de Pelotas.
2006
Concurso para Professor Adjunto, área Arquitetura de Computadores (aprovado em 2o lugar), Universidade Federal de Santa Catarina (UFSC) - Departamento de Informática e Estatística.
2006
Concurso para Professor Adjunto, área Microeletrônica (aprovado em 3o lugar), Universidade Federal de Santa Catarina (UFSC) - Departamento de Engenharia Elétrica.
2006
3o lugar da área de Engenharias do XV Congresso de Iniciação Científica (Trabalho orientado), Universidade Federal de Pelotas (Pró-Reitoria de Pesquisa e Pós-Graduação).
2005
1o lugar de sessão de apresentação oral do XVII Salão de Iniciação Científica (Trabalho orientado), Universidade Federal do Rio Grande do Sul (Pró-Reitoria de Pesquisa).
2004
Concurso para Professor Adjunto, área Informática Aplicada (aprovado em 6o lugar), Universidade Federal do Rio Grande do Sul (UFRGS) - Departamento de Informática Aplicada.
2004
Concurso para Professor Adjunto, área Arquitetura de Computadores (aprovado em 1o lugar), Universidade Federal de Santa Catarina (UFSC) - Departamento de Informática e Estatística.
2003
1o Lugar na sessão de posters da Área de Ciências Exatas e da Terra do XII Congresso de Iniciação Científica da UFPel (Trabalho orientado), Universidade Federal de Pelotas (Pró-Reitoria de Pesquisa e Pós-Graduação).
2003
Professor Homenageado dos Formandos em Ciência da Computação/2002-2, Universidade Federal de Pelotas.
2002
1o lugar de sessão de apresentação oral do XIII Salão de Iniciação Científica (Trabalho Orientado), Universidade Federal do Rio Grande do Sul (UFRGS), Pró-Reitoria de Pesquisa.
2002
Concurso para Professor Adjunto, área Informática Aplicada (aprovado em 6o lugar), Universidade Federal do Rio Grande do Sul (UFRGS) - Departamento de Informática Aplicada.
2002
Concurso para Professor Adjunto, área Microeletrônica e Técnicas Digitais (aprovado em 1o lugar), Universidade Federal de Pelotas (UFPel) - Departamento de Matemática, Estatística e Computação.
2001
Professor Homenageado dos Formandos em Ciência da Computação/2000-2, Universidade Luterana do Brasil (ULBRA).
2001
Professor Homenageado dos Formandos em Engenharia Elétrica/2001-1, Universidade Luterana do Brasil (ULBRA).
1999
Concurso para Professor Adjunto, área Hardware (aprovado em 4o lugar), Universidade Federal do Rio Grande do Sul (UFRGS) - Departamento de Informática Aplicada.
1992
Prêmio NUTEC - Categoria Pós-Graduação, empresa NUTEC e Instituto de Informática da UFRGS.


Produções



Produção bibliográfica
Citações

SCOPUS

Artigos completos publicados em periódicos

1.
LIVRAMENTO, VINICIUS2017 LIVRAMENTO, VINICIUS ; LIU, DERONG ; CHOWDHURY, SALIM ; YU, BEI ; XU, XIAOQING ; PAN, DAVID Z. ; GUNTZEL, JOSE LUIS ; DOS SANTOS, LUIZ C. V . Incremental Layer Assignment Driven by an External Signoff Timing Engine. IEEE TRANSACTIONS ON COMPUTER-AIDED DESIGN OF INTEGRATED CIRCUITS AND SYSTEMS, v. 36, p. 1126-1139, 2017.

2.
LIVRAMENTO, Vinícius dos Santos2016LIVRAMENTO, Vinícius dos Santos ; NETTO, Renan Oliveira ; GUTH, Chrystian de Sousa ; GUNTZEL, JOSE LUIS ; SANTOS, Luiz Claudio Villar dos . Clock-Tree-Aware Incremental Timing-Driven Placement. ACM TRANSACTIONS ON DESIGN AUTOMATION OF ELECTRONIC SYSTEMS, v. 21, p. 1-27, 2016.

3.
CANCELLIER, LUIZ HENRIQUE2015CANCELLIER, LUIZ HENRIQUE ; BRÄSCHER, ANDRÉ BEIMS ; SEIDEL, I. ; GÜNTZEL, J. L. ; AGOSTINI, Luciano Volcan . Exploring Optimized Hadamard Methods to Design Energy-Efficient SATD Processors. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 10, p. 113-122, 2015.

4.
SEIDEL, Ismael2015SEIDEL, Ismael ; Bräscher, André Beims ; MONTEIRO, Marcio ; GÜNTZEL, JOSÉ LUÍS . Towards optimal use of pel decimation to trade off quality for energy. Analog Integrated Circuits and Signal Processing, v. 85, p. 107-128, 2015.

5.
LIVRAMENTO, Vinícius dos Santos2014 LIVRAMENTO, Vinícius dos Santos ; GUTH, Chrystian de Sousa ; GÜNTZEL, Jose Luis ; JOHANN, Marcelo de Oliveira . A Hybrid Technique for Discrete Gate Sizing Based on Lagrangian Relaxation. ACM Transactions on Design Automation of Electronic Systems, v. 19, p. 1-25, 2014.

6.
SEIDEL, I.2014SEIDEL, I. ; Bräscher, André Beims ; MORAES, BRUNO G. ; MONTEIRO, M. ; GÜNTZEL, J. L. A. . Analysis of Pel Decimation and Technology Choices to Reduce Energy on SAD Calculation. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 9, p. 48-59, 2014.

7.
LIVRAMENTO, Vinícius dos Santos2012LIVRAMENTO, Vinícius dos Santos ; MORAES, Bruno George de ; MACHADO, Brunno Abner ; GONÇALVES, Eduardo Spyrides Boabaid Pimentel ; GÜNTZEL, J. L. A. . Evaluating the Impact of Architectural Decisions on the Energy Efficiency of FDCT/IDCT Configurable IP Cores. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 7, p. 23-36, 2012.

8.
MONTEIRO, Jucemar Luis2012MONTEIRO, Jucemar Luis ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. . Uma Arquitetura Rápida de Somador Binário de Alta Eficiência Energética. Revista Eletrônica de Iniciação Científica, v. 12, p. 1-11, 2012.

9.
AGOSTINI, Luciano Volcan2007AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . Forward and Inverse 2-D DCT Architectures Targeting HDTV for H.264/AVC Video Compression Standard.. Latin American Applied Research, v. 37, p. 11-16, 2007.

10.
VORTMANN, João Alberto2006VORTMANN, João Alberto ; SILVA, Thaísa Leal da ; REDIESS, Fabiane Konrad ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Codificador de Entropia Segundo o Perfil Baseline do Padrão H.264/AVC de Compressão de Vídeo.. Hífen (Uruguaiana), v. 30, p. 49-56, 2006.

11.
REDIESS, Fabiane Konrad2006REDIESS, Fabiane Konrad ; SILVA, André Marcelo Coelho da ; VORTMANN, João Alberto ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Projeto de Hardware para a Compensação de Movimento do Padrão H.264/AVC de Compressão de Vídeo.. Hífen (Uruguaiana), v. 30, p. 57-64, 2006.

12.
SILVA, Thaísa Leal da2005SILVA, Thaísa Leal da ; PORTO, Marcelo Schiavon ; PORTO, Roger Endrigo Carvalho ; ROSA, Lendro Zanetti Paiva da ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Comparison between OCP, PVCI and BVCI Hardware Reuse Interfaces Designed in VHDL and Mapped to FPGAs.. Hífen (Uruguaiana), Uruguaiana, RS, v. 29, n.55-56, p. 119-128, 2005.

13.
PORTO, Marcelo Schiavon2005PORTO, Marcelo Schiavon ; ROSA, Leandro Zanetti Paiva da ; SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Arquiteturas de Cálculo da FDCT 2-D e da IDCT 2-D para Codecs HDTV no Padrão H.264/AVC. Hífen (Uruguaiana), Uruguaiana, RS, v. 29, n.55-56, p. 129-137, 2005.

14.
BASTIAN, Fabrício Biolo2004BASTIAN, Fabrício Biolo ; LAZZARI, Cristiano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . A New Transistor Folding Algorithm Applied to an Automatic Full-Custom Layout Generation Tool. Lecture Notes in Computer Science, Berlin, v. 3254, p. 732-741, 2004.

15.
GÜNTZEL, J. L. A.2001GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz . Análise de Timing Funcional de Circuitos VLSI Contendo Portas Complexas.. Revista de Informática Teórica e Aplicada, Porto Alegre, v. 8, n.1, p. 111-142, 2001.

Livros publicados/organizados ou edições
1.
REIS, Ricardo Augusto da Luz (Org.) ; GÜNTZEL, J. L. A. (Org.) . 17th South Symposium on Microelectronics. Porto Alegre: UFRGS, 2002. 153p .

2.
GÜNTZEL, J. L. A.; REIS, R. A. L. (Org.) ; MARCHIORO, G. F. (Org.) . 2a Escola de Microeletrônica da SBC - Sul. Canoas: Editora da ULBRA - Universidade Luterana do Brasil, 2000. 110p .

3.
REIS, Ricardo Augusto da Luz (Org.) ; GÜNTZEL, J. L. A. (Org.) . XV Microelectronics Seminar - SIM2000. Canoas: Editora da ULBRA - Universidade Luterana do Brasil, 2000. 165p .

Capítulos de livros publicados
1.
REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira . Physical Design Automation.. In: Ricardo Augusto da Luz Reis; Marcelo Soares Lubaszewski; Jochen Jess. (Org.). Design of Systems on a Chip: Design and Test. 1ed.Berlin, Alemanha: Springer Verlag, 2006, v. , p. 83-108.

2.
LAZZARI, Cristiano ; DOMINGUES, Cristiano Viana ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . A Novel Full Automatic Layout Generation Strategy for Static CMOS Circuits. In: Manfred Glesner; Ricardo Augusto da Luz Reis; Leandro Indrusiak; V Mooney; H. Eveking. (Org.). VLSI-SOC: From Systems to Chips. 1ed.Berlin, Alemanha: Springer Verlag, 2006, v. , p. 197-211.

3.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Forward and Inverse 2-D DCT Architectures for H.264/AVC Video Compression Directed to HDTV.. In: Eduardo Boemo; Gustavo Sutter; Elías Todorovich; Sergio López-Buedo. (Org.). FPGA-Based System. 1ed.Madrid, Espanha: Universidad Autónoma de Madrid, 2006, v. , p. 11-18.

4.
GÜNTZEL, J. L. A.. Estilos de Projeto. In: REIS, Ricardo Augusto da Luz. (Org.). Concepção de Circuitos Integrados. 1ed.Porto Alegre: Sagra-Luzzato, 2000, v. 1, p. 77-98.

5.
GÜNTZEL, J. L. A.. Estilos de Projeto. In: Ricardo Augusto da Luz Reis. (Org.). Sistemas Digitales: Síntese Física de Circuitos Integrados. 1ed.Bogotá: Ediciones Uniandes y programa CYTED, 2000, v. 1, p. 75-99.

6.
LIMA, F. G. ; GÜNTZEL, J. L. A. . Componentes Programáveis. In: REIS, Ricardo Augusto da Luz; MARCHIORO, Gilberto Fernandes; GÜNTZEL, José Luís Almada. (Org.). 2a Escola de Microeletrônica da SBC-Sul. Canoas: Editora da ULBRA - Universidade Luterana do Brasil, 2000, v. , p. 71-95.

7.
LIMA, F. G. ; JOHANN, Marcelo de Oliveira ; GÜNTZEL, J. L. A. ; D'ÁVILA, E. ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . Designing a Masked Programmable Matrix for Sequential Circuits. In: Luis Miguel Silveira; Srinivas Devadas; Ricardo Augusto da Luz Reis. (Org.). VLSI: Systems on a Chip. Boston: Kluwer Academic Publishers, 2000, v. , p. 439-446.

8.
GÜNTZEL, J. L. A.. Técnicas de Implementação de Circuitos Lógicos.. In: Ricardo Augusto da Luz Reis; Marcello Macarthy. (Org.). I Escola de Microeletrônica da SBC/Regional Sul. 1ed.Porto Alegre: SBC, 1999, v. 1, p. 87-107.

Trabalhos completos publicados em anais de congressos
1.
MONTEIRO, Marcio ; SEIDEL, Ismael ; GUNTZEL, JOSE LUIS . On the calculation reuse in hadamard-based SATD. In: 2018 IEEE 9th Latin American Symposium on Circuits & Systems (LASCAS), 2018, Puerto Vallarta. 2018 IEEE 9th Latin American Symposium on Circuits & Systems (LASCAS), 2018. p. 1-4.

2.
SEIDEL, Ismael ; RODRIGUES FILHO, Vanio ; AGOSTINI, LUCIANO ; GUNTZEL, JOSE LUIS . Coding- and Energy-Efficient FME Hardware Design. In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018, Florence. 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018. p. 1-5.

3.
FABRE, Sheiny ; GÜNTZEL, Jose Luis ; PILLA, LAÉRCIO ; NETTO, Renan Oliveira ; FONTANA, T. A. ; LIVRAMENTO, VINICIUS . Enhancing Multi-Threaded Legalization Through k-d Tree Circuit Partitioning. In: 31st SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEMS DESIGN (SBCCI2018), 2018, Bento Gonçalves, Brazil. 31st SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEMS DESIGN (SBCCI2018). New York: IEEE, 2018. v. 1. p. 1-6.

4.
CANCELLIER, LUIZ HENRIQUE ; SEIDEL, I. ; GÜNTZEL, Jose Luis . On HEVC Robustness to Integer Motion Estimation Pruning. In: Accepted as full paper in the 2018 IEEE International Conference on Electronics, Circuits and Systems (ICECS 2018), 2018, Bordeaux, France. Accepted as full paper in the 2018 IEEE International Conference on Electronics, Circuits and Systems (ICECS 2018). New York: IEEE, 2018. v. 1. p. 1-4.

5.
LOHMANN, Douglas ; HUF, Alexis ; LETTNIN, D. V. ; SIQUEIRA, Frank ; GÜNTZEL, Jose Luis . A Domain-specific Language for Automated Fault Injection in SystemC Models. In: Accepted as full paper in the 2018 IEEE International Conference on Electronics, Circuits and Systems (ICECS 2018), 2018, Bordeaux, France. Accepted as full paper in the 2018 IEEE International Conference on Electronics, Circuits and Systems (ICECS 2018). New York: IEEE, 2018. v. 1. p. 1-4.

6.
NETTO, RENAN ; FONTANA, TIAGO ; FABRE, Sheiny ; FERRARI, Bernardo ; LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; SOUTO, João ; PILLA, LAÉRCIO ; GÜNTZEL, Jose Luis . Ophidian: an Open-Source Library for Physical Design Research and Teaching. In: Accepted for presentation in the 2018 Workshop on Open-Source EDA Technology (WOSET 2018), 2018, San Diego, CA, Estados Unidos. Accepted for presentation in the 2018 Workshop on Open-Source EDA Technology (WOSET 2018), 2018. v. 1. p. 1-4.

7.
FONTANA, TIAGO ; NETTO, RENAN ; LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; ALMEIDA, SHEINY ; PILLA, LAÉRCIO ; GÜNTZEL, JOSÉ LUÍS . How Game Engines Can Inspire EDA Tools Development. In: the 2017 ACM, 2017, Portland. Proceedings of the 2017 ACM on International Symposium on Physical Design - ISPD '17. New York: ACM, 2017. v. 1. p. 25-31.

8.
FONTANA, TIAGO AUGUSTO ; ALMEIDA, SHEINY ; NETTO, RENAN ; LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; PILLA, LAÉRCIO ; GÜNTZEL, JOSÉ LUIS . Exploiting cache locality to speedup register clustering. In: the 30th Symposium, 2017, Fortaleza. Proceedings of the 30th Symposium on Integrated Circuits and Systems Design Chip on the Sands - SBCCI '17, 2017. v. 1. p. 191-197.

9.
CANCELLIER, LUIZ HENRIQUE ; SEIDEL, Ismael ; GÜNTZEL, JOSÉ LUÍS . Block matching hardware architecture for SATD-based successive elimination. In: the 30th Symposium, 2017, Fortaleza. Proceedings of the 30th Symposium on Integrated Circuits and Systems Design Chip on the Sands - SBCCI '17. New York: ACM Press, 2017. v. 1. p. 149-154.

10.
Bräscher, André Beims ; SEIDEL, Ismael ; GÜNTZEL, JOSÉ LUÍS . Improving the energy efficiency of a low-area SATD hardware architecture using fine grain PDE. In: the 30th Symposium, 2017, Fortaleza. Proceedings of the 30th Symposium on Integrated Circuits and Systems Design Chip on the Sands - SBCCI '17. New York: ACM Press, 2017. v. 1. p. 155-161.

11.
SEIDEL, Ismael ; MONTEIRO, Marcio ; GUNTZEL, JOSE LUIS ; AGOSTINI, LUCIANO . Squarer exploration for energy-efficient sum of squared differences. In: 2016 IEEE 7th Latin American Symposium on Circuits & Systems (LASCAS), 2016, Florianopolis. 2016 IEEE 7th Latin American Symposium on Circuits & Systems (LASCAS). v. 1. p. 327-330.

12.
SEIDEL, Ismael ; BEIMS BRASCHER, ANDRE ; GUNTZEL, JOSE LUIS ; AGOSTINI, LUCIANO . Energy-efficient SATD for beyond HEVC. In: 2016 IEEE International Symposium on Circuits and Systems (ISCAS), 2016, Montréal. 2016 IEEE International Symposium on Circuits and Systems (ISCAS). v. 1. p. 802-805.

13.
NETTO, RENAN ; LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; DOS SANTOS, LUIZ C.V. ; GUNTZEL, JOSE LUIS . Evaluating the impact of circuit legalization on incremental optimization techniques. In: 2016 29th Symposium on Integrated Circuits and Systems Design (SBCCI), 2016, Belo Horizonte. 2016 29th Symposium on Integrated Circuits and Systems Design (SBCCI). v. 1. p. 1-6.

14.
SEIDEL, Ismael ; CANCELLIER, LUIZ HENRIQUE ; GUNTZEL, JOSE LUIS ; AGOSTINI, LUCIANO . Rate-constrained successive elimination of Hadamard-based SATDs. In: 2016 IEEE International Conference on Image Processing (ICIP), 2016, Phoenix. 2016 IEEE International Conference on Image Processing (ICIP). v. 1. p. 2395-2399.

15.
NETTO, RENAN ; LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; SANTOS, LUIZ C. V. DOS ; GUNTZEL, JOSE LUIS . Speeding up Incremental Legalization with Fast Queries to Multidimensional Trees. In: 2016 IEEE Computer Society Annual Symposium on VLSI (ISVLSI), 2016, Pittsburgh. 2016 IEEE Computer Society Annual Symposium on VLSI (ISVLSI), 2016. v. 1. p. 36-41.

16.
SEIDEL, Ismael ; GUNTZEL, JOSE LUIS ; AGOSTINI, LUCIANO . Coarse grain partial distortion elimination for Hadamard ME in HEVC. In: 2016 IEEE International Conference on Electronics, Circuits and Systems (ICECS), 2016, Monte Carlo. 2016 IEEE International Conference on Electronics, Circuits and Systems (ICECS). v. 1. p. 704-707.

17.
NETTO, RENAN ; GUTH, Chrystian de Sousa ; LIVRAMENTO, Vinícius dos Santos ; CASTRO, M. B. ; PILLA, L. L. ; GÜNTZEL, JOSÉ LUÍS . Exploiting Parallelism to Speed Up Circuit Legalization. In: 23rd IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2016), 2016, Monte Carlo, Monaco. 23rd IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2016), 2016. v. 1. p. 624-627.

18.
MONTEIRO, JUCEMAR ; FLACH, GUILHERME ; JOHANN, MARCELO ; GUNTZEL, JOSE L. A. . An analytical timing-driven algorithm for detailed placement. In: 2015 IEEE 6th Latin American Symposium on Circuits & Systems (LASCAS 2015), 2015, Montevideo. 2015 IEEE 6th Latin American Symposium on Circuits & Systems (LASCAS). v. 1. p. 1-4.

19.
LIVRAMENTO, VINICIUS ; GUTH, CHRYSTIAN ; NETTO, RENAN ; GUNTZEL, JOSE LUIS ; DOS SANTOS, LUIZ C.V. . Exploiting non-critical Steiner tree branches for post-placement timing optimization. In: 2015 IEEE/ACM International Conference on ComputerAided Design (ICCAD), 2015, Austin. 2015 IEEE/ACM International Conference on Computer-Aided Design (ICCAD), 2015. v. 1. p. 528-535.

20.
SEIDEL, Ismael ; BRASCHER, ANDRE BEIMS ; GUNTZEL, JOSE LUIS . Combining Pel Decimation with Partial Distortion Elimination to increase SAD energy efficiency. In: 2015 25th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS), 2015, Salvador. 2015 25th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS). v. 1. p. 177-184.

21.
GUTH, CHRYSTIAN ; LIVRAMENTO, VINICIUS ; NETTO, RENAN ; FONSECA, RENAN ; GÜNTZEL, JOSÉ LUÍS ; SANTOS, LUIZ . Timing-Driven Placement Based on Dynamic Net-Weighting for Efficient Slack Histogram Compression. In: the 2015 Symposium, 2015, Monterey. Proceedings of the 2015 Symposium on International Symposium on Physical Design - ISPD '15, 2015. v. 1. p. 141-148.

22.
SEIDEL, Ismael ; BEIMS BRASCHER, ANDRE ; MONTEIRO, Marcio ; Giintzel, Jose Luis . Exploring pel decimation to trade off between energy and quality in video coding. In: 2014 IEEE 5th Latin American Symposium on Circuits and Systems (LASCAS), 2014, Santiago. 2014 IEEE 5th Latin American Symposium on Circuits and Systems. v. 1. p. 1-4.

23.
CANCELLIER, LUIZ HENRIQUE ; BRÄSCHER, ANDRÉ BEIMS ; SEIDEL, Ismael ; GÜNTZEL, JOSÉ LUÍS . Energy-Efficient Hadamard-Based SATD Architectures. In: the 27th Symposium, 2014, Aracaju. Proceedings of the 27th Symposium on Integrated Circuits and Systems Design - SBCCI '14. New York: ACM Press. p. 1-6.

24.
LIVRAMENTO, Vinícius dos Santos ; GUTH, Chrystian de Sousa ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira . Fast and Efficient Lagrangian Relaxation-Based Discrete Gate Sizing. In: ACM/IEEE DESIGN, AUTOMATION & TEST IN EUROPE (DATE2013), 2013, Grenoble, França. ACM/IEEE DESIGN, AUTOMATION & TEST IN EUROPE. San Jose, CA, USA: EDA Consortium, 2013. p. 1855-1860.

25.
SORATO, E. ; NETTO, Renan Oliveira ; MICHEL, Pedro Veit ; GÜNTZEL, J. L. A. ; CASTRO, A. ; KLAUTAU, A. . VLSI Architectures for Digital Modulation Classification using Support Vector Machines. In: 4th LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS2013), 2013, Cusco, Peru. 4th LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS, 2013. p. 1-4.

26.
SEIDEL, Ismael ; MORAES, Bruno George de ; GÜNTZEL, J. L. A. . A Low-Power Configurable VLSI Architecture for Sum of Absolute Differences Calculation. In: 4th LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS2013), 2013, Cusco, Peru. 4th LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS, 2013. p. 1-4.

27.
SEIDEL, I. ; MORAES, Bruno George de ; WUERGES, E. ; GÜNTZEL, J. L. A. . Quality Assessment of Subsampling Patterns for Pel Decimation Targeting High Definition Video. In: 2013 IEEE INTERNATIONAL CONFERENCE ON MULTIMEDIA AND EXPO (ICME2013), 2013, San Jose, CA, USA. 2013 IEEE INTERNATIONAL CONFERENCE ON MULTIMEDIA AND EXPO, 2013. p. 1-6.

28.
SORATO, EDSON ; FRONZA, EDUARDO P. ; BARBOSA, PAULO R.F.M.M. ; GUNTZEL, JOSE LUIS ; CASTRO, ADALBERY R. ; KLAUTAU, ALDEBARO . Real-time digital modulation classification based on Support Vector Machines. In: 2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI), 2013, Curitiba. 2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI). p. 1-6.

29.
SEIDEL, I. ; MORAES, Bruno George de ; BRÄSCHER, A. B. ; GÜNTZEL, J. L. . On the Impacts of Pel Decimation and High-Vt/Low-Vdd on SAD Calculation. In: 26th Symposium on Integrated Circuits and Systems Design (SBCCI2013), 2013, Curitiba, Brasil. 26th Symposium on Integrated Circuits and Systems Design (SBCCI2013), 2013. p. 1-6.

30.
LIVRAMENTO, Vinícius dos Santos ; GUTH, Chrystian de Sousa ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira . Evaluating the Impact of Slew on Delay and Power of Neighboring Gates in Discrete Gate Sizing. In: 3rd LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS2012), 2012, Playa del Carmen, México. 3rd LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS. Piscataway (New Jersey, USA): IEEE Circuits and Systems, 2012. p. 1-4.

31.
NETTO, Renan Oliveira ; GÜNTZEL, J. L. A. . A High Throughput Configurable FFT Processor for WLAN and WiMax Protocols. In: VIII SOUTHERN CONFERENCE ON PROGRAMMABLE LOGIC (SPL2012), 2012, Bento Gonçalves, Brazil. VIII SOUTHERN CONFERENCE ON PROGRAMMABLE LOGIC. Piscataway (New Jersey, USA): IEEE Circuits and Systems, 2012. p. 1-5.

32.
SEIDEL, Ismael ; MORAES, Bruno George de ; GÜNTZEL, J. L. A. . Evaluating the Impact of Carry-Ripple and Carry-Lookahead Adders in Pel Decimation VLSI Implementations. In: 27th South Symposium on Microelectronics (SIM2012), 2012, São Miguel das Missões, RS. 27th South Symposium on Microelectronics. Porto Alegre: Sociedade Brasileira de Computação (SBC), 2012. p. 1-4.

33.
LIVRAMENTO, Vinícius dos Santos ; GUTH, Chrystian de Sousa ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira . Lagrangian Relaxation-Based Discrete Gate Sizing for Leakage Power Minimization. In: 19th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2012), 2012, Sevilha, Espanha. 19th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2012), 2012. p. 468-471.

34.
WESTPHAL, R. ; GÜNTZEL, J. L. A. ; SANTOS, Luiz Claudio Villar dos . Energy-efficient Multi-Task Computing on MPSoCs: a case study from a memory perspective. In: 19th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2012), 2012, Sevilha, Espanha. 19th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2012), 2012. p. 905-908.

35.
LIVRAMENTO, Vinícius dos Santos ; MORAES, Bruno George de ; MACHADO, Brunno Abner ; GÜNTZEL, J. L. A. . An Energy-Efficient 8x8 2-D DCT VLSI Architecture for Battery-Powered Portable Devices. In: IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS2011), 2011, Rio de Janeiro, Brazil. IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS. Piscataway (New Jersey, USA): IEEE, 2011. p. 587-590.

36.
VOLPATO, Daniel Pereira ; MENDONÇA, Alexandre K. I. ; GÜNTZEL, J. L. A. ; SANTOS, Luiz Claudio Villar dos . Cache-tuning-aware Scratchpad Allocation from Binaries. In: 24th Symposium on Integrated Circuits and Systems Design (SBCCI2011), 2011, João Pessoa. 24th Symposium on Integrated Circuits and Systems Design (SBCCI2011). New York: ACM, 2011. p. 221-226.

37.
LIVRAMENTO, Vinícius dos Santos ; MORAES, Bruno George de ; MACHADO, Brunno Abner ; GÜNTZEL, J. L. A. . An Energy-Efficient Configurable FDCT/IDCT IP Core for Mobile Multimedia Platforms. In: 24th Symposium on Integrated Circuits and Systems Design (SBCCI2011), 2011, João Pessoa. 24th Symposium on Integrated Circuits and Systems Design (SBCCI2011). New York: ACM, 2011. p. 149-154.

38.
MONTEIRO, J. L. ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . A1CSA: An Energy-Efficient Fast Adder Architecture for Cell-Based VLSI Design. In: 18th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2011), 2011, Beirute, Líbano. 18th IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS. Piscataway (New Jersey, USA): IEEE Circuits and Systems, 2011. p. 442-445.

39.
FRANCK, H. S. ; WILKE, Gustavo Reis ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Somadores Tolerantes a Falhas Usando BSD e Codificação 1 de 3.. In: 16th WORKSHOP IBERCHIP (IBERCHIP 2010), 2010, Foz do Iguaçu, PR. 16th WORKSHOP IBERCHIP (IBERCHIP 2010). Porto Alegre, RS: UFRGS, 2010. p. 107-112.

40.
VOLPATO, Daniel Pereira ; MENDONÇA, Alexandre K. I. ; SANTOS, Luiz Claudio Villar dos ; GÜNTZEL, J. L. A. . A Post-Compiling Approach that Exploits Code Granularity in Scratchpads to Improve Energy Efficiency. In: 2010 IEEE Computer Society Annual Symposium on VLSI (ISVLSI 2010), 2010, Kefalonia, Grécia. 2010 IEEE Computer Society Annual Symposium on VLSI (ISVLSI 2010). Washington DC, USA: IEEE Computer Society, 2010. p. 127-132.

41.
MENDONÇA, Alexandre K. I. ; VOLPATO, Daniel Pereira ; GÜNTZEL, J. L. A. ; SANTOS, Luiz Claudio Villar dos . Mapping Data and Code into Scratchpads from Relocatable Binaries. In: 2009 IEEE Computer Society Annual Symposium on VLSI, 2009, Tampa, FL, USA. 2009 IEEE Computer Society Annual Symposium on VLSI. Los Alamitos, CA, USA: IEEE Computer Society, 2009. p. 157-162.

42.
GUIMARAES JR, Daniel S. ; FRANCK, H. S. ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; REIS, Ricardo Augusto da Luz . Utilizando um Fluxo ASIC para Integração de um Multiplicador Wallace Tree no Datapath de um Processador RISC. In: 15th WORKSHOP IBERCHIP (IBERCHIP 2009), 2009, Buenos Aires. 15th WORKSHOP IBERCHIP. Buenos Aires: Ediciones Científicas Americanas, 2009. p. 334-337.

43.
BRAGA, Matheus Porciuncula ; CORRÊA, Guilherme Ribeiro ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Sensitivity Analysis to SETs Considering Timing and Logic Masking. In: 9th Latin-American Test Workshop (LATW2008), 2008, Puebla, México. 9th Latin-American Test Workshop. Puebla, México: INAOEP, 2008. p. 151-156.

44.
CORRÊA, Guilherme Ribeiro ; MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Evaluating Fault-Tolerant Fast Adders Implemented in FPGAs. In: IV Southern Conference on Programmable Logic - Designer Forum (SPL2008), 2008, Bariloche, Argentina. IV Southern Conference on Programmable Logic Design Forum - Designer Forum. Madrid, Espanha: Universidad Autonóma de Madrid, 2008. p. 1-6.

45.
CORRÊA, Guilherme Ribeiro ; MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Arquitetura de Somador de Alto Desempenho Baseada no Recálculo Parcial com Carry Invertido. In: XXXIV Conferencia Latinoamericana de Informática (CLEI2008), 2008, Santa Fe, Argentina. XXXIV Conferencia Latinoamericana de Informática (CLEI2008). Buenos Aires, Argentina: Sociedade Argentina de Informática, 2008. p. 1-10.

46.
MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Soft Error Tolerant Carry-Select Adders Implemented Into Altera FPGAs. In: 3rd Southern Conference on Programmable Logic (SPL2007), 2007, Mar del Plata, Argentina. 3rd Southern Conference on Programmable Logic. Piscataway, NJ, Estado Unidos: IEEE, 2007. v. 1. p. 199-202.

47.
MESQUITA, Eduardo Macedo ; CORRÊA, Guilherme Ribeiro ; BRAGA, Matheus Porciuncula ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Reducing TMR Resource Overhead in Hardened Carry-Select Adders. In: 8th Latin-American Test Workshop (LATW2007), 2007, Cuzco, Peru. 8th Latin-American Test Workshop. Lima, Peru: PUC Peru, 2007. p. 1-6.

48.
REDIESS, Fabiane Konrad ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . A Motion Compensation Architecture Design and Prototyping Targeting SDTV Frames for H.264/AVC Standard. In: III Southern Conference on Programmable Logic - Designer Forum (SPL2007), 2007, Mar del Plata, Argentina. III Southern Conference on Programmable Logic - Designer Forum. Madrid, Espanha: Universidad Autonóma de Madrid, 2007. v. 1. p. 37-40.

49.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; SILVA, Ivan Saraiva ; AGOSTINI, Luciano Volcan . Forward and Inverse 2-D DCT Architectures for H.264/AVC Video Compression Directed to HDTV.. In: 2nd SOUTHERN CONFERENCE ON PROGRAMMABLE LOGIC, 2006, Mar del Plata. FPGA-Based System.. Madrid, España: Universidad Autónoma de Madrid, 2006. p. 1-6.

50.
AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . High Throughput Multitransform and Multiparallelism IP Directed to the H.264/AVC Video Compression Standard.. In: IEEE International Symposium on Circuits and Systems, 2006 (ISCAS2006), 2006, Island of Kos. IEEE International Symposium on Circuits and Systems (ISCAS2006). Piscataway, NJ, Estado Unidos: IEEE, 2006. p. 5417-5422.

51.
ROSA, Leandro Zanetti Paiva da ; SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Projeto de Arquiteturas Síncronas e de Alto Desempenho para os Blocos das Transformadas Diretas e Inversas da Compressão H.264/AVC.. In: XII Workshop Iberchip (IWS2006), 2006, San José. XII Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 187-90.

52.
FERRÃO, Daniel Lima ; WILKE, Gustavo Reis ; REIS, Ricardo Augusto da Luz ; NEVES, Carolina Gomes ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Safe Path-Based Hierarchical Functional Timing Analysis by Considering Block Arrival Times.. In: 6th International Caribbean Conference on Devices, Circuits and Systems (ICCDCS2006), 2006, Playa del Carmen. 6th IEEE International Caribbean Conference on Devices, Circuits and Systems. Los Alamitos, CA: IEEE, 2006. p. 345-349.

53.
NEVES, Carolina Gomes ; HENES NETO, Egas ; RIBEIRO, Ivandro ; WIRTH, Gilson Inácio ; KASTENSMIDT, Fernanda Gusmão de Lima ; GÜNTZEL, J. L. A. . Automatic Evaluation of Single Event Transient Propagation in CMOS Logic Circuits Based on Topological Timing Analysis.. In: 7th IEEE Latin-American Test Workshop (LATW2006), 2006, Buenos Aires. 7th IEEE Latin-American Test Workshop, 2006. p. 49-54.

54.
SILVA, André Marcelo Coelho da ; SILVA, Thaísa Leal da ; PORTO, Marcelo Schiavon ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Exploração no Espaço de Projeto da Hadamard 4x4 Direta do Padrão de Compressão de Vídeo H.264/AVC.. In: XII Workshop Iberchip (IWS2006), 2006, San José. XII Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 99-102.

55.
PORTO, Marcelo Schiavon ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Investigação de Algoritmos e Proposta Arquitetural para a Estimação de Movimento direcionada à Vídeos de Alta Resolução.. In: XII Workshop Iberchip (IWS2006), 2006, San José. XII Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 61-64.

56.
AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . Arquitetura Multi-Transformada de Alto Desempenho com Paralelismo Programável e Direcionada para o Padrão de Compressão de Vídeo H.264/AVC .. In: XII Workshop Iberchip (IWS2006), 2006, San José. XII Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 91-94.

57.
PORTO, Marcelo Schiavon ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Quantização Direta e Inversa de Alta Performance para a Compressão de Vídeo H.264/AVC Direcionada para HDTV.. In: XII Workshop Iberchip (IWS2006), 2006, San José. XII Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 95-98.

58.
NEVES, Carolina Gomes ; RIBEIRO, Ivandro ; HENES NETO, Egas ; WIRTH, Gilson Inácio ; KASTENSMIDT, Fernanda Gusmão de Lima ; GÜNTZEL, J. L. A. . Avoiding Circuit Simulation in Single Event Transient Propagation Analysis in Combinational Circuits.. In: 11TH IEEE EUROPEAN TEST SYMPOSIUM (ETS2006), 2006, Southampton, UK. 11TH IEEE EUROPEAN TEST SYMPOSIUM (ETS2006). Southampton (Inglaterra): Univ. of Southampton (Inglaterra), 2006. v. 1. p. 46-51.

59.
AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . High Throughput FPGA Based Architecture for H.264/AVC Inverse Transforms and Quantization.. In: 49th IEEE Midwest Symposium on Circuits and Systems, 2006 (MWSCAS2006), 2006, San José, Porto Rico. 49th IEEE Midwest Symposium on Circuits and Systems. Piscatay, NJ: IEEE CAS, 2006. v. 1. p. 281-285.

60.
FERRÃO, Daniel Lima ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Considering Zero-Arrival Time and Block Arrival-Time in Hierarchical Functional Timing Analysis. In: 16th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2006), 2006, Montpellier, França. Lecture Notes in Computer Science (LNCS). Berlin, Alemanha: Springer Verlag, 2006. v. 4148. p. 301-310.

61.
AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; BAMPI, Sergio ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva . High Throughput Architecture for H.264/AVC Forward Transforms Block. In: 16th ACM Great Lakes Symposium on VLSI (GLSVLSI2006), 2006, Philadelphia, USA. 16th ACM Great Lakes Symposium on VLSI. New York, USA: ACM, 2006. p. 320-323.

62.
SILVA, Thaísa Leal da ; VORTMANN, João Alberto ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Entropy Coder Architectures for H.264/AVC Baseline Profile. In: 6th Microelectronics Students Forum (SForum2006), 2006, Recife. 6th Microelectronics Students Forum. Porto Alegre: SBC - SBMicro, 2006. p. 1-4.

63.
SANTOS, Cristiano Lopes dos ; FERRÃO, Daniel Lima ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Incremental Timing Optimization for Automatic Layout Generation. In: IEEE International Symposium on Circuits and Systems (ISCAS2005), 2005, Kobe, Japão. IEEE International Symposium on Circuits and Systems (ISCAS2005). New York: IEEE Press, 2005. p. 3567-3571.

64.
NEVES, Carolina Gomes ; FERRÃO, Daniel Lima ; BRAGA, Matheus Porciuncula ; AGOSTINI, Luciano Volcan ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Hierarchical Timing Analysis Using Selective Critical Path Sensitization. In: 6th IEEE LATIN AMERICAN TEST WORKSHOP, 2005, Salvador, Bahia. 6th IEEE LATIN AMERICAN TEST WORKSHOP. Salvador, Bahia: UFRGS/IM-Sevilla/UFBa, 2005. p. 65-70.

65.
ZIESEMER JUNIOR, Adriel Mota ; BRAGA, Matheus Porciuncula ; COSTA, Eduardo ; GÜNTZEL, J. L. A. . Automatic Layout Generation of 2´s Complement Multipliers in CMOS Technology. In: XI Workshop Iberchip (IWS2005), 2005, Salvador, Bahia. XI Workshop Iberchip. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 35-38.

66.
PORTO, Roger Endrigo Carvalho ; NEVES, Bruno Silveira ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Increasing the Image Quality in a JPEG Compressor through Arithmetic Error Minimization. In: XI Workshop Iberchip (IWS2005), 2005, Salvador, Bahia. XI Workshop Iberchip. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 90-93.

67.
PORTO, Marcelo Schiavon ; SILVA, André Marcelo Coelho da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Impactos do Uso de Diferentes Arquiteturas de Somadores em FPGAS Altera. In: XI Workshop Iberchip, 2005, Salvador, Bahia. XI Workshop Iberchip. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 134-137.

68.
SILVA, Thaísa Leal da ; MATEUS, Gustavo Pereira ; BERARDI, Rita Cristina Galarraga ; SAWABE, Érico Kazuhiro ; BLASCO, Ezequiel Conceição ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Exploração do Espaço de Projeto em Arquiteturas para Cálculo de Raiz Quadrada Inteira. In: XI Workshop Iberchip (IWS2005), 2005, Salvador, Bahia. XI Workshop Ibership. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 158-161.

69.
SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Desenvolvimento e Validação das Interfaces BVCI para o Reuso de Blocos de Hardware. In: XI Workshop Iberchip (IWS2005), 2005, Salvador, Bahia. XI Workshop Iberchip. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 239-242.

70.
PORTO, Marcelo Schiavon ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Projeto, Síntese e Simulação das Interfaces de Reuso de Hardware do Padrão OCP (Open Core Protocol). In: XI Workshop Iberchip, 2005, Salvador, Bahia. XI Workshop Iberchip. Salvador, Bahia: IBERCHIP/UFRGS/UFBa/IMSE, 2005. p. 251-254.

71.
SANTOS, Cristiano Lopes dos ; FERRÃO, Daniel Lima ; LAZZARI, Cristiano ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Effects of Using a Pin-to-Pin Delay Model on a Library-Free Transistor/Gate Sizing Scheme. In: IEEE INTERNATIONAL MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS, 2005 (MWSCAS2005), 2005, Cincinati, Ohio. 48TH IEEE INTERNATIONAL MIDWEST SYMPOSIUM ON CIRCUITS AND SYSTEMS (MSCAS2005). Piscataway, New Jersey (EUA): IEEE Circuits & Systems Society, 2005. p. 305-318.

72.
FERRÃO, Daniel Lima ; SANTOS, Cristiano Lopes dos ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; LUBASZEWSKI, Marcelo Soares ; REIS, Ricardo Augusto da Luz . Path Delay Fault Generation Using Exact Floating Mode Sensitization. In: 5th IEEE LATIN AMERICAN TEST WORKSHOP, 2004, Cartagena de Indias. 5th IEEE LATIN AMERICAN TEST WORKSHOP. Bogotá: UNIANDES, 2004. p. 174-177.

73.
BRUSAMARELLO, Lucas ; WILKE, Gustavo Reis ; SILVA, Luciano da ; REAL, Rodrigo ; FRAINER, Gustavo ; REIS, Ricardo Augusto da Luz ; GEYER, Claudio Fernando Resin ; GÜNTZEL, J. L. A. ; YAMIN, Adenauer Correa ; AUGUSTIN, Iara . Timing Verification Based on Floating Vector Simulation: a Distribuited Approach. In: X Workshop Iberchip (IWS2004), 2004, Cartagena de Indias. X Workshop Iberchip. Bogotá: UNIANDES, 2004. p. 110-111.

74.
REIS, Ricardo Augusto da Luz ; KASTENSMIDT, Fernanda Lima ; GÜNTZEL, J. L. A. . Physical Design Methodologies for Performance Predictability and Manufacturability. In: 1st ACM Conference on Computing Frontiers, 2004, Ischia. ACM Conference on Computing Frontiers. New York: ACM Express, 2004. p. 390-397.

75.
GÜNTZEL, J. L. A.; WILKE, Gustavo Reis ; REIS, Ricardo Augusto da Luz ; PINTO, Ana Cristina Medina . Functional Timing Analysis Using ATPG Techniques. In: 4TH IEEE LATIN AMERICAN TEST WORKSHOP, 2003, Natal. 4TH IEEE LATIN AMERICAN TEST WORKSHOP, 2003. p. 92-97.

76.
FERRÃO, Daniel Lima ; WILKE, Gustavo Reis ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Improving Critical Path Identification in Functional Timing Analysis. In: 16th Symposium on Integrated Circuits and Systems Design, 2003, São Paulo. 16th Symposium on Integrated Circuits and Systems Design, 2003. p. 297-302.

77.
SANTOS, Cristiano ; WILKE, Gustavo Reis ; LAZZARI, Cristiano ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . A Transistor Sizing Method Applied to an Automatic Layout Generation Tool. In: 16th Symposium on Integrated Circuits and Systems Design, 2003, São Paulo. 16th Symposium on Integrated Circuits and Systems Design, 2003. p. 303-307.

78.
GUERRERO, David ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; BELLIDO, Manuel ; JUANCHICO, Jorge ; RUIZDECLAVIJO, Paulino ; MILLAN, Alejandro . Computational Delay Models to Estimate the Delay of Floating Cubes in CMOS Circuits. In: 13th International Workshop on Power and Timing Modeling, Optimization and Simulation, 2003, Torino, Itália. Integrated Circuit Design: Power and Timing Modeling, Optimization and Simulation, 2003. p. 510-519.

79.
LAZZARI, Cristiano ; DOMINGUES, Cristiano Viana ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . A New Macro-Cell Generation Strategy for Three Metal Layer CMOS Technologies. In: IFIP International Conference on Very Large Scale Integration, 2003, Darmstadt, Alemanha. IFIP International Conference on Very Large Scale Integration, 2003. p. 193-197.

80.
GUERRERO, David ; BELLIDO, Manuel ; JUANCHICO, Jorge ; MILLAN, Alejandro ; RUIZDECLAVIJO, Paulino ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. . Estimation of Floating Cube Delay Using Transistor Path Computation Delay Models for CMOS Circuits. In: XVIII Conference on Design of Circuits and Integrated Systems, 2003, Ciudad Real, Espanha. XVIII Conference on Design of Circuits and Integrated Systems, 2003. p. 95-99.

81.
GÜNTZEL, J. L. A.; WILKE, Gustavo Reis ; BYSTRONSKI, Márcio ; PINTO, Ana Cristina Medina ; REIS, Ricardo Augusto da Luz . A Comparison Between Testability Measures Applied to Complex Gates.. In: 3rd IEEE LATIN AMERICAN TEST WORKSHOP, 2002, Montevideo. 3rd IEEE LATIN AMERICAN TEST WORKSHOP. Montevideo: TIMA/LATU, 2002. v. 1. p. 144-149.

82.
WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; BYSTRONSKI, Márcio ; PINTO, Ana Cristina Medina ; REIS, Ricardo Augusto da Luz . Finding the Critical Delay of Combinational Blocks by Floating Vector Simulation and Path Tracing.. In: 15th SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEMS DESIGN, 2002, Porto Alegre. 15th SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEMS DESIGN (SBCCI2002). Los Alamitos, California: IEEE Computer Society, 2002. p. 277-282.

83.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; REIS, R. A. L. . A Timed Calculus for ATG-Based Timing Analysis of Circuits with Complex Gates. In: 2nd IEEE Latin American Test Workshop, 2001, Cancún. 2nd IEEE Latin American Test Workshop. Puebla, México: National Institute for Astrophysics, Optics and Electronics (INAOE), 2001. p. 234-239.

84.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; D'ÁVILA, E. ; REIS, Ricardo Augusto da Luz . ATG-Based Timing Analysis of Circuits Containing Complex Gates. In: Symposium on Integrated Circuits and Systems Design, 2000, Manaus. Symposium on Integrated Circuits and Systems Design. Los Alamitos: IEEE Computer Society, 2000. p. 21-26.

85.
GÜNTZEL, J. L. A.; BERTOTTO, C. A. . Ambiente de Programação Off-line para o Kit de Robótica ROBIX RCS-6. In: CONGRESSO NACIONAL DA SOCIEDADE BRASILEIRA DE COMPUTAÇÃO, 2000, Curitiba. CONGRESSO NACIONAL DA SOCIEDADE BRASILEIRA DE COMPUTAÇÃO, 20. Curitiba: Editora Universitária Champagnat, 2000. p. 41-41.

86.
LIMA, F. G. ; JOHANN, Marcelo de Oliveira ; GÜNTZEL, J. L. A. ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . A Tool for Analysis of Universal Logic Gates Functionality.. In: Brazilian Synposium on Integrated Circuit Design (SBCCI'99), 1999, Natal. Brazilian Synposium on Integrated Circuit Design (SBCCI'99). Los Alamitos, California - USA: IEEE Computer Society, 1999. p. 184-187.

87.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; FRAGOSO, J. L. ; PIZZOL, Guilherme Dall ; REIS, Ricardo Augusto da Luz . Path Enumeration Algorithms for Timing Analysis of Digital Circuits.. In: Workshop Iberchip, 1999, Lima, Peru. Quinto Workshop Iberchip. Lima, Peru: Iberchip/Pontificia Universidad Católica del Perú, 1999. p. 334-341.

88.
LIMA, F. G. ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . Designing Masked Programmable ULGs for MPGAs. In: Workshop Iberchip, 1999, Lima, Peru. Quinto Workshop Iberchip. Lima, Perú: Iberchip/Pontificia Universidad Católica del Perú, 1999. p. 91-99.

89.
LIMA, F. G. ; JOHANN, Marcelo de Oliveira ; GÜNTZEL, J. L. A. ; D'ÁLVILA, E. ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . Maragata. In: UFRGS Microelectronics Seminar, 1999, Pelotas. XIV UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1999. p. 55-62.

90.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; MORAES, Fernando Gehm ; REIS, Ricardo Augusto da Luz . An Improved Path Enumeration Method Considering Different Fall and Rise Gate Delays.. In: Brazilian Symposium on Integrated Circuit Design, 1998, Armação de Búzios, RJ. Brazilian Symposium on Integrated Circuit Design. Los Alamitos, California - USA: IEEE Computer Society, 1998. p. 208-211.

91.
LIMA, F. G. ; CARRO, Luigi ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira ; REIS, Ricardo Augusto da Luz . Improving Logic Density of QCL Masterslices by Using Universal Logic Gates.. In: Brazilian Symposium on Integrated Circuit Design (SBCCI), 1998, Armação de Búzios, RJ. Brazilian Symposium on Integrated Circuit Design. Los Alamitos, California - USA: IEEE Computer Society, 1998. p. 204-207.

92.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; REIS, Ricardo Augusto da Luz . Improving Path Enumeration Accuracy by Considering Different Fall and Rise Gate Delays.. In: Workshop Iberchip, 1998, Mar del Plata. Quarto Workshop Iberchip. Buenos Aires: Iberchip/Universidad Nacional de La Plata, 1998. p. 91-100.

93.
LIMA, F. G. ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . On the Applicability of Universal Logic Gates for Designing Masked Programmable Gate Arrays.. In: Workshop Iberchip, 1998, Mar del Plata. Quarto Workshop Iberchip. Buenos Aires: Iberchip/Universidad Nacional de La Plata, 1998. p. 110-119.

94.
CREMOUX, S. ; GÜNTZEL, J. L. A. ; MONNIER, T. ; AZEMARD, N. ; AUVERGNE, D. . Performance Optimization by Path Selection.. In: International Workshop on Logic Synthesis, 1997, Tahoe City, California - USA. International Workshop on Logic Synthesis, 1997. v. 1.

95.
FRAGOSO, J. L. ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . An X-Window/MOTIF Interface for Fast Prototyping Using Marcela Prediffused Masterslices.. In: Workshop Iberchip, 1997, Cidade do México. Tercer Workshop Iberchip. México, DF: Iberchip/CYTED/CINVESTAV, 1997. p. 504-509.

96.
MAHLMANN, L. G. G. ; MORAES, Fernando Gehm ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Tentos for Windows- Um Sistema para Microeletrônica.. In: Workshop Iberchip, 1997, Cidade do México. Tercer Workshop Iberchip. México DF: Iberchip/CYTED/CINVESTAV, 1997. p. 513-522.

97.
CREMOUX, S. ; GÜNTZEL, J. L. A. ; MONNIER, T. ; AZEMARD, N. ; AUVERGNE, D. . Algorithme de Sélection des Chemins pour l'Optimisation de Performances.. In: Colloque CAO de Circuits Intégrés et Systémes., 1997, Villard de Lans (Grenoble), Fr. Colloque CAO de Circuits Intégrés et Systémes.. Grenoble, France: TIMA/MENESTRIP, 1997. p. 188-191.

98.
CREMOUX, S. ; MONNIER, T. ; GÜNTZEL, J. L. A. ; AZEMARD, N. ; AUVERGNE, D. . Path Selection Algorithm for Performance Optimization.. In: IFIP TC10 WG10.5 International Workshop on Logic and Architecture Synthesis., 1996, Grenoble, France. IFIP TC10 WG10.5 International Workshop on Logic and Architecture Synthesis.. Grenoble, France: INPG/IFIP, 1996. p. 277-284.

99.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz ; FLORES, Aline Pessano ; JOHANN, Marcelo de Oliveira . A Novel Approach for ASIC Layout Generation.. In: Midwest Symposium on Circuits and Systems, 1995, Rio de Janeiro. Midwest Symposium on Circuits and Systems. Piscataway, USA: IEEE Press, 1995. p. 719-794.

100.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz ; FLORES, Aline Pessano ; FREITAS, Demétrio Luis de . A Sea-of-Cells Approach for ASIC Design. In: Primer Workshop Iberchip, 1995, Cartagena de Indias. Primer Workshop Iberchip. Bogotá: CMUA/CNM/IBERCHIP, 1995. p. 281-290.

101.
GÜNTZEL, J. L. A.; FREITAS, Demétrio Luis de ; BELFORT, Hendrio Baron ; FLORES, Aline Pessano ; REIS, Ricardo Augusto da Luz . Partitioning-Based Procedures for Sea-of-Cells Layout Assignment. In: Congresso da Sociedade Brasileira de Microeletrônica, 1994, Rio de Janeiro. Congresso da Sociedade Brasileira de Microeletrônica. Rio de Janeiro: SBMicro/NCE-UFRJ, 1994. p. 709-718.

102.
FLORES, Aline Pessano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . The MARCELA Sea-of-Cells Generator. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1994, Gramado. Simpósio Brasileiro de Concepção de Circuitos Integrados. Porto Alegre: SBC/SBMicro/UFRGS, 1994. p. 357-366.

103.
GÜNTZEL, J. L. A.; HACKBART, A. ; KRÜGER, F. ; REIS, Ricardo Augusto da Luz . Comparação entre as Abordagens Marcela e Sea-of-Gates: um Estudo de Caso. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1992, Rio de Janeiro. Simpósio Brasileiro de Concepção de Circuitos Integrados. Rio de Janeiro: SBC/SBMicro/UFRJ, 1992. p. 164-178.

104.
REIS, André Inácio ; GÜNTZEL, J. L. A. ; RIBAS, R. . Algumas Formas de Implementação de ASICs. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1992, Rio de Janeiro. Simpósio Brasileiro de Concepção de Circuitos Integrados. Rio de Janeiro: SBC/SBMicro/UFRJ, 1992. p. 15-34.

105.
APREA, Javier Francisco ; GÜNTZEL, J. L. A. ; KINDEL, Marcus ; FICHMAN, L. ; PILGER, L. ; REIS, Ricardo Augusto da Luz . GAMA: uma Interface de Aquisição para Cintilografias. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1992, Rio de Janeiro. Simpósio Brasileiro de Concepção de Circuitos Integrados. Rio de Janeiro: SBC/SBMicro/UFRJ, 1992. p. 148-163.

106.
GÜNTZEL, J. L. A.; RIBAS, R. ; FACHIN, D. ; REIS, Ricardo Augusto da Luz . Tchê: o Circuito de Teste do Projeto Marcela.. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1991, Jaguariúna. Simpósio Brasileiro de Concepção de Circuitos Integrados. Campinas: SBC/SBMicro/CTI, 1991. p. 21-30.

107.
GÜNTZEL, J. L. A.; RIBAS, R. ; REIS, Ricardo Augusto da Luz . Marcela: uma Nova Abordagem para Pré-Difundidos. In: Congresso da Sociedade Brasileira de Microeletrônica, 1991, Belo Horizonte. Congresso da Sociedade Brasileira de Microeletrônica. Belo Horizonte: SBMicro/UFMG, 1991. p. 534-543.

108.
GÜNTZEL, J. L. A.; FREIRE, L. O. ; RIBAS, R. ; HOLSBACH, J. ; BARONE, Dante . Taura: um ASIC para Terminal de Vídeo. In: Simpósio Brasileiro de Concepção de Circuitos Integrados, 1990, Ouro Preto. Simpósio Brasileiro de Concepção de Circuitos Integrados. Belo Horizonte: SBC/SBMicro/UFMG, 1990. p. 315-324.

Resumos expandidos publicados em anais de congressos
1.
BONOTO, Bruno Izais ; CANCELLIER, LUIZ HENRIQUE ; MONTEIRO, Marcio ; SEIDEL, I. ; GÜNTZEL, Jose Luis . A Named-Pipe Library for Hardware Simulation. In: 33rd South Symposium on Microelectronics (SIM2018), 2018, Curitiba. 33rd South Symposium on Microelectronics (SIM2018). Porto Alegre: SBC, 2018. v. 1. p. 1-4.

2.
MONTEIRO, Marcio ; SEIDEL, I. ; GÜNTZEL, Jose Luis . Impacts of SAD on Execution Time for High Definition Video Codecs. In: 29th South Symposium on Microelectronics (SIM2014), 2014, Alegrete, Brazil. 29th South Symposium on Microelectronics (SIM2014). Porto Alegre, RS: SBC, 2014. p. 1-4.

3.
CANCELLIER, L. H. L. ; BRÄSCHER, A. B. ; SEIDEL, I. ; GÜNTZEL, Jose Luis . Design Space Evaluation of SATD Architectures. In: 29th South Symposium on Microelectronics (SIM2014), 2014, Alegrete, Brazil. 29th South Symposium on Microelectronics (SIM2014). Porto Alegre, RS: SBC, 2014. p. 1-4.

4.
MONTEIRO, J. L. ; FLACH, G. A. ; PUGET, J. C. ; GÜNTZEL, Jose Luis ; JOHANN, Marcelo de Oliveira ; REIS, R. A. L. . A More Accurate Algorithm for Fast Cut Line Selection in Global Placement. In: 29th South Symposium on Microelectronics (SIM2014), 2014, Alegrete, Brazil. 29th South Symposium on Microelectronics (SIM2014). Porto Alegre, RS: SBC, 2014. p. 1-4.

5.
SEIDEL, I. ; MORAES, Bruno George de ; BRÄSCHER, A. B. ; GÜNTZEL, Jose Luis . Comparison of 90nm and 65nm Logic Synthesis of a SAD Configurable VLSI Architecture.. In: 28th South Symposium on Microelectronics (SIM2013), 2013, Porto Alegre, RS. 28th South Symposium on Microelectronics (SIM2013). Porto Alegre, RS: SBC, 2013. p. 1-4.

6.
NETTO, Renan Oliveira ; MICHEL, Pedro Veit ; GÜNTZEL, J. L. A. . A Low-Power High Throughput Configurable FFT/IFFT Processor for WLAN and WiMax Protocols. In: 27th South Symposium on Microelectronics (SIM2012), 2012, São Miguel das Missões, RS. 27th South Symposium on Microelectronics. Porto Alegre: Sociedade Brasileira de Computação (SBC), 2012. p. 1-4.

7.
MONTEIRO, Jucemar Luis ; CAMPOS, P. P. V. ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Cell-Based VLSI Implementations of the Add One Carry Select Adder. In: 26th South Symposium on Microelectronics (SIM2011), 2011, Novo Hamburgo, RS. 26th South Symposium on Microelectronics. Porto Alegre: Sociedade Brasileira de Computação (SBC), 2011. p. 201-204.

8.
CORREA, I. S. ; GÜNTZEL, J. L. A. ; KLAUTAU, A. ; COSTA, J. C. . A Direct Memory Access Controller (DMAC) IP-Core using AMBA AXI Protocol. In: 26th South Symposium on Microelectronics (SIM2011), 2011, Novo Hamburgo, RS. 26th South Symposium on Microelectronics. Porto Alegre: Sociedade Brasileira de Computação (SBC), 2011. p. 167-171.

9.
MORAES, Bruno George de ; SEIDEL, Ismael ; GÜNTZEL, J. L. A. . A Rate-Distortion Metric Targeting Perceptual Video Coding. In: 26th South Symposium on Microelectronics (SIM2011), 2011, Novo Hamburgo, RS. 26th South Symposium on Microelectronics. Porto Alegre: Sociedade Brasileira de Computação (SBC), 2011. p. 109-112.

10.
LIVRAMENTO, Vinícius dos Santos ; MORAES, Bruno George de ; MACHADO, Brunno Abner ; GÜNTZEL, J. L. A. . A High Throughput Multiplierless Low Power 8x8 2-D DCT IP for Portable Multimedia Applications. In: 10th Microelectronics StudentsForum (SForum2010), 2010, São Paulo, Brasil. 10th Microelectronics StudentsForum. São Paulo: USP/FEI, 2010. p. 1-4.

11.
NIHEI, Gustavo H. ; GÜNTZEL, J. L. A. . Modeling Embedded SRAM with SystemC. In: 24th South Symposium on Microelectronics (SIM2009), 2009, Pelotas, RS, Brasil. 24th South Symposium on Microelectronics. Porto Alegre: SBC, 2009. p. 145-148.

12.
CAMPOS, Carlos Eduardo de ; MONTEIRO, Jucemar Luis ; RIBAS, Robson ; GÜNTZEL, J. L. A. . Evaluation of XOR Circuits in 90nm CMOS Technology. In: 24th South Symposium on Microelectronics (SIM2009), 2009, Pelotas, RS, Brasil. 24th South Symposium on Microelectronics. Porto Alegre: SBC, 2009. p. 55-58.

13.
MONTEIRO, Jucemar Luis ; CAMPOS, Carlos Eduardo de ; RIBAS, Robson ; GÜNTZEL, J. L. A. . A Comparison of Carry Lookahead Adders Mapped with Static CMOS Gates. In: 24th South Symposium on Microelectronics (SIM2009), 2009, Pelotas, RS, Brasil. 24th South Symposium on Microelectronics. Porto Alegre: SBC, 2009. p. 59-62.

14.
FRANCK, H. S. ; GUIMARAES JR, Daniel S. ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; REIS, R. A. L. . Using an ASIC Flow for the Integration of a Wallace Tree Multiplier in the DataPath of a RISC Processor. In: 24th South Symposium on Microelectronics, 2009, Pelotas, RS, Brasil. 24th South Symposium on Microelectronics. Porto Alegre: SBC, 2009. p. 79-82.

15.
BRAGA, Matheus Porciuncula ; CORRÊA, Guilherme Ribeiro ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . A Two-Step SET Sensitivity Estimation Technique. In: 23rd South Symposium on Microelectronics (SIM2008), 2008, Bento Gonçalves, RS. 23rd South Symposium on Microelectronics. Porto Alegre: SBC, 2008. p. 81-84.

16.
CORRÊA, Guilherme Ribeiro ; FRANCK, H. S. ; MESQUITA, Eduardo Macedo ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Fault-Tolerant Fast Adders Implemented in FPGAs. In: 23rd South Symposium on Microelectronics (SIM2008), 2008, Bento Gonçalves, RS. 23rd South Symposium on Microelectronics. Porto Alegre: SBC, 2008. p. 85-88.

17.
CORRÊA, Guilherme Ribeiro ; MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Transient Fault-Tolerant Adders Implemented in FPGAs. In: 8th Microelectronics Students Forum (SForum2008), 2008, Gramado, RS, Brasil. 8th Microelectronics Students Forum. Porto Alegre, RS: SBC, 2008. p. 1-4.

18.
MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . RIC Fast Adder and Its SET-Tolerant implementation in FPGAs. In: 17th IEEE International Conference on Field Programmable Logic and Applications (FPL2007), 2007, Amsterdam. 17th IEEE International Conference on Field Programmable Logic and Applications. Piscataway, NJ, Estado Unidos: IEEE, 2007. v. 1. p. 638-641.

19.
MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Re-computing the Carry to Reduce Resource Penalty in Binary Adders Protected with TMR. In: 22nd South Symposium on Microelectronics (SIM2007), 2007, Porto Alegre. 22nd South Symposium on Microelectronics. Porto Alegre: SBC, 2007. p. 93-96.

20.
FRANCK, H. S. ; MESQUITA, Eduardo Macedo ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Fault Tolerant Carry Lookahead Adders Implemented in FPGA. In: 22nd South Symposium on Microelectronics (SIM2007), 2007, Porto Alegre. 22nd South Symposium on Microelectronics. Porto Alegre: SBC, 2007. p. 109-112.

21.
BRAGA, Matheus Porciuncula ; CORRÊA, Guilherme Ribeiro ; MATEUS, Gustavo Pereira ; VIÇOSA JR, Elvio ; GÜNTZEL, J. L. A. . Timing Aware Pre-Analysis of Single Event Transient Propagation. In: 22nd South Symposium on Microelectronics (SIM2007), 2007, Porto Alegre. 22nd South Symposium on Microelectronics. Porto Alegre: SBC, 2007. p. 97-100.

22.
REDIESS, Fabiane Konrad ; GÜNTZEL, J. L. A. . Projeto e Implementação de Processadores RISC em VHDL. In: XIV Congresso de Iniciação Científica da UFPel (CIC2006), 2006, Pelotas. XIV Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2006. p. 1-4.

23.
SILVA, Thaísa Leal da ; VORTMANN, João Alberto ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Arquitetura de Hardware Dedicada para a Aecodificação Exp-Golomb Padrão H.264 de Compressão de Vídeo.. In: XII Workshop Iberchip (IWS2006), 2006, San José. XI Workshop Iberchip. Sevilha, Espanha: Iberchip, 2006. p. 277-278.

24.
AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio . A Multitransform and Multiparallelism IP for H.264/AVC Video Compression Standard.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 133-136.

25.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; SILVA, Ivan Saraiva ; GÜNTZEL, J. L. A. ; BAMPI, Sergio . FPGA Prototype of a H.264/AVC Inverse Transform and Quantization Architecture for HDTV.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 19-23.

26.
PORTO, Marcelo Schiavon ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; SILVA, Ivan Saraiva ; AGOSTINI, Luciano Volcan . A Hardware Architecture for Motion Estimation Using Pel Decimation 4:1 and SAD.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 69-72.

27.
SILVA, André Marcelo Coelho da ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; SILVA, Ivan Saraiva ; AGOSTINI, Luciano Volcan . Design Space Exploration on the H.264 4x4 Hadamard Transform.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 125-128.

28.
REDIESS, Fabiane Konrad ; SILVA, André Marcelo Coelho da ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . A Motion Compensation Architecture for Video Compression.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 65-68.

29.
ROSA, Leandro Zanetti Paiva da ; SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; SILVA, Ivan Saraiva ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . H.264/AVC Forward Transforms Block Architecture for HDTV.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 121-124.

30.
VORTMANN, João Alberto ; SILVA, Thaísa Leal da ; GÜNTZEL, J. L. A. ; BAMPI, Sergio ; SILVA, Ivan Saraiva ; AGOSTINI, Luciano Volcan . Dedicated Hardware Architectures for H.264/AVC Exp-Golomb Coding and Decoding.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 129-132.

31.
MESQUITA, Eduardo Macedo ; BRAGA, Matheus Porciuncula ; WILKE, Gustavo Reis ; AGOSTINI, Luciano Volcan ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Using Statistical Timing Analysis to Evaluate the Accuracy of Worst-Case Topological Timing Analysis. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 89-92.

32.
WILKE, Gustavo Reis ; MESQUITA, Eduardo Macedo ; BRAGA, Matheus Porciuncula ; AGOSTINI, Luciano Volcan ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . A Basic Study on Montecarlo Simulation and Its Applications on Statistical Timing Analysis.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 97-100.

33.
NEVES, Carolina Gomes ; MATEUS, Gustavo Pereira ; AGOSTINI, Luciano Volcan ; KASTENSMIDT, Fernanda Lima ; GÜNTZEL, J. L. A. . On the Influence of Single Event Transient on Gate Delays. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 85-88.

34.
CORRÊA, Guilherme Ribeiro ; PETRY, Rafael de Lima ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . A Comparison Between Multiplier Architectures Implemented in Altera FPGAs.. In: 21st South Symposium on Microelectronics, 2006, Porto Alegre. 21st South Symposium on Microelectronics. Porto Alegre: SBC, 2006. p. 25-28.

35.
ZIESEMER JUNIOR, Adriel Mota ; BRAGA, Matheus Porciuncula ; COSTA, Eduardo ; GÜNTZEL, J. L. A. . Development of an Automatic Regular Layout Generator of 2´s Complement Multipliers in CMOS Technology. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 109-112.

36.
BRAGA, Matheus Porciuncula ; ALTERMANN, Wagner ; ZIESEMER JUNIOR, Adriel Mota ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . Automatic Layout Generation of Binary Adders in Static CMOS Logic. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 39-42.

37.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . An Integer 2-D DCT Architecture for the H.264/AVC Video Coding Standard. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 119-122.

38.
PORTO, Marcelo Schiavon ; ROSA, Leandro Zanetti Paiva da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Design, Synthesis and Simulation of OCP (Open Core Protocol) Hardware Reuse Interface. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 11-14.

39.
PORTO, Marcelo Schiavon ; SILVA, André Marcelo Coelho da ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Impacts of Different Adder Architectures in Designs Directed to Altera FPGAS. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 131-134.

40.
SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Design, Syntesis and Evaluation of BVCI Hardware Reuse Interfaces. In: 20th South Symposium on Microelectronics (SIM2005), 2005, Santa Cruz do Sul. 20th South Symposium on Microelectronics. Santa Cruz do Sul: UNISC, 2005. p. 15-18.

41.
PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Design and Comparison between PVCI, BVCI and OCP Hardware Reuse Interfaces Mapped to FPGA. In: 3rd Microelectronics Students Forum (SForum2005), 2005, Florianópolis. 3rd Student Forum on Microelectronics. Florianópolis: SBC - SBMicro, 2005. p. 1-2.

42.
SILVA, Michele dos Santos da ; GÜNTZEL, J. L. A. . Towards Using The Floating Vector Gate Delay Model in Functional Timing Analysis.. In: X Workshop Iberchip (IWS2004), 2004, Cartagena de Indias. X Workshop Iberchip. Bogotá: UNIANDES, 2004. p. 149-150.

43.
SANTOS, Cristiano Lopes dos ; FERRÃO, Daniel Lima ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Delay/Area Optimization with Transistor Sizing. In: 19th South Symposium on Microelectronics (SIM2004), 2004, São Miguel das Missões. 19th South Symposium on Microelectronics. Ijuí: UNIJUI, 2004. p. 80-84.

44.
BASTIAN, Fabrício Biolo ; LAZZARI, Cristiano ; SANTOS, Cristiano Lopes dos ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . A New Parametrizable Folding Algorithm Applied to an Automatic Layout Generation Tool. In: 19th South Symposium on Microelectronics (SIM2004), 2004, São Miguel das Missões. 19th South Symposium on Microelectronics. Ijuí: UNIJUI, 2004. p. 71-74.

45.
SILVA, Michele dos Santos da ; BRAGA, Matheus Porciuncula ; GÜNTZEL, J. L. A. . A Comparison Between Gate Delay Models for Timing Analysis. In: 19th South Symposium on Microelectronics (SIM2004), 2004, São Miguel das Missões. 19th South Symposium on Microelectronics. Ijuí: UNIJUI, 2004. p. 145-149.

46.
FERRÃO, Daniel Lima ; WILKE, Gustavo Reis ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . Improving Critical Path Identification in Functional Timing Analysis. In: 18th South Symposium on Microelectronics (SIM2003), 2003, Novo Hamburgo. 18th South Symposium on Microelectronics, 2003. p. 93-98.

47.
SANTOS, Cristiano ; WILKE, Gustavo Reis ; LAZZARI, Cristiano ; REIS, Ricardo Augusto da Luz ; GÜNTZEL, J. L. A. . A Sizing Algorithm Applied to an Automatic Layout Generator. In: 18th South Symposium on Microelectronics (SIM2003), 2003, Novo Hamburgo. 18th South Symposium on Microelectronics, 2003. p. 85-88.

48.
LAZZARI, Cristiano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Timing-Driven Automatic Layout Generation of Digital CMOS Circuits. In: 18th South Symposium on Microelectronics (SIM2003), 2003, Novo Hamburgo. 18th South Symposium on Microelectronics, 2003. p. 81-84.

49.
BRUSAMARELLO, Lucas ; WILKE, Gustavo Reis ; SILVA, Luciano da ; REAL, Rodrigo ; FRAINER, Gustavo ; REIS, Ricardo Augusto da Luz ; GEYER, Cláudio Resin ; GÜNTZEL, J. L. A. ; YAMIN, Adenauer ; AUGUSTIN, Iara . Timing Verification Based on Floating Vector Simulation on a Heterogeneous Distributed System. In: 18th South Symposium on Microelectronics (SIM2003), 2003, Novo Hamburgo. 18th South Symposium on Microelectronics, 2003. p. 111-114.

50.
WILKE, Gustavo ; GÜNTZEL, J. L. A. ; BYSTRONSKI, Márcio ; PINTO, Ana Cristina Medina ; REIS, Ricardo Augusto da Luz . Finding the Critical Delay of Combinational Blocks by Floating Vector Simulation and Path Tracing.. In: 17th South Simposium on Microelectronics (SIM2002), 2002, Canela, RS. 17th South Simposium on Microelectronics. Porto Alegre, RS: Instituto de Informática/UFRGS, 2002. p. 43-46.

51.
HENTSCHKE, Renato ; LAZZARI, Cristiano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Lemon Dragon Physical Synthesis. In: 17th South Symposium on Microelectronics (SIM2002), 2002, Canela, RS. 17th South Symposium on Microelectronics. Porto Alegre, RS: Instituto de Informática/UFRGS, 2002. p. 119-122.

52.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; D'ÁLVILA, E. ; REIS, Ricardo Augusto da Luz . ATG-Based Timing Analysis of Circuits Containing Complex Gates. In: UFRGS Microelectronics Seminar (SIM2000), 2000, Torres. XV UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 2000. p. 69-72.

53.
PINTO, Ana Cristina Medina ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Recursive Learning: a New Methodology for Backtrackings Reduction in Functional Timing Analysis. In: UFRGS Microelectronics Seminar (SIM2000), 2000, Torres. XV UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 2000. p. 73-75.

54.
GÜNTZEL, J. L. A.; PIZZOL, Guilherme Dall ; REIS, Ricardo Augusto da Luz . Exploiting Circuit Regularity in Functional Timing Analysis. In: UFRGS Microelectronics Seminar (SIM99), 1999, Pelotas. XIV UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1999. p. 77-82.

55.
LIMA, F. G. ; JOHANN, Marcelo de Oliveira ; GÜNTZEL, J. L. A. ; CARRO, Luigi ; REIS, Ricardo Augusto da Luz . Programa de TV Tool. In: UFRGS Microelectronics Seminar (SIM99), 1999, Pelotas. XIV UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1999. p. 91-94.

56.
GÜNTZEL, J. L. A.; PINTO, Ana Cristina Medina ; REIS, Ricardo Augusto da Luz . Considering Different Fall and Rise Gate Delays in Path Enumeration. In: UFRGS Microelectronics Seminar (SIM98), 1998, Bento Gonçalves. XIII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1998. p. 59-65.

57.
PINTO, Ana Cristina Medina ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Performance Evaluation of the SGD and SPGD Path Enumeration Methods. In: UFRGS Microelectronics Seminar (SIM98), 1998, Bento Gonçalves. XIII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1998. p. 67-72.

58.
FERREIRA, F. K. ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Path-Based Power Estimation of CMOS Circuits. In: UFRGS Microelectronics Seminar (SIM98), 1998, Bento Gonçalves. XIII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1998. p. 73-77.

59.
LIMA, F. G. ; GÜNTZEL, J. L. A. ; CARRO, Luigi ; JOHANN, Marcelo de Oliveira ; REIS, Ricardo Augusto da Luz . On the Applicability of Universal Logic Gates to Design Masked Programmable Gate Arrays. In: UFRGS Microelectronics Seminar (SIM98), 1998, Bento Gonçalves. XIII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1998. p. 133-138.

60.
LIMA, F. G. ; CARRO, Luigi ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira ; REIS, Ricardo Augusto da Luz . Area Gain Using Universal Logic Gates. In: UFRGS Microelectronics Seminar (SIM98), 1998, Bento Gonçalves. XIII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1998. p. 139-142.

61.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz . A Path Search Algorithm Based on Implicit Path Enumeration Wich Considers Fall and Rise Times. In: UFRGS Microelectronics Seminar (SIM97), 1997, Porto Alegre. XII UFRGS Microelectronics Seminar, 1997. p. 55-60.

62.
GÜNTZEL, J. L. A.; AUVERGNE, D. ; REIS, Ricardo Augusto da Luz . The Path Sensitization Problem in Combinational Circuits: Theory. In: UFRGS Microelectronics Seminar (SIM96), 1996, Porto Alegre. XII UFRGS Microelectronics Seminar. Porto Alegre: Instituto de Informática/UFRGS, 1996. p. 69-74.

63.
FLORES, Aline Pessano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . The Interface of the Marcela Module Generator. In: IX Seminário Interno da Microeletrônica (SIM94), 1994, Porto Alegre. IX Seminário Interno da Microeletrônica. Porto Alegre: Instituto de Informática/UFRGS, 1994. p. 45-47.

64.
FREITAS, Demétrio Luis de ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Partitioning-Based Procedures for Sea-of-Cells Layout Assignment. In: IX Seminário Interno da Microeletrônica (SIM94), 1994, Porto Alegre. IX Seminário Interno da Microeletrônica. Porto Alegre: Instituto de Informática/UFRGS, 1994. p. 49-52.

65.
GÜNTZEL, J. L. A.; BELFORT, Hendrio Baron ; REIS, Ricardo Augusto da Luz . The Logic Decomposition Problem in the Sea-of-Cells Approach. In: IX Seminário Interno da Microeletrônica (SIM94), 1994, Porto Alegre. IX Seminário Interno da Microeletrônica. Porto Alegre: Instituto de Informática/UFRGS, 1994. p. 53-56.

66.
GÜNTZEL, J. L. A.; FREITAS, D. L. ; FLORES, Aline Pessano ; REIS, Ricardo Augusto da Luz . Analysis of a Sea-of-Cells Assignment Tool. In: Congresso da Sociedade Brasileira de Microeletrônica, 1993, Campinas. Congresso da Sociedade Brasileira de Microeletrônica. Campinas: SBMicro/CPqD-Telebras/UNICAMP, 1993. p. XII13-XII15.

67.
FLORES, Aline Pessano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Performance Analysis of the Marcela Design Tools. In: VIII Seminário Interno da Microeletrônica (SIM93), 1993, Porto Alegre. VIII Seminário Interno da Microeletrônica. Porto Alegre: Instituto de Informática/UFRGS, 1993. p. 41-45.

68.
FREITAS, Demétrio Luis de ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . MARLA: The Marcela Layout Assigner. In: VIII Seminário Interno da Microeletrônica (SIM93), 1993, Porto Alegre. VIII Seminário Interno da Microeletrônica. Porto Alegre: Instituto de Informática/UFRGS, 1993. p. 47-51.

69.
FACHIN, D. ; GÜNTZEL, J. L. A. ; RIBAS, Renato Perez ; REIS, Ricardo Augusto da Luz . Tchê: a Test Chip for the Marcela Project. In: VII Seminário Interno da Microeletrônica (SIM91), 1991, Capão da Canoa. VII Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1991. p. 76-79.

70.
APREA, Javier Francisco ; GÜNTZEL, J. L. A. ; FICHMAN, L. ; KINDEL, Marcus ; REIS, Ricardo Augusto da Luz . The GAMA Integrated Circuit. In: VII Seminário Interno da Microeletrônica (SIM91), 1991, Capão da Canoa. VII Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1991. p. 80-83.

71.
GÜNTZEL, J. L. A.; RIBAS, Renato Perez ; REIS, Ricardo Augusto da Luz . Projeto Marcela: uma Opção de Implementação para o Sistema TRANCA. In: VI Seminário Interno da Microeletrônica (SIM90), 1990, Tramandaí. VI Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1990. p. 62-65.

72.
GÜNTZEL, J. L. A.; HOLSBACH, J. ; RIBAS, Renato Perez . Testes Funcionais do CI Taura. In: VI Seminário Interno da Microeletrônica (SIM90), 1990, Tramandaí. VI Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1990. p. 66-69.

73.
GÜNTZEL, J. L. A.. MANOTAÇO: um Alarme Automotivo Anti-Furto. In: VI Seminário Interno da Microeletrônica (SIM90), 1990, Tramandaí. VI Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1990. p. 86-89.

74.
FREIRE, L. O. ; GÜNTZEL, J. L. A. ; BARONE, Dante ; RIBAS, R. ; COSTA, A. L. . PEALO, um CI Gate Array Controlador de Acesso Direto à Memória de um Canal. In: V Seminário Interno da Microeletrônica (SIM89), 1989, Tramandaí. V Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1989. p. 49-52.

75.
GÜNTZEL, J. L. A.; FREIRE, L. O. ; RIBAS, Renato Perez . TAURA, ASIC para Terminal de Vídeo. In: V Seminário Interno da Microeletrônica (SIM89), 1989, Tramandaí. V Seminário Interno da Microeletrônica. Porto Alegre: CPGCC da UFRGS, 1989. p. 58-61.

Resumos publicados em anais de congressos
1.
CORRÊA, Guilherme Ribeiro ; BRAGA, Matheus Porciuncula ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Análise Automática da Propagação de Single-Event Transients Utilizando os Algoritmos PODEM e SAT. In: XVI Congresso de Iniciação Científica da UFPel (CIC2007), 2007, Pelotas. XVI Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2007. v. 1. p. 1-1.

2.
CORRÊA, Guilherme Ribeiro ; MESQUITA, Eduardo Macedo ; FRANCK, H. S. ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Análise da Proteção de Somadores Tolerantes a Radiação Implementados em FPGAs. In: XVI Congresso de Iniciação Científica da UFPel (CIC2007), 2007, Pelotas. XVI Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2007. v. 1. p. 1-1.

3.
MESQUITA, Eduardo Macedo ; BRAGA, Matheus Porciuncula ; WILKE, Gustavo Reis ; GÜNTZEL, J. L. A. . Usando Análise de Timing Estatística para Avaliar a Precisão da Análise de Timing de Pior Caso. In: XIV Congresso de Iniciação Científica da UFPel (CIC2005), 2006, Pelotas. XIV Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2006. p. 1-1.

4.
SILVA, André Marcelo Coelho da ; GÜNTZEL, J. L. A. ; AGOSTINI, Luciano Volcan . Hardware para o Compensador de Movimento do Padrão H.264 de Compressão de Vídeo. In: XIV Congresso de Iniciação Científica da UFPel (CIC2005), 2006, Pelotas. XIV Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2006. p. 1-1.

5.
NEVES, Carolina Gomes ; GÜNTZEL, J. L. A. . Um Método para a Análise Automática de Single Event Transients Baseado em Cálculo Lógico-Temporal. In: XVII Salão de Iniciação Científica da UFRGS, 2005, Porto Alegre. XVII Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 2005. p. 1-1.

6.
BRAGA, Matheus Porciuncula ; MESQUITA, Eduardo Macedo ; GÜNTZEL, J. L. A. . Comparação de Somadores Ripple-Carry CMOS Gerados Automaticamente.. In: XVII Salão de Iniciação Científica da UFRGS, 2005, Porto Alegre. XVII Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 2005. p. 1-1.

7.
NEVES, Carolina Gomes ; BRAGA, Matheus Porciuncula ; GÜNTZEL, J. L. A. . Análise de Timing Topológica de Blocos Combinacionais Baseada no Modelo Pino-a-Pino.. In: XIII Congresso de Iniciação Científica da UFPel, 2004, Pelotas. XIII Congresso de Iniciação Científica da UFPel. Pelotas, RS: UFPel, 2004. p. 1-1.

8.
SILVA, Michele dos Santos da ; GÜNTZEL, J. L. A. . Caracterização Temporal de Portas XOR.. In: XIII Congresso de Iniciação Científica da UFPel, 2004, Pelotas, RS. XIII Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2004. p. 1-1.

9.
ZIESEMER JUNIOR, Adriel Mota ; ALTERMANN, Wagner ; GÜNTZEL, J. L. A. . Geração Bit-Slice para Blocos Operativos em Tecnologia CMOS. In: XII Congresso de Iniciação Científica da UFPel, 2003, Pelotas. XII Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2003. p. 1-1.

10.
ALTERMANN, Wagner ; ZIESEMER JUNIOR, Adriel Mota ; GÜNTZEL, J. L. A. . Visualização e Edição de Layouts de Circuitos CMOS.. In: XII Congresso de Iniciação Científica da UFPel, 2003, Pelotas. XII Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2003.

11.
SILVA, Michele dos Santos da ; GÜNTZEL, J. L. A. . Caracterização Temporal de Portas XOR. In: XII Congresso de Iniciação Científica da UFPel, 2003, Pelotas. XII Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2003.

12.
NEVES, Carolina Gomes ; GÜNTZEL, J. L. A. . Sobre a Aplicação de Técnicas de ATPG para Acelerar a Análise de Timing Baseada em Enumeração de Atrasos. In: XII Congresso de Iniciação Científica da UFPel, 2003, Pelotas. XII Congresso de Iniciação Científica da UFPel. Pelotas: UFPel, 2003.

13.
BYSTRONSKI, Márcio ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Considerando Caminhos Críticos no Posicionamento de Circuitos Digitais CMOS.. In: XIV Salão de Iniciação Científica da UFRGS, 2002, Porto Alegre. XIV Salão de Iniciação Científica da UFRGS, 2002.

14.
FERRÃO, Daniel Lima ; GÜNTZEL, J. L. A. . Sensibilização de Caminhos em Circuitos Combinacionais CMOS.. In: XIV Salão de Iniciação Científica da UFRGS, 2002, Porto Alegre. XIV Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 2002. p. 1-1.

15.
WILKE, Gustavo Reis ; BYSTRONSKI, Márcio ; GÜNTZEL, J. L. A. . Algoritmos para Análise de Timing Funcional de Circuitos Contendo Portas CMOS Complexas.. In: XIII Salão de Iniciação Científica, 2001, Porto Alegre. XIII Salão de Iniciação Científica. Porto Alegre: UFRGS, 2001.

16.
PIZZOL, Guilherme Dall ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Estudo Sobre a Sensibilização de Caminhos em Somadores CMOS.. In: X Salão de Iniciação Científica da UFRGS, 1998, Porto Alegre. X Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 1998. p. 70-70.

17.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz . ASIC Design Using a Sea-of-Cells Approach.. In: European Design & Test Conference, 1995, Paris. European Design & Test Conference. Los Alamitos, CA, EUA: IEEE e ACM-SIGDA, 1995. p. 255-255.

18.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz . Geração de Circuitos Integrados Usando Matrizes de Células Pré-Difundidas.. In: Jornadas de Investigación del Grupo de Montevideo, 1994, Salto. Jornadas de Investigación del Grupo del Montevideo. Montevideo: Universidad de la República (Uruguai), 1994. p. 197-197.

19.
BELFORT, Hendrio Baron ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Validação da Matriz de Células Pré-Difundidas do Projeto Marcela.. In: VI Salão de Iniciação Científica da UFRGS, 1994, Porto Alegre. Porto Alegre: UFRGS, 1994. p. 1-1.

20.
FLORES, Aline Pessano ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . A Interface X-Windows para o Sistema Marcela.. In: VI Salão de Iniciação Científica da UFRGS, 1994, Porto Alegre. VI Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 1994.

21.
KINDEL, Marcus ; FICHMAN, Luis Henrique ; APREA, Javier Francisco ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Desenvolvimento de um Microcircuito Digital Atualizador.. In: IV Salão de Iniciação Científica da UFRGS, 1992, Porto Alegre. IV Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 1992. p. 110-110.

22.
FICHMAN, Luis Henrique ; KINDEL, Marcus ; APREA, Javier Francisco ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Projeto de um Microcircuito Digital Contador de 16 Bits.. In: IV Salão de Iniciação Científica da UFRGS, 1992, Porto Alegre. Porto Alegre: UFRGS, 1992. p. 110-110.

23.
RIBAS, Renato Perez ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . Tchê : o circuito teste do projeto Marcela.. In: III Salão de Iniciação Científica da UFRGS, 1991, Porto Alegre. III Salão de Iniciação Científica da UFRGS. Porto Alegre: UFRGS, 1991. p. 43-43.

24.
FREIRE, Luis Otavio ; GÜNTZEL, J. L. A. ; RIBAS, R. ; COSTA, A. L. ; BARONE, Dante . A Concepção de Pealo, CI Gate Array Controlador de Acesso Direto à Memória.. In: Congresso da Sociedade Brasileira de Microeletrônica, 1989, Porto Alegre. Congresso da Sociedade Brasileira de Microeletrônica. Porot Alegre: SBMicro/UFRGS, 1989. p. 745-746.

Apresentações de Trabalho
1.
GÜNTZEL, JOSÉ LUÍS; LIVRAMENTO, Vinícius dos Santos ; SANTOS, LUIZ C. V. DOS . Exploiting Flow Conservation Conditions for Effective Timing-Driven Layer Assignment. 2017. (Apresentação de Trabalho/Conferência ou palestra).

2.
NETTO, RENAN ; LIVRAMENTO, Vinícius dos Santos ; GUTH, Chrystian de Sousa ; SANTOS, Luiz Claudio Villar dos ; GÜNTZEL, JOSÉ LUÍS . Exploiting bipartite graph matching for fast local clock network optimization during incremental timing-driven placement. 2016. (Apresentação de Trabalho/Congresso).

3.
NETTO, RENAN ; GUTH, Chrystian de Sousa ; LIVRAMENTO, Vinícius dos Santos ; CASTRO, M. B. ; PILLA, L. L. ; GÜNTZEL, JOSÉ LUÍS . Exploiting Parallelism to Speed Up Circuit Legalization. 2016. (Apresentação de Trabalho/Simpósio).

4.
SEIDEL, I. ; GÜNTZEL, JOSÉ LUÍS ; AGOSTINI, Luciano Volcan . Coarse Grain Partial Distortion Elimination for Hadamard ME in HEVC. 2016. (Apresentação de Trabalho/Simpósio).

5.
GÜNTZEL, J. L.. Portas Lógicas CMOS e Layout. 2015. (Apresentação de Trabalho/Conferência ou palestra).

6.
GÜNTZEL, J. L.. Timing-Driven Placement. 2015. (Apresentação de Trabalho/Conferência ou palestra).

7.
GÜNTZEL, J. L.; LIVRAMENTO, Vinícius dos Santos . FirstPlace: a Fast and Effective Incremental Timing-Driven Placement Flow. 2015. (Apresentação de Trabalho/Conferência ou palestra).

8.
SEIDEL, I. ; BRÄSCHER, ANDRÉ BEIMS ; MONTEIRO, Marcio ; GÜNTZEL, JOSÉ LUÍS . Exploring Pel Decimation to Trade off Between Energy and Quality in Video Coding. 2014. (Apresentação de Trabalho/Simpósio).

9.
GÜNTZEL, J. L. A.. Projeto Físico de Portas Lógicas e Redes de Transistores. 2012. (Apresentação de Trabalho/Conferência ou palestra).

10.
VOLPATO, Daniel Pereira ; MENDONÇA, Alexandre K. I. ; GÜNTZEL, J. L. A. ; SANTOS, Luiz Claudio Villar dos . Cache-tuning-aware Scratchpad Allocation from Binaries. 2011. (Apresentação de Trabalho/Simpósio).

11.
GÜNTZEL, J. L. A.. Static Timing Analysis e Otimização de Atraso e Potência de Circuitos Digitais. 2011. (Apresentação de Trabalho/Conferência ou palestra).

12.
GÜNTZEL, J. L. A.. Apresentação Geral do INCT-NAMITEC. 2011. (Apresentação de Trabalho/Conferência ou palestra).

13.
GÜNTZEL, J. L. A.. Metodologias de Projeto Físico. 2011. (Apresentação de Trabalho/Conferência ou palestra).

14.
GÜNTZEL, J. L. A.. Circuitos Integrados Digitais em Tecnologia CMOS. 2010. (Apresentação de Trabalho/Conferência ou palestra).

15.
GÜNTZEL, J. L. A.. Circuitos Integrados Digitais em Tecnologia CMOS. 2009. (Apresentação de Trabalho/Conferência ou palestra).

16.
GÜNTZEL, J. L. A.. Técnicas de Implementação de Circuitos Integrados. 2008. (Apresentação de Trabalho/Conferência ou palestra).

17.
GÜNTZEL, J. L. A.. Técnicas de Implementação e Metodologias de Projeto. 2007. (Apresentação de Trabalho/Conferência ou palestra).


Produção técnica
Programas de computador sem registro
1.
FERRÃO, Daniel Lima ; SANTOS, Cristiano Lopes dos ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . TicTac::Sizing. 2005.

2.
FERRÃO, Daniel Lima ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . TicTac::Sens. 2004.

3.
WILKE, Gustavo Reis ; BRUSAMARELLO, Lucas ; GÜNTZEL, J. L. A. ; REIS, Ricardo Augusto da Luz . TicTac:: Brutus. 2003.

4.
GÜNTZEL, J. L. A.; JOHANN, Marcelo de Oliveira ; FLORES, Aline Pessano ; FREITAS, Demétrio Luis de ; REIS, Ricardo Augusto da Luz . MARCELA: um gerador automático de leiautes baseado em matrizes de células pré-difundidas. 1995.

Trabalhos técnicos
1.
REIS, André Inácio ; BEHRENS, Frank Hermann ; GÜNTZEL, J. L. A. ; RIBAS, Renato Perez ; REIS, Ricardo Augusto da Luz . Formas de Implementação de ASICs Digitais.. 1993.

2.
GÜNTZEL, J. L. A.; FREIRE, Luis Otavio ; RIBAS, Renato Perez ; BARONE, Dante . TAURA, Um ASIC para Terminal de Vídeo.. 1991.

3.
FREIRE, Luis Otavio ; GÜNTZEL, J. L. A. ; RIBAS, Renato Perez ; COSTA, Ana Lúcia ; FRÖHLICH, Antônio Augusto ; BARONE, Dante . Documentação da Concepção de Pealo (CADM1C), um Circuito Integrado Pré-Difundido Controlador de Acesso Direto à Memória de um Canal para Sistemas Baseados no Microprocessador 8085A.. 1989.

4.
CALAZANS, Ney ; FRANCESCHINI, Carlos ; FREIRE, Luis Otavio ; GÜNTZEL, J. L. A. ; RIBAS, Renato Perez . Biblioteca de células para circuitos pré-difundidos.. 1988.


Demais tipos de produção técnica
1.
GÜNTZEL, J. L. A.. Circuitos Integrados Digitais em Tecnologia CMOS. 2009. (Curso de curta duração ministrado/Extensão).

2.
GÜNTZEL, J. L. A.. Técnicas de Implementação de CIs. 2008. (Curso de curta duração ministrado/Extensão).

3.
GÜNTZEL, J. L. A.. Técnicas de Implementação e Metodologias de Projeto. 2007. (Curso de curta duração ministrado/Extensão).

4.
GÜNTZEL, J. L. A.. Design Styles: gate arrays, standard-cells, full custom, FPGA. 2006. (Curso de curta duração ministrado/Extensão).

5.
GÜNTZEL, J. L. A.. Estilos de Projeto Físico. 2005. (Curso de curta duração ministrado/Extensão).

6.
GÜNTZEL, J. L. A.. Estilos de Projeto Físico. 2004. (Curso de curta duração ministrado/Extensão).

7.
GÜNTZEL, J. L. A.. Modelos e Algoritmos para Verificação de Timing de Circuitos Digitais CMOS. 2004. (Curso de curta duração ministrado/Outra).

8.
GÜNTZEL, J. L. A.. Estilos de Projeto Físico. 2003. (Curso de curta duração ministrado/Extensão).

9.
GÜNTZEL, J. L. A.. Estilos de Projeto Físico. 2002. (Curso de curta duração ministrado/Extensão).

10.
GÜNTZEL, J. L. A.. Estilos de Projeto. 2001. (Curso de curta duração ministrado/Extensão).

11.
GÜNTZEL, J. L. A.. Estilos de Projeto. 2000. (Curso de curta duração ministrado/Extensão).

12.
GÜNTZEL, J. L. A.. Técnicas de Implementação de Circuitos Lógicos.. 1999. (Curso de curta duração ministrado/Extensão).

13.
GÜNTZEL, J. L. A.. Curso de Introdução à Microeletrônica. 1998. (Curso de curta duração ministrado/Extensão).



Bancas



Participação em bancas de trabalhos de conclusão
Mestrado
1.
GÜNTZEL, Jose Luis; RIBAS, Renato Perez; DINIZ, Claudio Machado; BAMPI, Sergio. Participação em banca de Felipe Todeschini Bortolon. Static Noise Margin Analysis for CMOS Logic Cells in Near-Threshold. 2018. Dissertação (Mestrado em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

2.
GÜNTZEL, JOSÉ LUÍS; MORAES, Raimes; SILVA, Karina Rocha Gomes da. Participação em banca de Fabrízio Piccoli Maziero. Geração Automática de Testes Funcionais Baseada em Algoritmos Genéticos para Verificação Funcional. 2016. Dissertação (Mestrado em Programa de Pós-graduação em Engenharia Elétrica) - Universidade Federal de Santa Catarina.

3.
GÜNTZEL, JOSÉ LUÍS; REIS, André Inácio; RIBAS, Renato Perez; BAMPI, Sergio. Participação em banca de André Luis Rodeghiero Rosa. Projeto de Células e Circuitos VLSI Digitais CMOS para Operação em Baixa Tensão. 2015. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

4.
GÜNTZEL, JOSÉ LUÍS; CORRÊA, Guilherme Ribeiro; MATTOS, J. C. B.; AGOSTINI, Luciano Volcan; PORTO, Marcelo Schiavon. Participação em banca de Dieison Soares Silveira. Algoritmos e Arquiteturas de Hardware para a Compressão de Quadros de Referência em Codificadores de Vídeo Digitais. 2015. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

5.
GÜNTZEL, Jose Luis; AZEVEDO, R. J.; LETTNIN, D. V.; SANTOS, Luiz Claudio Villar dos. Participação em banca de Olav Philipp Henschel. Verificação de Consistência e Coerência de Memória Compartilhada para Multiprocessamento em Chip. 2014. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina.

6.
GÜNTZEL, Jose Luis; PORTO, Marcelo Schiavon; ZATT, B.; AGOSTINI, Luciano Volcan. Participação em banca de Ricardo Garcia Jeske. Projeto de Hardware de Baixo Custo e Alto Desempenho para as Transformadas Discretas dos Cossenos de Tamanho Variável Definidas no Padrão de Codificação de Vídeos HEVC. 2013. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

7.
GÜNTZEL, Jose Luis; LIMA, A. C. C.; FARIAS, P. C. M. A.; CUNHA, A. I. A.. Participação em banca de Ilan Schnitman Souza. Projeto de um Sistema de Correção de Erros em Comunicação Móvel Usado no Padrão LTE. 2013. Dissertação (Mestrado em Engenharia Elétrica) - Universidade Federal da Bahia.

8.
GÜNTZEL, Jose Luis; BEZERRA, Eduardo Augusto; FARINES, J. M.; LETTNIN, D. V.. Participação em banca de Wesley Gonçalves Silva. Geração Automática de Propriedades para Verificação Formal de uma Aplicação Espacial Baseada em FPGA. 2013. Dissertação (Mestrado em PROGRAMA DE POS GRADUAÇÃO EM ENGENHARIA ELETRICA) - Universidade Federal de Santa Catarina.

9.
GÜNTZEL, Jose Luis; BEZERRA, Eduardo Augusto; BECKER, L. B.; LETTNIN, D. V.. Participação em banca de Daniel dos Santos. Desenvolvimento de um Sistema para a Detecção e o Reconhecimento de Sinais de Trânsito Brasileiros. 2013. Dissertação (Mestrado em Programa de Pós-graduação em Engenharia Elétrica) - Universidade Federal de Santa Catarina.

10.
GÜNTZEL, J. L. A.; MARCON, C. A. M.; FERNANDES, L. G. L.; MORAES, Fernando Gehm. Participação em banca de Tales Marchesan Chaves. Distributed Memory Organization with Support for Data Migration for NOC-Based MPSoCs. 2012. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul.

11.
BEZERRA, Eduardo Augusto; MORAES, Fernando Gehm; LETTNIN, D. V.; GÜNTZEL, J. L. A.. Participação em banca de Frederico Ferlini. PLAESER: Plataforma de Emulação de Soft Errors Visando a Análise Experimental de Técnicas de Tolerância a Falhas: uma prototipação rápida utilizando FPGAs. 2012. Dissertação (Mestrado em Programa de Pós-graduação em Engenharia Elétrica) - Universidade Federal de Santa Catarina.

12.
GÜNTZEL, J. L. A.; TEIVE, R. C. G.; ZEFERINO, C. A.. Participação em banca de Rodrigo Vinícius Mendonça Pereira. Análise da Implementação do Protocolo LIN em Hardware e em Software. 2011. Dissertação (Mestrado em Programa de Mestrado Acadêmico em Computação Aplic) - Universidade do Vale do Itajaí.

13.
GÜNTZEL, J. L. A.; WAGNER, F. R.; Olinto Furtado; LETTNIN, D. V.; SANTOS, Luiz Claudio Villar dos. Participação em banca de Eberle Andrey Rambo. Verificação de Consistência de Memória para Sistemas Integrados Multiprocessados. 2011. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina.

14.
GÜNTZEL, J. L. A.; BAMPI, Sergio; WILKE, Gustavo Reis; REIS, Ricardo Augusto da Luz. Participação em banca de Thiago Rocha de Assis. Analysis of Transistor Sizing and Folding Effectiveness to Mitigate Soft Errors. 2009. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

15.
LUBASZEWSKI, Marcelo Soares; KASTENSMIDT, Fernanda Gusmão de Lima; GÜNTZEL, J. L. A.; SUSIN, Altamiro Amadeu. Participação em banca de Cláudio Machado Diniz. Arquitetura de Hardware Dedicada para a Predição Intra-Quadro em Codificadores do Padrão H.264/AVC. 2009. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

16.
SANTOS, Luiz Claudio Villar dos; WAGNER, F. R.; AZEVEDO, R. J.; SCHNEIDER, Márcio Cherem; GÜNTZEL, J. L. A.. Participação em banca de Roberto de Oliveira Leão. Análise Experimental de Técnicas de Estimativa de Potência Baseadas em Macromodelagem em Nível RT. 2008. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina.

17.
SOUZA, A.; CUNHA, C. R.; GÜNTZEL, J. L. A.; MARQUES, Luis Cleber Carneiro; NOCETI FILHO, Sidnei. Participação em banca de Alessandro de Souza Lima. Células SRAM de Ultra Baixa Tensão com Polarização de Substrato. 2008. Dissertação (Mestrado em Programa de Pós-graduação em Engenharia Elétrica) - Universidade Federal de Santa Catarina.

18.
FURTADO, Olinto José Varela; SANTOS, Luiz Claudio Villar dos; Luís Fernando Friedrich; GÜNTZEL, J. L. A.. Participação em banca de Max Ruben de Oliveira Schultz. Geração Automática de Ferramentas de Inspeção de Código para Processadores Especificados em ADL. 2007. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina.

19.
REIS, Ricardo Augusto da Luz; SUSIN, Altamiro Amadeu; MORAES, Fernando Gehm; RIBAS, Renato Perez; GÜNTZEL, J. L. A.. Participação em banca de Adriel Mota Ziesemer Junior. Geração Automática de Partes Operativas de Circuitos VLSI. 2007. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

20.
GALUP-MONTORO, Carlos; SCHNEIDER, Márcio Cherem; MARQUES, Luis Cleber Carneiro; GÜNTZEL, J. L. A.. Participação em banca de Gustavo Buchweitz Giusti. Projeto de um Circuito Divisor de Freqüência de Ultra-Baixo Consumo de Potência. 2007. Dissertação (Mestrado em PROGRAMA DE POS GRADUAÇÃO EM ENGENHARIA ELETRICA) - Universidade Federal de Santa Catarina.

21.
REIS, Ricardo Augusto da Luz; GÜNTZEL, J. L. A.; KASTENSMIDT, Fernanda Gusmão de Lima; LUBASZEWSKI, Marcelo Soares. Participação em banca de Cristina Meinhardt. Geração de Leiautes Regulares Baseados em Matrizes de Células. 2006. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

22.
REIS, Ricardo Augusto da Luz; KASTENSMIDT, Fernanda Gusmão de Lima; BURIOL, Luciana Salete; GÜNTZEL, J. L. A.. Participação em banca de Glauco Borges Valim dos Santos. Area Routing in Digital Integrated Circuits. 2006. Dissertação (Mestrado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

23.
LUBASZEWSKI, Marcelo Soares; SUSIN, Altamiro Amadeu; GÜNTZEL, J. L. A.; REIS, André Inácio. Participação em banca de Rubinei Peske Angelo. Implicações do estilo de Descrição de Códigos VHDL na Testabilidade. 2005. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

24.
GÜNTZEL, J. L. A.; LUBASZEWSKI, Marcelo Soares; KASTENSMIDT, Fernanda Gusmão de Lima. Participação em banca de Cláudio Carvalho Menezes. Geração Automática de Leiaute Através de Matrizes de Células NAND-ARTELO. 2004. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

25.
GÜNTZEL, J. L. A.; VARGAS, F.; FAGUNDES, Rubem. Participação em banca de Leonardo Lemos Ribeiro. Desenvolvimento de um Ambiente paa Controle e Comunicação de um Monitor de Sinais Vitais em Ambiente Windows/PC. 2003. Dissertação (Mestrado em Engenharia Elétrica) - Pontifícia Universidade Católica do Rio Grande do Sul.

26.
GÜNTZEL, J. L. A.; COMBA, João Luiz Dihl; LUBASZEWSKI, Marcelo Soares; MORAES, Fernando Gehm. Participação em banca de Felipe de Souza Marques. Um Algoritmo Formal para Remoção de Redundâncias. 2003. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

27.
GÜNTZEL, J. L. A.; MORAES, Fernando Gehm; SILVA, Ivan Saraiva. Participação em banca de Alex Rocha Prado. Identificando e Removendo Falhas de Colagem Não-Testáveis com o Uso de Vertex Precedent BDDs. 2002. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

28.
GÜNTZEL, J. L. A.; ROCHOL, Juergen; FRANÇA, F. M. G.. Participação em banca de Marcelo Boeira de Barcelos. Soft IP para Criptografia usando o Algoritmo Rijndael e Implementação em Lógica Programável. 2002. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

29.
GÜNTZEL, J. L. A.; RIBAS, Renato Perez; SUSIN, Altamiro Amadeu; LUBASZEWSKI, Marcelo. Participação em banca de Alex Dias Gonsales. Proposta de uma Nova Arquitetura de FPGA para Aplicações DSP e BIST. 2002. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

30.
GÜNTZEL, J. L. A.; SANTOS, Luiz Claudio Villar dos; GEYER, Claudio Fernando Resin; REIS, Ricardo Augusto da Luz. Participação em banca de Sandro Sawicki. Projeto Cooperativo no Ambiente Cave Baseado em Espaço Compartilhado de Objetos. 2002. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

31.
GÜNTZEL, J. L. A.; SUSIN, Altamiro Amadeu; FETTER, Walter; LUBASZEWSKI, Marcelo. Participação em banca de Janor Araújo Bastos. Teste de uma Matriz de Chaveamento. 2002. Dissertação (Mestrado em Engenharia Elétrica) - Universidade Federal do Rio Grande do Sul.

Teses de doutorado
1.
GÜNTZEL, JOSÉ LUÍS; VIVET, Pascal; MORAES, Fernando Gehm; CALAZANS, Ney. Participação em banca de Matheus Trevisan Moreira. Asynchronous Circuits: Innovations in Components, Cell Libraries and Design Templates. 2016. Tese (Doutorado em Ciência da Computação) - Pontifícia Universidade Católica do Rio Grande do Sul.

2.
MORAES, Fernando Gehm; SASSATELLI, G.; GÜNTZEL, J. L.; MARCON, C. A. M.; INDRUSIAK, L. S.; ROBERT, M.; OST, L.; GOGNIAT, G.. Participação em banca de Marcelo Grandi Mandelli. Exploration of Run-Time Dynamic Mapping Techniques for Emerging Large Scale MPSoCs. 2015. Tese (Doutorado em Systemes automatique et micro-electronique) - Université Montpellier 2 - Sciences et Techniques.

3.
PEDRONI, V. A.; GÜNTZEL, Jose Luis; GOUVEIA FILHO, O.; RENAUX, D. P. B.; LIMA, C. R. E.. Participação em banca de Ricardo Pereira Jasinski. Effective Design with VHDL: Principles and Best Practice. 2014. Tese (Doutorado em Engenharia Elétrica e Informática Industrial) - Universidade Tecnológica Federal do Paraná.

4.
GÜNTZEL, Jose Luis; KASTENSMIDT, Fernanda Gusmão de Lima; MARQUES, F. S.; REIS, André Inácio. Participação em banca de Caio Graco Prates Alegretti. Analytical Logical Effort Formulation for Local Sizing. 2013. Tese (Doutorado em Programa de Pós-Graduação em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

5.
GÜNTZEL, Jose Luis; PEREIRA, C. E.; FRAGA, J. S.; COELHO, P. H. G.; STEMMER, M. R.; BECKER, L. B.. Participação em banca de Elisabete Nakoneczny Moraes. Método para Gerenciamento de Consumo de Energia Elétrica em Sistemas Ciberfísicos. 2013. Tese (Doutorado em PROGRAMA DE POS GRADUAÇÃO EM ENGENHARIA ELETRICA) - Universidade Federal de Santa Catarina.

6.
GÜNTZEL, J. L. A.; MILLAN, Alejandro; ROSELLÓ, J. L.; SANCHEZ, S.; YÚFERA, A.. Participação em banca de David Guerrero Martos. Técnicas de Implementación de Circuitos Integrados Digitales CMOS de Alta Velocidad de Operación y Bajo Consumo de Potencia. 2012. Tese (Doutorado em Doctorado en Ingeniería Informática) - Universidade de Sevilla.

7.
SCHNEIDER, Márcio Cherem; SUZUKI, D. O. H.; BAMPI, Sergio; GÜNTZEL, J. L. A.; GOUVEIA FILHO, O.; SOARES JUNIOR, J. N.. Participação em banca de Adilson Jair Cardoso. Modelagem e Projeto de Conversores AC/DC de Ultrabaixa Tensão de Operação. 2012. Tese (Doutorado em Programa de Pós-graduação em Engenharia Elétrica) - Universidade Federal de Santa Catarina.

8.
GÜNTZEL, J. L. A.; FREIRE, R. C. S.; SOUSA, M. J.; ZAMPOLO, R. F.; KLAUTAU, A.. Participação em banca de Adalbery Rodrigues Castro. Implementação em FPGA de Algoritmos para Classificação de Modulação em Rádio Cognitivo. 2011. Tese (Doutorado em Engenharia Elétrica) - Universidade Federal do Pará.

9.
LUBASZEWSKI, Marcelo Soares; JACOBI, R. P.; GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz. Participação em banca de Sandro Sawicki. Particionamento de Células e Pads de I/O em Circuitos VLSI 3D.. 2009. Tese (Doutorado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

10.
REIS, André Inácio; GÜNTZEL, J. L. A.; KASTENSMIDT, Fernanda Gusmão de Lima; JOHANN, Marcelo de Oliveira. Participação em banca de Felipe de Souza Marques. Technology Mapping for Virtual Libraries Based on DAGs. 2008. Tese (Doutorado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul.

11.
AGOSTINI, Luciano Volcan; JOHANN, Marcelo de Oliveira; GÜNTZEL, J. L. A.; RIBAS, Renato Perez. Participação em banca de Leomar Soares da Rosa Júnior. Automatic Generation and Evaluation of Transistor Networks in Different Logic Styles. 2008. Tese (Doutorado em Programa de Pós-Graduação em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

12.
PAN, D.; WIRTH, Gilson Inácio; GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz. Participação em banca de Gustavo Reis Wilke. Analysis and Optimization of Mesh-based Clock Distribution. 2008. Tese (Doutorado em Programa de Pós-Graduação em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

Qualificações de Doutorado
1.
Giintzel, Jose Luis; KAHNG, Andrew B.; BRENNER, Ulrich; JOHANN, MARCELO. Participação em banca de Jucemar Luis Monteiro. Timing-driven Placement with Network Flow-based Legalization. 2017. Exame de qualificação (Doutorando em Programa de Pós-Graduação em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

2.
GÜNTZEL, JOSÉ LUÍS; BRUSAMARELLO, Valner João; HELDWEIN, Marcelo Lobo; RAMBO, Carlos Renato; ÁLVAREZ-BOTERO, Germán Andrés; SOUSA, Fernando Rangel de. Participação em banca de Arturo Fajardo Jaimes. Concepção de um Sistema Autônomo para Alimentar um Implante Subcutâneo sem Baterias e sem Contato. 2015. Exame de qualificação (Doutorando em Programa de Pós-Graduação em Engenharia Elétrica - PGEEL) - Universidade Federal de Santa Catarina.

3.
PEDRONI, V. A.; GÜNTZEL, Jose Luis; GOUVEIA FILHO, O.; RENAUX, D. P. B.; LIMA, C. R. E.. Participação em banca de Ricardo Pereira Jasinski. Effective Design with VHDL: Principles and Best Practice. 2014. Exame de qualificação (Doutorando em Engenharia Elétrica e Informática Industrial) - Universidade Tecnológica Federal do Paraná.

4.
GÜNTZEL, Jose Luis; PEDRONI, V. A.; REIS, André Inácio; SAWAN, M.; PETTENGHI, H.. Participação em banca de Luiz Alberto Pasini Melek. Ultra-Low Voltage CMOS Static Gates. 2014. Exame de qualificação (Doutorando em PROGRAMA DE POS GRADUAÇÃO EM ENGENHARIA ELETRICA) - Universidade Federal de Santa Catarina.

5.
GÜNTZEL, J. L. A.; PEREIRA, C. E.; STEMMER, M. R.. Participação em banca de Elisabete Nakoneczny Moraes. Framework para Gerenciamento de Energia em Sistemas Embarcados. 2011. Exame de qualificação (Doutorando em Pós Graduação em Engenharia de Automação e Sistemas) - Universidade Federal de Santa Catarina.

6.
REIS, Ricardo Augusto da Luz; GÜNTZEL, J. L. A.; KASTENSMIDT, Fernanda Gusmão de Lima; JOHANN, Marcelo de Oliveira; RIBAS, Renato Perez. Participação em banca de Cristiane Lazzari. Transistor-Level Automatic Generation of Hardening and Secure Circuits. 2007. Exame de qualificação (Doutorando em Programa de Pós-Graduação em Microeletrônica) - Universidade Federal do Rio Grande do Sul.

Trabalhos de conclusão de curso de graduação
1.
GÜNTZEL, J. L. A.; Olinto Furtado; FRÖHLICH, Antônio Augusto. Participação em banca de João Paulo Pizani Flor.Síntese comportamental de componentes de um Sistema Operacional em hardware. 2011. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina.

2.
GÜNTZEL, J. L. A.; VOLPATO, Daniel Pereira; SANTOS, Luiz Claudio Villar dos. Participação em banca de Olav Philipp Henschel.Verificação de Coerência e Consistência de Memória Compartilhada para Multiprocessamento em Chip: o impacto da simulação de falhas na avaliação de cobertura. 2011. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina.

3.
GÜNTZEL, J. L. A.; ROSA, Vagner Santos da; SUSIN, Altamiro Amadeu. Participação em banca de Marcelo Schiavon Porto.Investigação de Algoritmos e Desenvolvimento Arquitetural para a Estimação de Movimento em Compressão de Vídeo Digital.. 2006. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

4.
GÜNTZEL, J. L. A.; SILVA, Sandro Vilela da; MACARTHY, Marcello da Rocha. Participação em banca de Thaísa Leal da Silva.Codificação e Decodificação de entropia Segundo o Perfil Baseline do Padrão de Compresão de Vídeo H.264/AVC: Algoritmos e Arquiteturas. 2006. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

5.
MACARTHY, Marcello da Rocha; GÜNTZEL, J. L. A.. Participação em banca de Allan Sampaio Pires.Consolidação do Ambiente Exec-RS com a Inclusão de Mecanismos de Exceção e Interfaces Demonstrativas. 2006. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

6.
GÜNTZEL, J. L. A.; AGOSTINI, Luciano Volcan; MACARTHY, Marcello da Rocha. Participação em banca de Rodrigo Araújo Tavares.Avaliação dos Impactos do Reuso de Hardware Através da Implementaçao de uma Interface PVCI Integrada a uma Arquitetura de Cálculo da DCT 2-D. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

7.
GÜNTZEL, J. L. A.; SILVEIRA, Ricardo Azambuja; AGOSTINI, Luciano Volcan. Participação em banca de Natan Bueno Ungethuem.DomoWork: Ambiente para Projeto de Sistemas de Automação Predial/Residencial Orientado a Objetos. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

8.
GÜNTZEL, J. L. A.; MEDEIROS, Gil Carlos Rodrigues; AGOSTINI, Luciano Volcan. Participação em banca de Cristiano Brasil Sperb.Desenvolvimento de um Compressor JPEG em Software. 2004. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

9.
GÜNTZEL, J. L. A.; JOHANN, Marcelo de Oliveira; REIS, Ricardo Augusto da Luz. Participação em banca de Gustavo Reis Wilke.Evaluating Clock Distribution Architectures. 2004. Trabalho de Conclusão de Curso (Graduação em Engenharia da Computação) - Universidade Federal do Rio Grande do Sul.

10.
GÜNTZEL, J. L. A.; AGOSTINI, Luciano Volcan; MACARTHY, Marcello da Rocha. Participação em banca de Roger Endrigo Carvalho Porto.Estudo e Desenvolvimento de Arquiteturas de Somadores para Uso na Compressão de Imagens JPEG. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

11.
GÜNTZEL, J. L. A.; REIS, Ricardo; AGOSTINI, Luciano Volcan; MACARTHY, Marcello da Rocha. Participação em banca de Bruno Silveira Neves.Minimização de Erros das Operações de DCT 2-D e Quantização de um Compressor de Imagens JPEG Descrito em VHDL. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

12.
GÜNTZEL, J. L. A.; MEDEIROS, Gil Carlos Rodrigues; MATTOS, J.; TOSCANI, S.. Participação em banca de Felipe Zschornack.Um Ambiente de Execução para a Linguagem RS. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

13.
GÜNTZEL, J. L. A.; VARGAS, F.; MEDEIROS, Gil Carlos Rodrigues; MEIRELES, L. F.. Participação em banca de Leandro Teixeira Lopes.Soluções Seguras para Acesso Remoto: Uma Análise de Redes Privadas Virtuais. 2003. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

14.
GÜNTZEL, J. L. A.; YAMIN, Adenauer Correa; MACARTHY, Marcello da Rocha; MEDEIROS, Gil Carlos Rodrigues. Participação em banca de Marcelo Augusto Cardozo Jr..Uma Contribuição à Comunicação e à Coordenação no EXEHDA. 2002. Trabalho de Conclusão de Curso (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas.

15.
GÜNTZEL, J. L. A.. Participação em banca de Adriana Aparecida Sette.Um Guia para Implantação de Segurança Básica em Sistema. 2001. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Informática) - Universidade Luterana do Brasil.

16.
GÜNTZEL, J. L. A.. Participação em banca de Cledimar Machado de Lima.Estudo Comparativo entre Mecanismos de Comunicação e Bibliotecas de Troca de Mensagens em Agrupamentos de Estações de TRabalho. 2001. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Informática) - Universidade Luterana do Brasil.

17.
GÜNTZEL, J. L. A.; TEODOROWITCH, R.. Participação em banca de Ricardo Hernandes Fernandes.Implementação de uma Aplicação Distribuída Usando Troca de Mensagens MPI em um CLuster Linux/Beowulf. 2001. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Luterana do Brasil.

18.
GÜNTZEL, J. L. A.. Participação em banca de Peter Tscherdantzew Neto.Reconhecimento de Palavras Faladas por Meio de Redes Neurais. 2001. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Luterana do Brasil.

19.
GÜNTZEL, J. L. A.. Participação em banca de Paulo Luciano Souza Mello.SOS - Sistema Operacional S. 2000. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Luterana do Brasil.

20.
GÜNTZEL, J. L. A.. Participação em banca de Toshio Murata.Análise de Implantação do Sistema Road Show na ECT. 2000. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Informática) - Universidade Luterana do Brasil.

21.
GÜNTZEL, J. L. A.. Participação em banca de Sérgio Mainieri.Tecnologias Avançadas de Acesso à Internet - Estdo Comparativo de Casos: Modem, ADSL e Wireless. 2000. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Informática) - Universidade Luterana do Brasil.

22.
GÜNTZEL, J. L. A.. Participação em banca de Alexandre da Cunha Corrêa.SarX-10: Sistema de Automação Residencial Orientado ao Protocolo X10. 1999. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Informática) - Universidade Luterana do Brasil.

23.
GÜNTZEL, J. L. A.. Participação em banca de Hugo César Philipp.Implementação de Um Ambiente de Simulação para uma Arquitetura SIMD. 1999. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Luterana do Brasil.

24.
GÜNTZEL, J. L. A.; TEODOROWITSCH, Roland; KRUG, Ricardo. Participação em banca de Leonardo de Oliveira Barros.Criptografia e Segurança de Dados. 1994. Trabalho de Conclusão de Curso (Graduação em Tecnologia Em Processamento de Dados) - Universidade Luterana do Brasil.



Participação em bancas de comissões julgadoras
Concurso público
1.
Giintzel, Jose Luis; CASTRO, M. B.; AZEVEDO, R. J.. Banca de Concurso Público para Professor Classe A - Ciência da Computação/Sistemas de Computação. 2017. Universidade Federal de Santa Catarina.

2.
Giintzel, Jose Luis; SOUSA, Fernando Rangel de; BEZERRA, Eduardo Augusto; REIS, R. A. L.; FRANCO, Dênis Teixeira. Banca de Concurso Público para Professor Classe - Adjunto 1 DE - Engenharia Elétrica - Circuitos Eletrônicos Digitais. 2011. Universidade Federal de Santa Catarina.

3.
FRIEDRICH, Luis Fernando; GÜNTZEL, J. L. A.; WILLRICH, Roberto; JOHANN, Marcelo de Oliveira; FREITAS, Sergio Antônio Andrade de. Banca de Concurso Público para Professor Adjunto no Campus Araranguá da UFSC. 2010. Universidade Federal de Santa Catarina.

4.
GÜNTZEL, J. L. A.; MEDEIROS, Gil Carlos Rodrigues; FLEISCHMANN, Ana Marilza Pernas. Banca de Processo Seletivo de Professor Substituto em Informática Aplicada.. 2006. Universidade Federal de Pelotas.

5.
GÜNTZEL, J. L. A.; AGOSTINI, Luciano Volcan; MACARTHY, Marcello da Rocha. Banca de Processo Seletivo de Professor Assistente em Arquitetura e Organização de Computadores. 2006. Universidade Federal de Pelotas.

6.
MEDEIROS, Gil Carlos Rodrigues; GÜNTZEL, J. L. A.; DINIZ, Eliane da Silva Alcoforado; AZAMBUJA, Flávia Braga de. Banca de Processo Seletivo de Professor Substituto em Computação Gráfica e Programação de Computadores.. 2005. Universidade Federal de Pelotas.

7.
MEDEIROS, Gil Carlos Rodrigues; GÜNTZEL, J. L. A.; SILVEIRA, Ricardo Azambuja; AZAMBUJA, Flávia Braga de. Banca de Processo Seletivo de Professor Substituto em Redes de Computadores e Organização de Computadores.. 2005. Universidade Federal de Pelotas.

8.
MEDEIROS, Gil Carlos Rodrigues; SILVEIRA, Ricardo Azambuja; ROCHOL, Juergen; GÜNTZEL, J. L. A.; YAMIN, Adenauer Correa. Banca de Processo Seletivo de Professor Assistente em Redes de Computadores e Sistemas Distribuídos.. 2005. Universidade Federal de Pelotas.

9.
DINIZ, Eliane da Silva Alcoforado; GÜNTZEL, J. L. A.; FREITAS, Carla Maria das Sasso; CAMPANI, Carlos Antônio Pereira; WALTER, Marcelo. Banca de Processo Seletivo de Professor Assistente em Computação Gráfica.. 2005. Universidade Federal de Pelotas.

10.
GÜNTZEL, J. L. A.; MEDEIROS, Gil Carlos Rodrigues; AGOSTINI, Luciano Volcan; MACARTHY, Marcello da Rocha; AZAMBUJA, Flávia Braga de. Banca de Processo Seletivo de Professor Substituto em Informática Aplicada.. 2004. Universidade Federal de Pelotas.

11.
DINIZ, Eliane da Silva Alcoforado; GÜNTZEL, J. L. A.; AGOSTINI, Luciano Volcan; MEDEIROS, Gil Carlos Rodrigues. Banca de Processo Seletivo de Professor Substituto em Informática Aplicada.. 2004. Universidade Federal de Pelotas.

12.
GÜNTZEL, J. L. A.; DINIZ, Eliane da Silva Alcoforado; AZAMBUJA, Flavia Braga de. Banca de Processo Seletivo de Professor Substituto em Informática Aplicada.. 2003. Universidade Federal de Pelotas.

13.
GÜNTZEL, J. L. A.; GEYER, Claudio Fernando Resin; BARBOSA, Jorge Victoria. Banca de Processo Seletivo de Professor Assistente em Redes de Computadores e Sistemas Distribuídos.. 2002. Universidade Federal de Pelotas.

Outras participações
1.
GÜNTZEL, J. L. A.. Coordenador do Steering Committee da Comissão Regional de Microeletrônica das Universidades do RS. 2004. Comissão Regional de Microeletrônica das Universidades.

2.
GÜNTZEL, J. L. A.. Conselheiro da Sociedade Brasileira de Microeletrônica. 2004. Sociedade Brasileira de Microeletrônica.

3.
GÜNTZEL, J. L. A.; RIBAS, Renato Perez. Banca de Salão de Iniciação Científica. 2001. Universidade Federal do Rio Grande do Sul.



Eventos



Participação em eventos, congressos, exposições e feiras
1.
2018 IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS2018). 2018. (Congresso).

2.
54th ACM/IEEE Design Automation Conference (DAC2017). 2017. (Congresso).

3.
Chip on the Sands. 2017. (Congresso).

4.
23rd IEEE INTERNATIONAL CONFERENCE ON ELECTRONICS, CIRCUITS AND SYSTEMS (ICECS2016). Exploiting Parallelism to Speed Up Circuit Legalization. 2016. (Congresso).

5.
53rd ACM/IEEE Design Automation Conference (DAC2016). Exploiting bipartite graph matching for fast local clock network optimization during incremental timing-driven placement. 2016. (Congresso).

6.
Chip on the Mountains. 2016. (Congresso).

7.
2015 ACM Symposium on International Symposium on Physical Design - (ISPD2015) I. 2015. (Simpósio).

8.
2015 IEEE/ACM International Conference on Computer-Aided Design (ICCAD). 2015. (Congresso).

9.
Chip in Bahia. 2015. (Congresso).

10.
5th LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS2014).Exploring Pel Decimation to Trade off Between Energy and Quality in Video Coding. 2014. (Simpósio).

11.
Chip in Aracaju. 2014. (Simpósio).

12.
26th Symposium on Integrated Circuits and Systems Design (SBCCI2013). 2013. (Simpósio).

13.
ACM/IEEE DESIGN, AUTOMATION & TEST IN EUROPE (DATE2013). 2013. (Congresso).

14.
3rd LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS2012).Evaluating the Impact of Slew on Delay and Power of Neighboring Gates in Discrete Gate Sizing. 2012. (Simpósio).

15.
18th IEEE International Conference on Electronics, Circuits, and Systems (ICECS2011). A1CSA: An Energy-Efficient Fast Adder Architecture for Cell-Based VLSI Design. 2011. (Congresso).

16.
24th Symposium on Integrated Circuits and Systems Design (SBCCI2011).Cache-tuning-aware Scratchpad Allocation from Binaries. 2011. (Simpósio).

17.
48th Design Automation Conference (DAC2011). 2011. (Congresso).

18.
IEEE INTERNATIONAL SYMPOSIUM ON CIRCUITS AND SYSTEMS (ISCAS2011). 2011. (Simpósio).

19.
23rd Symposium on Integrated Circuits and Systems Design (SBCCI2010). 2010. (Simpósio).

20.
XVI Workshop Iberchip (Iberchip2010).Chair of Session i9: Digital Design. 2010. (Simpósio).

21.
22nd Symposium on Integrated Circuits and Systems Design (SBCCI2009). chair of session 5: Test. 2009. (Congresso).

22.
46th Design Automation Conference (DAC2009). 2009. (Congresso).

23.
21st Symposium on Integrated Circuits and Systems Design (SBCCI2008). Chair of session.. 2008. (Congresso).

24.
20th Symposium on Integrated Circuits and Systems Design (SBCCI2007). 2007. (Congresso).

25.
11th European Test Symposium.ETS2006 - 11th European Test Symposium. 2006. (Simpósio).

26.
21th South Symposium on Microelectronics (SIM2006).SIM2006 - 21th South Symposium on Microelectronics. 2006. (Simpósio).

27.
7th Latin-American Test Workshop.Automatic Evaluation of Single Event Transient Propagation in CMOS Logic Circuits Based on Topological Timing Analysis.. 2006. (Simpósio).

28.
VIII Escola Sul de Microeletrônica.EMicro2006 - VIII Escola Sul de Microeletrônica. 2006. (Outra).

29.
20th South Symposium on Microelectronics (SIM2005).SIM2005 - 20th South Symposium on Microelectronics. 2005. (Simpósio).

30.
6th Latin-American Test Workshop.LATW2005 - 6th Latin-American Test Workshop. 2005. (Simpósio).

31.
VII Escola Sul de Microeletrônica.EMicro2005 - VII Escola Sul de Microeletrônica. 2005. (Outra).

32.
XI Workshop Iberchip.IWS2005 - XI Workshop Iberchip. 2005. (Simpósio).

33.
19th South Symposium on Microelectronics (SIM2004).SIM2004 - 19th South Symposium on Microelectronics. 2004. (Simpósio).

34.
5thLatin-American Test Workshop.LATW2004 - 5th Latin-American Test Workshop. 2004. (Simpósio).

35.
Design and Teste in Europe - DATE2004. DATE2004 - Design and Test in Europe. 2004. (Congresso).

36.
VI Escola Sul de Microeletrônica.EMicro2004 - Escola Sul de Microeletrônica. 2004. (Outra).

37.
X Workshop Iberchip.IWS2004 - X Workshop Iberchip. 2004. (Simpósio).

38.
16th Symposium on Integrated Circuits and Systems Design.SBCCI2003 - 16th Symposium on Integrated Circuits and Systems Design. 2003. (Simpósio).

39.
18th South Symposium on Microelectronics (SIM2003).SIM2003 - 18th South Symposium on Microelectronics. 2003. (Simpósio).

40.
Design Automation Conference - DAC2003. DAC2003 - 40th Design Automation Conference. 2003. (Congresso).

41.
V Escola Sul de Microeletrônica.EMicro2003 - Escola Sul de Microeletrônica. 2003. (Outra).

42.
15th Symposium on Integrated CIrcuits and Systems Design.SBCCI2002 - 15th Symposium on Integrated CIrcuits and Systems Design. 2002. (Simpósio).

43.
17th South Symposium on Microelectronics (SIM2002).SIM2002 - 17th South Symposium on Microelectronics. 2002. (Simpósio).

44.
3rd Latin-American Test Workshop.LATW2002 - 3rd Latin-American Test Workshop. 2002. (Simpósio).

45.
IV Escola Sul de Microeletrônica.EMicro2002 - Escola Sul de Microeletrônica. 2002. (Outra).

46.
14th Symposium on Integrated CIrcuits and Systems Design.SBCCI2001 - 14th Symposium on Integrated CIrcuits and Systems Design. 2001. (Simpósio).

47.
16th South Symposium on Microelectronics (SIM2001).SIM2001 - 16th South Symposium on Microelectronics. 2001. (Simpósio).

48.
2ndLatin-American Test Workshop.LATW2001 - 2nd Latin-American Test Workshop. 2001. (Simpósio).

49.
I Escola Regional de Alto Desempenho.ERAD2001 - Escola Regional de Alto Desempenho. 2001. (Outra).

50.
IFIP International Conference on Very Large Scale Integration. VLSI2001 - IFIP International Conference on Very Large Scale Integration. 2001. (Congresso).

51.
III Curso de Qualidade - Planos Pedagógicos para Cursos da Área de Computação e Informática. III Curso de Qualidade. 2001. (Congresso).

52.
III Escola de Microeletrônica da SBC/Sul.EMicro2001 - Escola de Microeletrônica da SBC/Sul. 2001. (Outra).

53.
13th Symposium on Integrated CIrcuits and Systems Design.SBCCI2000 - 13th Symposium on Integrated CIrcuits and Systems Design. 2000. (Simpósio).

54.
II Escola de Microeletrônica da SBC/Sul.EMicro2000 - Escola de Microeletrônica da SBC/Sul. 2000. (Outra).

55.
XV UFRGS Microeletronics Seminar (SIM2000).EMicro2000 - XV UFRGS Microeletronics Seminar. 2000. (Seminário).

56.
Design Automation Conference - DAC99. DAC99 - Design Automation Conference. 1999. (Congresso).

57.
I Escola de Microeletrônica da SBC/Sul.EMicro99 - Escola de Microeletrônica da SBC/Sul. 1999. (Outra).

58.
XII Symposium on Integrated CIrcuits and Systems Design.SBCCI99 - XII Symposium on Integrated CIrcuits and Systems Design. 1999. (Simpósio).

59.
XIV UFRGS Microeletronics Seminar (EMicr99).EMIcro99 - XIV UFRGS Microeletronics Seminar. 1999. (Seminário).

60.
Quarto Workshop Iberchip.IBERCHIP98 - Quarto Workshop Iberchip. 1998. (Simpósio).

61.
XI Brazilian Symposium on Integrated Circuit Design.SBCCI98 - XI Brazilian Symposium on Integrated Circuit Design. 1998. (Simpósio).

62.
IX IFIP International Conference on Very Large Scale Integration. VLSI97 - IX IFIP International Conference on Very Large Scale Integration. 1997. (Congresso).

63.
X Brazilian Symposium on Integrated Circuit Design.SBCCI97 - X Brazilian Symposium on Integrated Circuit Design. 1997. (Simpósio).

64.
IV EBMicro - Escola Brasileira de Microeletrônica.IV EBMicro - Escola Brasileira de Microeletrônica. 1995. (Outra).

65.
Primer Workshop Iberchip.IBERCHIP95 - Primer Workshop Iberchip. 1995. (Simpósio).

66.
X Congresso da Sociedade Brasileira de Microeletrônica. SBMicro95 - X Congresso da Sociedade Brasileira de Microeletrônica. 1995. (Congresso).

67.
II Jornadas de Investigación de AUGM.II Jornadas de Investigación de AUGM. 1994. (Encontro).

68.
IX Congresso da Sociedade Brasileira de Microeletrônica. SBMicro94 - IX Congresso da Sociedade Brasileira de Microeletrônica. 1994. (Congresso).

69.
VIII Simpósio Brasileiro de Concepção de Circuitos Integrados.SBCCI94 - VIII Simpósio Brasileiro de Concepção de Circuitos Integrados. 1994. (Simpósio).

70.
VIII Congresso da Sociedade Brasileira de Microeletrônica. SBMicro93 - VIII Congresso da Sociedade Brasileira de Microeletrônica. 1993. (Congresso).

71.
II Brazilian Microelectronics School.EBMicro92 - II Brazilian Microelectronics School. 1992. (Outra).

72.
VII Simpósio Brasileiro de Concepção de Circuitos Integrados.SBCCI92 - VII Simpósio Brasileiro de Concepção de Circuitos Integrados. 1992. (Simpósio).

73.
VI Congresso da Sociedade Brasileira de Microeletrônica. SBMicro91 - VI Congresso da Sociedade Brasileira de Microeletrônica. 1991. (Congresso).

74.
VI Simpósio Brasileiro de Concepção de Circuitos Integrados.SBCCI91 - VI Simpósio Brasileiro de Concepção de Circuitos Integrados. 1991. (Simpósio).

75.
V Simpósio Brasileiro de Concepção de Circuitos Integrados.SBCCI90 - V Simpósio Brasileiro de Concepção de Circuitos Integrados. 1990. (Simpósio).

76.
IV Congresso da Sociedade Brasileira de Microeletrônica. SBMicro89 - IV Congresso da Sociedade Brasileira de Microeletrônica. 1989. (Congresso).

77.
III Simpósio Brasileiro de Concepção de Circuitos Integrados.SBCCI88 - III Simpósio Brasileiro de Concepção de Circuitos Integrados. 1988. (Simpósio).


Organização de eventos, congressos, exposições e feiras
1.
GUNTZEL, JOSE L. A.; HÜBNER, Michael . 31st Symposium on Integrated Circuits and System Design (SBCCI2018) - Program Chair. 2018. (Congresso).

2.
GÜNTZEL, JOSÉ LUÍS; Bastos, Rodrigo Possamai . 30th Symposium on Integrated Circuits and System Design (SBCCI2017) - EDA/CAD, Test and Reliability Track Co-Chair. 2017. (Congresso).

3.
GÜNTZEL, JOSÉ LUÍS; GALUP-MONTORO, Carlos ; SCHNEIDER, Márcio Cherem ; PETTENGHI, H. ; LETTNIN, D. V. ; BEZERRA, Eduardo Augusto . 7th Latin American Symposium on Circuits and Systems (LASCAS2016) - Finance Chair. 2016. (Congresso).

4.
GÜNTZEL, JOSÉ LUÍS; JUANCHICO, Jorge . XXII Iberchip Workshop (Iberchip2016) - Program Co-Chair. 2016. (Congresso).

5.
GÜNTZEL, JOSÉ LUÍS; Alberto Garcia Ortiz . 29th Symposium on Integrated Circuits and System Design (SBCCI2016) - EDA/CAD, Test and Reliability Track Co-Chair. 2016. (Congresso).

6.
GÜNTZEL, JOSÉ LUÍS. 25th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2015) - Member of the TPC. 2015. (Congresso).

7.
GÜNTZEL, JOSÉ LUÍS. 28th Symposium on Integrated Circuits and System Design (SBCCI2015) - EDA, Test and Verification Track Co-Chair. 2015. (Congresso).

8.
GÜNTZEL, JOSÉ LUÍS. 6th IEEE Latin American Symposium on Circuits and Systems (LASCAS2015) - Member of the TPC. 2015. (Congresso).

9.
GÜNTZEL, J. L. A.. 11th Latin-American Test Workshop (LATW2010). 2010. (Congresso).

10.
GÜNTZEL, J. L. A.. XVI Workshop Iberchip (Iberchip2010). 2010. (Congresso).

11.
GÜNTZEL, J. L. A.. 20th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2010). 2010. (Congresso).

12.
AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. ; MATTOS, J. ; ROSA JÚNIOR, Leomar S. da ; DINIZ, Eliane da Silva Alcoforado . 11th Microelectronics School (EMicro2009). 2009. (Congresso).

13.
REIS, R. A. L. ; BECKER, J. ; GÜNTZEL, J. L. A. ; JOHANN, Marcelo de Oliveira ; WILKE, Gustavo Reis . 17th IFIP/IEEE International Conference on Very Large Scale Integration (VLSI-SoC2009). 2009. (Congresso).

14.
SILVA, Ivan Saraiva ; GÜNTZEL, J. L. A. . 22nd Symposium on Integrated Circuits and Systems Design (SBCCI2009). 2009. (Congresso).

15.
GÜNTZEL, J. L. A.. 10th IEEE Latin-American Test Workshop (LATW2009). 2009. (Congresso).

16.
GÜNTZEL, J. L. A.. 19th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2009). 2009. (Congresso).

17.
GÜNTZEL, J. L. A.. 24th South Symposium on Microelectronics (SIM2009). 2009. (Congresso).

18.
GÜNTZEL, J. L. A.. 21st Symposium on Integrated Circuits and Systems Design (SBCCI2008). 2008. (Congresso).

19.
GÜNTZEL, J. L. A.. 9th IEEE Latin-American Test Workshop (LATW2008). 2008. (Congresso).

20.
GÜNTZEL, J. L. A.. 18th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2008). 2008. (Congresso).

21.
GÜNTZEL, J. L. A.. 20th Symposium on Integrated Circuits and Systems Design (SBCCI2007). 2007. (Congresso).

22.
GÜNTZEL, J. L. A.. 8th IEEE Latin-American Test Workshop (LATW2007). 2007. (Congresso).

23.
GÜNTZEL, J. L. A.. 17th International Workshop on Power and Timing Modeling, Optimization and Simulation (PATMOS2007). 2007. (Congresso).

24.
GÜNTZEL, J. L. A.. PATMOS2006 - 16th International Workshop on Power and Timing Modeling, Optimization and Simulation. 2006. (Congresso).

25.
GÜNTZEL, J. L. A.. LATW2006 - 7th Latin-American Test Workshop. 2006. (Congresso).

26.
GÜNTZEL, J. L. A.. IWS2006 - XII Workshop Iberchip. 2006. (Congresso).

27.
GÜNTZEL, J. L. A.. SIM2006 - 21th South Sympoum on Microelectronics. 2006. (Congresso).

28.
GÜNTZEL, J. L. A.. SBCCI2006 - 19th Symposium on Integrated Circuits and Systems Design. 2006. (Congresso).

29.
GÜNTZEL, J. L. A.. LATW2005 - 6th Latin-American Test Workshop. 2005. (Congresso).

30.
GÜNTZEL, J. L. A.. PATMOS2005 - 15th International Workshop on Power and Timing Modeling, Optimization and Simulation. 2005. (Congresso).

31.
GÜNTZEL, J. L. A.. IWS2005 - XI Workshop Iberchip. 2005. (Congresso).

32.
GÜNTZEL, J. L. A.. SIM2005 - 20th South Sympoum on Microelectronics. 2005. (Congresso).

33.
GÜNTZEL, J. L. A.. EMicro2005 - VII Escola Sul de Microeletrônica. 2005. (Congresso).

34.
GÜNTZEL, J. L. A.; HUERTAS, José Luis ; ZORIAN, Yervant ; LUBASZEWSKI, Marcelo Soares ; CARRO, Luigi ; CHAMPAC, Victor . LATW2004 - 5th Latin American Test Workshop. 2004. (Congresso).

35.
GÜNTZEL, J. L. A.. IWS2004 - X Workshop Iberchip. 2004. (Congresso).

36.
GÜNTZEL, J. L. A.. PATMOS2004 - 14th International Workshop on Powerand Timing Modeling, Optimization ans Simulation. 2004. (Congresso).

37.
GÜNTZEL, J. L. A.. SBCCI2004 - 17th Symposium on Integrated Circuits and Systems Design. 2004. (Congresso).

38.
GÜNTZEL, J. L. A.; FRANCO, Denis Teixeira ; AGOSTINI, Luciano Volcan . V Escola de Microeletrônica da SBC-Sul. 2003. (Outro).

39.
CAPPELATTI, Ewerton ; AGOSTINI, Luciano Volcan ; GÜNTZEL, J. L. A. . SIM2003 - 18th South Symposium on Microelectronics. 2003. (Outro).

40.
GÜNTZEL, J. L. A.; AGOSTINI, Luciano Volcan . 3° Fórum de Microeletrônica das Universidades do Rio Grande do Sul. 2003. (Congresso).

41.
GÜNTZEL, J. L. A.. IWS2003 - IX Workshop Iberchip. 2003. (Congresso).

42.
GÜNTZEL, J. L. A.. SBCCI2003 - 16th Symposium on Integrated Circuits ans Systems Design. 2003. (Congresso).

43.
GÜNTZEL, J. L. A.. PATMOS2003 - 13th International Workshop on Power and Timing Modeling, Optimizations and Simulation. 2003. (Congresso).

44.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz ; CALAZANS, Ney ; HUERTAS, José Luis ; SILVA, J. L. ; BAMPI, Sergio . Chip in the Pampa - 15th Symposium on Integrated Circuits and Systems Design. 2002. (Congresso).

45.
GÜNTZEL, J. L. A.; REIS, Ricardo Augusto da Luz . SIM2002- 17th South Symposium on Microelectronics. 2002. (Congresso).

46.
GÜNTZEL, J. L. A.. SIMS2002 - VII Simpósio de Informática e II MOstra de Software Acadêmico. 2002. (Concerto).

47.
GÜNTZEL, J. L. A.. SIM2000 - XV Microelectronics Seminar. 2000. (Congresso).

48.
GÜNTZEL, J. L. A.. VLSI97 - IFIP TC10 WG10.5 International Conference on Very Large Scale Integration. 1997. (Congresso).

49.
GÜNTZEL, J. L. A.. SIM97 - Seminário de Microeletrônica da UFRGS. 1997. (Congresso).



Orientações



Orientações e supervisões em andamento
Dissertação de mestrado
1.
Sheiny Almeida Fabre. Paralelismo na remoção de pessimismo presente na rede de relógio durante a análise de timing estática. Início: 2017. Dissertação (Mestrado em Ciências da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. (Coorientador).

2.
Luiz Henrique de Lorenzi Cancellier. Exploração da SATD para o aumento da eficiência da compressão de vídio. Início: 2017. Dissertação (Mestrado profissional em Ciências da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. (Orientador).

3.
Marcio Monteiro. Estimação de Movimento Fracionária Energeticamente Eficiente para o Padrão Pós-HEVC. Início: 2017. Dissertação (Mestrado em Ciências da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. (Orientador).

4.
André Beims Bräscher. Avaliação da Relação Entre a Estimação de Movimentos e a Etapa da Transformada no HEVC. Início: 2016. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Fundação de Amparo à Pesquisa e Inovação do Estado de Santa Catarina. (Orientador).

Tese de doutorado
1.
Tiago Augusto Fontana. Legalização de circuitos integrados considerando standard cells de múltiplas linhas e restrições no posicionamento. Início: 2018. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Santa Catarina. (Orientador).

2.
Renan Oliveira Netto. Placement Techniques Considering Multirow Cells, Blockages and Routability. Início: 2017. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Santa Catarina. (Orientador).

3.
Chrystian de Sousa Guth. Posicionamento Incremental Guiado por Potência. Início: 2016. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

4.
Ismael Seidel. Codificação de Vídeo de Alta Eficiência Energética Explorando Técnicas Perceptivas: algoritmos e arquiteturas de hardware. Início: 2014. Tese (Doutorado em Ciências da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. (Orientador).

Trabalho de conclusão de curso de graduação
1.
Giuseppe Battistella. Integração de ferramentas industriais de síntese física de circuitos integrados em uma infraestrutura de pesquisa acadêmica. Início: 2017. Trabalho de Conclusão de Curso (Graduação em Engenharia Eletrônica) - Universidade Federal de Santa Catarina. (Orientador).

Iniciação científica
1.
Gabriel Baiocchi de Sant'Anna. Desenvolvimento de um algoritmo de busca baseado em MSEA com SATD. Início: 2018. Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

2.
Arthur Philippi Bianco. Desenvolvimento e Aperfeiçoamento de uma Técnica de Roteamento de Sinais para Circuitos Integrados VLSI. Início: 2018. Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

3.
Bruno Izaías Bonotto Souza. Simulação de Hardware Usando Vetores Realistas Fornecidos por um Codificador de Vídeo. Início: 2017. Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).


Orientações e supervisões concluídas
Dissertação de mestrado
1.
Tiago Augusto Fontana. Avaliação quantitativa do impacto da organização dos dados na execução de programas: estudos de caso no contexto da Síntese Física. 2018. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Orientador: José Luís Almada Güntzel.

2.
Renan Oliveira Netto. Aceleração da Legalização Incremental Mediante o Uso de Árvores Espaciais. 2017. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Orientador: José Luís Almada Güntzel.

3.
Chrystian de Sousa Guth. Otimização de Atraso Pós-Posicionamento Explorando Ramos Não-Críticos de Árvores de Steiner. 2015. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

4.
Ismael Seidel. Análise do Impacto de Pel Decimation na Codificação de Vídeos de Alta Resolução. 2014. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Orientador: José Luís Almada Güntzel.

5.
Edson Sorato. Classificação Automática de Modulações Digitais Usando Histogramas e Máquinas de Vetores de Suporte. 2014. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, . Orientador: José Luís Almada Güntzel.

6.
Jucemar Luis Monteiro. Algoritmo de Posicionamento Analítico Detalhado Guiado a Caminhos Críticos. 2014. Dissertação (Mestrado em Microeletrônica) - Universidade Federal do Rio Grande do Sul, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Coorientador: José Luís Almada Güntzel.

7.
Vinícius dos Santos Livramento. Sizing Discreto Baseado em Relaxação Lagrangeana para Minimização de Leakage em Circuitos Digitais. 2013. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

8.
Rafael Westphal. Computação Energeticamente Eficiente sob Restrições de Tempo Real em Dispositivos Móveis: o impacto de se otimizar o uso de memória. 2013. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

9.
Gustavo Henrique Nihei. Gerenciamento Energeticamente Eficiente de Memória para Multiprocessamento em Chip Explorando Múltiplas Scratchpads. 2012. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

10.
Helen de Souza Franck. Avaliação de Atraso, Consumo e Proteção de Somadores Tolerantes a Falhas. 2011. Dissertação (Mestrado em Microeletrônica) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

11.
Daniel Pereira Volpato. Gerenciamento Explícito de Memória Auxiliar a partir de Arquivos-Objeto para Melhoria da Eficiência Energética de Sistemas Embarcados. 2010. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

12.
Alexandre Keunecke Ignácio de Mendonça. Alocação de Dados e de Código em Memórias Embarcadas: Uma Abordagem Pós-Compilação.. 2010. Dissertação (Mestrado em Programa de Pós-Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

13.
Daniel Lima Ferrão. Análise de Timing de Circuitos Combinacionais: Abordagens Funcionais e Hierárquicas. 2006. 117 f. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

14.
Cristiano Lopes dos Santos. Verificação e Otimização de Atraso Durante a Síntese Física de Circuitos Integrados CMOS. 2005. 95 f. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

15.
Cristiano Lazzari. Automatic Layout Generation of Static CMOS Circuits Targeting Delay and Power Reduction. 2003. 95 f. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Coorientador: José Luís Almada Güntzel.

Tese de doutorado
1.
Vinícius dos Santos Livramento. Timing Optimization During the Physical Synthesis of Cell-Based VLSI Circuits. 2017. Tese (Doutorado em Pós Graduação em Engenharia de Automação e Sistemas) - Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Coorientador: José Luís Almada Güntzel.

Supervisão de pós-doutorado
1.
Renan Alves Fonseca. 2013. Universidade Federal de Santa Catarina, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. José Luís Almada Güntzel.

Trabalho de conclusão de curso de graduação
1.
Vanio Rodrigues Filho. Arquitetura de Hardware para Interpolação na Estimação de Movimento Fracionária para o Padrão de Compressão de Vídeo HEVC. 2017. Trabalho de Conclusão de Curso. (Graduação em Engenharia Eletrônica) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

2.
Marcio Monteiro. Arquitetura Energeticamente Eficiente para Cálculo da SATD Através do Reúso de Dados. 2017. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

3.
Pedro Veit Michel. Análise da Tecnologia FinFET no Contexto do Fluxo de Projeto Standard-Cell. 2015. Trabalho de Conclusão de Curso. (Graduação em Engenharia Eletrônica) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

4.
Renan de Oliveira Netto. Gate Sizing Discreto Usando Programação Dinâmica. 2013. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

5.
Jucemar Luis Monteiro. Hierarchical Add One Carry Select Adder (A1CSAH): Uma arquitetura somadora select adder com cadeia de carry logarítmica. 2011. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

6.
Carlos Eduardo de Campos. Projeto de um Controlador de Acesso Direto a Memória de Multi Canais. 2011. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

7.
Ismael Seidel. Investigação de Padrões de Subamostragem em Métrica de Similaridade de Imagem. 2011. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

8.
Bruno George de Moraes. Uma Métrica para Taxa de Distorção Voltada para Codificação de Vídeo Perceptiva. 2010. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

9.
Gustavo Henrique Nihei. Modelagem de Alto Nível de Blocos de Memórias visando a Análise de Falhas Transientes em Sistemas Embarcados. 2008. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina. Orientador: José Luís Almada Güntzel.

10.
Matheus Porciuncula Braga. Análise Automática da Propagação de Single-Event Transients Considerando Análise Temporal e Lógica. 2007. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

11.
Helen de Souza Franck. Uma Investigação Sobre Implementações Tolerantes a Falhas Transientes de Somadores Carry Lookahead e Ripple Carry em FPGA. 2007. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

12.
Eduardo Macedo Mesquita. Somadores Rápidos Tolerantes a Falhas Transientes Implementados em FPGA. 2007. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

13.
Carolina Gomes Neves. Análise Automática da Propagação de Single Event Transients em Circuitos Combinacionais CMOS. 2006. 59 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

14.
André Marcelo Coelho da Silva. Desenvolvimento de um Compensador de Movimento para o Padrão H.264 de Compressão de Vídeo. 2005. 0 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

15.
Gustavo Pereira Mateus. Aumentando a Precisão da Análise Automática da Propagação de Single Event Transients em Circuitos Combinacionais CMOS. 2005. 0 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

16.
Adriel Mota Ziesemer Junior. Geração Automática de Multiplicadores para Números Inteiros Binários. 2004. 43 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

17.
Wagner Altermann. Geração Automática de Leiaute de Somadores em Tecnologia CMOS. 2004. 47 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

18.
Daniel Lima Ferrão. Desenvolvimento de uma Ferramenta de Análise de Timing e Circuitos Combinacionais Baseada em Sensibilização Individual de Caminhos. 2003. 87 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

19.
Carlos Alberto Bertotto. Ambiente de Programação Off-Line para Manipuladores Robóticos. 2000. 110 f. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciência da Computação) - Universidade Luterana do Brasil. Orientador: José Luís Almada Güntzel.

Iniciação científica
1.
Sheiny Fabre Almeida. Exploração de Paralelismo na Análise de Timing Estática. 2017. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

2.
Luiz Henrique De Lorenzi Cancellier. Desenvolvimento de um Algoritmo de Busca por Eliminações Sucessivas Baseado em SATD e sua Respectiva Arquitetura. 2017. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

3.
Bernardo Ferrari Mendonça. Desenvolvimento e avaliação de Técnica para Geração da Rede Virtual de Relógio e sua Integração no Fluxo com Ferramentas Comerciais. 2017. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

4.
Thiago Carminatti Barbato. Colaboração ao posicionamento guiado a restrições de atraso usando a biblioteca Ophidian. 2017. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

5.
João Vicente Souto. Estudo, implementação e avaliação de técnica de roteamento de sinais em circuitos integrados digitais. 2017. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

6.
Tiago Augusto Fontana. Desenvolvimento de uma Técnica para Geração da Rede Virtual de Relógio em Circuitos Integrados Digitais. 2015. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

7.
Marcio Monteiro. Estudo e Desenvolvimento de uma Arquitetura da Hardware de Baixo Consumo de Energia para o Cálculo da SATD Considerando Reuso de Dados. 2015. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

8.
Décio Moritz Júnior. Desenvolvimento de uma ferramenta de Gate Sizing Discreto baseada em Relaxação Lagrangiana. 2014. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

9.
Marcio Monteiro. Desenvolvimento de Arquiteturas de Blocos Aceleradores de Hardware de Alta Eficiência Energética para Aplicações Específicas de Multimídia. 2014. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

10.
Ramon Donadel Balthazar. Caracterização de Portas Lógicas em Tecnologia FinFET. 2014. Iniciação Científica. (Graduando em Engenharia Eletrônica) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

11.
Eduardo Pickler Fronza. Síntese Standard Cell de Classificadores baseados em Support Vector Machines. 2014. Iniciação Científica. (Graduando em Engenharia Eletrônica) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

12.
André Beims Bräscher. MFBM: Projeto e prototipagem de um IP-core configurável para block matching em codificação de vídeo. 2013. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

13.
Luiz Henrique de Lorenzi Cancellier. MFBM: Projeto e prototipagem de um IP-core configurável para block matching em codificação de vídeo. 2013. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

14.
Bruno George de Moraes. DCT-2D: Projeto e prototipação de um IP-core para codificação de imagens em formato JPEG. 2012. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

15.
Brunno Abner Machado. DCT-2D: Projeto e prototipação de um IP-core para codificação de imagens em formato JPEG. 2012. Iniciação Científica. (Graduando em Engenharia de Automação e Controle) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

16.
Eduardo Spyrides Boabaid Pimentel Gonçalves. Projeto e prototipagem de um IP-core configurável para block matching em codificação de vídeo. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

17.
Chrystian de Sousa Guth. Desenvolvimento de uma Ferramenta de Análise de Timing para o Dimensionamento de Portas no Fluxo de Projeto Standard Cell. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

18.
Pedro Veit Michel. Projeto de Arquitetura VLSI para classificação de modulações digitais usando Support Vector Machine. 2012. Iniciação Científica. (Graduando em Engenharia Eletrônica) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

19.
Renan Oliveira Netto. Análise do Impacto de Técnicas de Projeto Low Power. 2011. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

20.
Ismael Seidel. Desenvolvimento de Técnicas para Análise e Projeto de Arquiteturas Tolerantes a Falhas Não-Permanentes.. 2010. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

21.
Carlos Eduardo de Campos. Projeto de um IP Controlador de Acesso Direto à Memória. 2010. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

22.
Pedro Paulo Vezzá Campos. Projeto e síntese de somador tolerante a falhas transientes. 2010. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

23.
Robson Ribas. Desenvolvimento de Técnicas para a Análise e Projeto de Arquiteturas Tolerantes a Falhas Não-Permanentes. 2009. Iniciação Científica. (Graduando em Engenharia Elétrica) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

24.
Jucemar Luis Monteiro. Projeto de circuitos aritméticos tolerantes a falhas transientes. 2009. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

25.
Douglas Fernando Rieger. Projeto e Caracterização de um Bloco IP FFT. 2009. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

26.
Gustavo Henrique Nihei. Desenvolvimento de Sistemas Computacionais Tolerantes a Falhas Não-Transientes. 2008. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

27.
Guilherme Klein da Silva Bitencourt. rojeto e síntese de uma arquitetura de somador tolerante a falhas transientes. 2008. Iniciação Científica. (Graduando em Bacharelado em Ciências da Computação) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

28.
Thiago Raitz Novais. Desenvolvimento de Técnicas para a Análise e Projeto de Arquiteturas tolerantes a Falhas Não-Permanentes. 2008. Iniciação Científica. (Graduando em Engenharia Elétrica) - Universidade Federal de Santa Catarina, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

29.
Guilherme Ribeiro Corrêa. Análise de Falhas Não-Permanentes em Circuitos Integrados Provocadas por Radiação. 2006. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

30.
Carolina Gomes Neves. Desenvolvimento de Algoritmos e Ferramentas para a Análise de Timing Funcional de Circuitos Digitais. 2006. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

31.
Eduardo Macedo Mesquita. Desenvolvimento de Ferramentas Computacionais de Apoio ao Projeto Físico. 2005. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

32.
Fabiane Konrad Rediess. Desenvolvimento de Blocos de Hardware para o Compressor H.264. 2005. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: José Luís Almada Güntzel.

33.
Matheus Porciuncula Braga. Desenvolvimento de Ferramentas e Algoritmos para Verificação de Timing de Blocos de Hardware. 2004. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: José Luís Almada Güntzel.

34.
Fabiane Konrad Rediess. Desenvolvimento de Arquiteturas de Microprocessadores para Aplicações Multimídia. 2004. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

35.
Michele dos Santos da Silva. Desenvolvimento de Ferramentas para a Análise de Timing de Circuitos CMOS Digitais. 2004. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

36.
Carolina Gomes Neves. Análise de Timing Funcional de Blocos de Hardware. 2004. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: José Luís Almada Güntzel.

37.
Daniel Lima Ferrão. Desenvolvimento de uma Ferramenta de Análise deTiming de Circuitos Combinacionais Baseada em Sensibilização de Caminhos. 2003. 87 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: José Luís Almada Güntzel.

38.
Carolina Gomes Neves. Desenvolvimento de Algoritmos e Ferramentas para a Análise de Timing Funcional de Circuitos Digitais. 2003. 0 f. Iniciação Científica. (Graduando em Bacharelado Em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

39.
Gustavo Reis Wilke. Timing Analysis de Circuitos CMOS VLSI. 2002. 0 f. Iniciação Científica. (Graduando em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.

40.
Márcio Bystronski. Timing Analysis de Circuitos CMOS VLSI. 2002. 0 f. Iniciação Científica. (Graduando em Computação) - Universidade Federal do Rio Grande do Sul, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: José Luís Almada Güntzel.



Inovação



Projetos de pesquisa


Educação e Popularização de C & T



Apresentações de Trabalho
1.
GÜNTZEL, J. L. A.. Técnicas de Implementação e Metodologias de Projeto. 2007. (Apresentação de Trabalho/Conferência ou palestra).

2.
GÜNTZEL, J. L. A.. Técnicas de Implementação de Circuitos Integrados. 2008. (Apresentação de Trabalho/Conferência ou palestra).

3.
GÜNTZEL, J. L. A.. Circuitos Integrados Digitais em Tecnologia CMOS. 2009. (Apresentação de Trabalho/Conferência ou palestra).

4.
GÜNTZEL, J. L. A.. Circuitos Integrados Digitais em Tecnologia CMOS. 2010. (Apresentação de Trabalho/Conferência ou palestra).

5.
GÜNTZEL, J. L. A.. Static Timing Analysis e Otimização de Atraso e Potência de Circuitos Digitais. 2011. (Apresentação de Trabalho/Conferência ou palestra).

6.
GÜNTZEL, J. L. A.. Apresentação Geral do INCT-NAMITEC. 2011. (Apresentação de Trabalho/Conferência ou palestra).

7.
GÜNTZEL, J. L. A.. Metodologias de Projeto Físico. 2011. (Apresentação de Trabalho/Conferência ou palestra).

8.
GÜNTZEL, J. L. A.. Projeto Físico de Portas Lógicas e Redes de Transistores. 2012. (Apresentação de Trabalho/Conferência ou palestra).

9.
GÜNTZEL, J. L.. Timing-Driven Placement. 2015. (Apresentação de Trabalho/Conferência ou palestra).

10.
GÜNTZEL, JOSÉ LUÍS; LIVRAMENTO, Vinícius dos Santos ; SANTOS, LUIZ C. V. DOS . Exploiting Flow Conservation Conditions for Effective Timing-Driven Layer Assignment. 2017. (Apresentação de Trabalho/Conferência ou palestra).


Organização de eventos, congressos, exposições e feiras
1.
GÜNTZEL, JOSÉ LUÍS; GALUP-MONTORO, Carlos ; SCHNEIDER, Márcio Cherem ; PETTENGHI, H. ; LETTNIN, D. V. ; BEZERRA, Eduardo Augusto . 7th Latin American Symposium on Circuits and Systems (LASCAS2016) - Finance Chair. 2016. (Congresso).




Página gerada pelo Sistema Currículo Lattes em 14/12/2018 às 11:46:25