Rodrigo Soares de Lima Sá Rego

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  • Última atualização do currículo em 10/06/2010


Possui graduação em Ciência da Computação pela Universidade Federal do Rio Grande do Norte(2003) e mestrado em Sistemas e Computação pela Universidade Federal do Rio Grande do Norte(2006). Tem experiência na área de Ciência da Computação, com ênfase em Sistemas de Computação. Atuando principalmente nos seguintes temas:System-on-Chip, Network-on-Chip, MP-SoC, Coerência de Cache, Projeto baseado em Plataforma. (Texto gerado automaticamente pela aplicação CVLattes)


Identificação


Nome
Rodrigo Soares de Lima Sá Rego
Nome em citações bibliográficas
SOARES, R.

Endereço


Endereço Profissional
Universidade de São Paulo, Escola Politécnica, Departamento de Engenharia de Sistema Eletrônicos.
Av. Prof. Luciano Gualberto, trav.3 nº.158
Butantã
05508-010 - Sao Paulo, SP - Brasil
Telefone: () 30915310
Ramal: 304


Formação acadêmica/titulação


2006
Doutorado em andamento em Engenharia Elétrica.
Universidade de São Paulo, USP, Brasil.
Título: -,
Orientador: Marius Strum.
2004 - 2006
Mestrado em Sistemas e Computação.
Universidade Federal do Rio Grande do Norte, UFRN, Brasil.
Título: Projeto e Implementação de uma Plataforma MP-SoC usando SystemC,Ano de Obtenção: 2006.
Orientador: Ivan Saraiva Silva.
Bolsista do(a): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior.
Palavras-chave: System-on-Chip; Network-on-Chip; MP-SoC; Coerência de Cache; Projeto baseado em Plataforma.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Arquitetura de Sistemas de Computação.
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação / Especialidade: Hardware.
Grande Área: Engenharias / Área: Engenharia Elétrica / Subárea: Circuitos Elétricos, Magnéticos e Eletrônicos / Especialidade: Circuitos Eletrônicos.
Setores de atividade: Informática; Industria Eletro-Eletrônica.
1999 - 2003
Graduação em Ciência da Computação.
Universidade Federal do Rio Grande do Norte, UFRN, Brasil.
Título: Implementação de uma Unidade Reconfigurável de Granularidade Grossa usando SystemC.
Orientador: Ivan Saraiva Silva.
Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico.




Atuação Profissional



Universidade Federal do Rio Grande do Norte, UFRN, Brasil.
Vínculo institucional

2003 - 2003
Vínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20

Vínculo institucional

2002 - 2002
Vínculo: Bolsista, Enquadramento Funcional: Bolsista, Carga horária: 20

Atividades

3/2002 - 7/2002
Estágios , Centro de Ciências Exatas, Departamento de Informática e Matemática Aplicada.

Estágio realizado
Monitor da disciplina Laboratório de Estrutura de Dados.


Projetos de pesquisa


2003 - 2004
HiTV
Descrição: O HiTV visa o desenvolvimento de software e hardware para sistemas de televisão digital de alta definição..
Situação: Concluído; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (0) / Especialização: (0) / Mestrado acadêmico: (0) / Mestrado profissional: (0) / Doutorado: (0) .
Integrantes: Rodrigo Soares de Lima Sá Rego - Integrante / Ivan Saraiva Silva - Coordenador.


Áreas de atuação


1.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Hardware.
2.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Arquitetura de Sistemas de Computação.
3.
Grande área: Engenharias / Área: Engenharia Elétrica / Subárea: Circuitos Elétricos, Magnéticos e Eletrônicos/Especialidade: Circuitos Eletrônicos.
4.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Software Básico.


Idiomas


Inglês
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.
Espanhol
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Razoavelmente.
Francês
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Razoavelmente.


Produções



Produção bibliográfica
Trabalhos completos publicados em anais de congressos
1.
G. Girão ; B. C. Oliveira ; SOARES, R. ; SILVA, I. S. . Design and Performance Evaluation of a Cache Consistent NOC-Based MP-SOC. In: IBERCHIP, 2007, Lima. XIII Workshop Iberchip, 2007.

2.
SOARES, R.; AZEVEDO, A. ; SILVA, I. S. . When reconfigurable architecture meets network-on-chip. In: 17th Symposium on Integrated Circuits and Systems Design, 2004, Porto de Galinhas. 17th Symposium on Integrated Circuits and Systems Design. Los Alamitos: IEEE Computer Society, 2004. p. 216-221.

3.
SOARES, R.; AZEVEDO, A. ; SILVA, I. S. . A Case-Study of Communication in a Reconfigurable Architecture: The X4CP32's Communication Buffer. In: Workshop Iberchip, 2004, Cartagena de Indias, 2004.

4.
SOARES, R.; AZEVEDO, A. ; SILVA, I. S. . A New Hybrid Reconfigurable/Parallel Architecture: the X4CP32. In: 15TH SYMPOSIUM ON COMPUTER ARCHITECTURE AND HIGH PERFORMANCE COMPUTING, 2003, São Paulo. 15TH SYMPOSIUM ON COMPUTER ARCHITECTURE AND HIGH PERFORMANCE COMPUTING. Los Alamitos: IEEE Computer Society, 2003. p. 100-108.

5.
SOARES, R.; AZEVEDO, A. ; SILVA, I. S. . X4CP32: a coarse grain general purpose reconfigurable microprocessor. In: PARALLEL AND DISTRIBUTED PROCESSING SYMPOSIUM, 2003, Nice. INTERNATIONAL PARALLEL AND DISTRIBUTED PROCESSING SYMPOSIUM. Los Alamitos: IEEE Computer Society, 2003. p. 171-178.

6.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. . A New Hybrid Parallel/Reconfigurable Architecture: the X4CP32. In: XV SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEM DESIGN, 2003, São Paulo. XV SYMPOSIUM ON INTEGRATED CIRCUITS AND SYSTEM DESIGN. Los Alamitos: IEEE Computer Society, 2003. p. 225-230.

7.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. . Implementacão da DCT 2D em Arquiteturas Reconfiguráveis Utilizando a X4CP32. In: IX WORKSHOP IBERCHIP, 2003, La Habana. IX WORKSHOP IBERCHIP, 2003.

8.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. . Proposta De Um Processador Reconfigurável Multi-Nível: O X4CP32. In: WORKSHOP TÉCNICO CIENTIFICO DO DIMAP, 2003, Natal. WORKSHOP TÉCNICO CIENTIFICO DO DIMAP, 2003.

Resumos expandidos publicados em anais de congressos
1.
AZEVEDO, A. ; AGOSTINI, L. ; WAGNER, F. ; BAMPI, S. ; SOARES, R. ; SILVA, I. S. . Accelerating a Multiprocessor Reconfigurable Architecture with Pipelined VLIW Units. In: Rapid System Prototyping, 2005, Montreal, 2005.

2.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. ; WAGNER, F. ; BAMPI, S. . VLIW Implementation of a Multiprocessor Reconfigurable Architecture. In: STUDENT FORUM ON MICROELECTRONICS, 2004, Porto de Galinhas, 2004.

3.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. . Implementation of Montgomery Multiplication in a Coarse-Grained Reconfigurable Architecture. In: STUDENT FORUM ON MICROELECTRONICS, 2003, São Paulo. STUDENT FORUM ON MICROELECTRONICS. Porto Alegre: Sociedade Brasileira de Computação, 2003.

4.
SOARES, R.; AZEVEDO, A. ; SILVA, I. S. . X4CP32: a Programmable Multi-level Reconfigurable Microprocessor. In: STUDENTS FORUM ON MICROELETRONICS, 2002, Porto Alegre. STUDENTS FORUM ON MICROELETRONICS. Porto Alegre: Sociedade Brasileira de Computação, 2002.

Resumos publicados em anais de congressos
1.
SOARES, R.; SILVA, I. S. . A Low-Cost High-Performance Network-on-Chip. In: WORKSHOP TÉCNICO CIENTIFICO DO DIMAP, 2005, Natal, 2005.

2.
AZEVEDO, A. ; SOARES, R. ; SILVA, I. S. . X4CP32: Uma Arquitetura Reconfigurável Multi-Nível de Granularidade Grossa. In: XIV CONGRESSO DE INICIAÇÃO CIENTÍFICA, CIC2003, 2003, Natal. XIV CONGRESSO DE INICIAÇÃO CIENTÍFICA. Natal: Universidade Federal do Rio Grande do Norte, 2003.

3.
AZEVEDO, A. ; DIAS, C. E. S. ; FARIAS, J. P. F. ; SOARES, R. ; SALMITO, T. L. . Projeto de um Microprocessador Vetorial Didático: O X4CP128i. In: II Workshop em Sistemas Computacionais de alto desempenho, 2001, Pirenópolis. WSCAD 2001. Porto Alegre: Sociedade Brasileira de Computação - SBC, 2001. v. 1. p. 158-161.


Produção técnica
Programas de computador sem registro
1.
SOARES, R.. Plataforma MP-SoC STORM. 2005.




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