Marcelo Schiavon Porto

Bolsista de Produtividade em Pesquisa do CNPq - Nível 2

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  • Última atualização do currículo em 15/10/2018


É professor Adjunto da Universidade Federal de Pelotas, onde atua desde 2009, trabalha no Centro de Desenvolvimento Tecnológico junto aos cursos de Ciência e Engenharia de Computação, também é membro permanente e coordenador adjunto do Programa de Pós-graduação em Computação da UFPel. Possui graduação em Bacharelado em Ciência da Computação pela Universidade Federal de Pelotas (2005), Mestrado em Ciência da computação pela Universidade Federal do Rio Grande do Sul (2008) e Doutorado também pela UFRGS (2012). É Senior Member da IEEE e membro da IEEE Circuits and Systems Society (CASS), IEEE Signal Processing Society (SPS) e SBMicro. Atua em pesquisa junto ao Grupo de Arquiteturas e Circuitos Integrados (GACI) e o Video Technology Research Group (ViTech), suas principais contribuições científicas estão no desenvolvimento de algoritmos e arquiteturas de hardware dedicadas para a compressão de vídeo em diversos padrões (H.264/AVC, HEVC, 3D-HEVC), redução de complexidade na codificação de vídeo 2D/3D e projeto de hardware dedicado para dispositivos móveis. (Texto informado pelo autor)


Identificação


Nome
Marcelo Schiavon Porto
Nome em citações bibliográficas
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.

Endereço


Endereço Profissional
Universidade Federal de Pelotas, Centro de Desenvolvimento Tecnológico (CDTec).
Rua Gomes Carneiro, 01
Centro
96010610 - Pelotas, RS - Brasil
Telefone: (53) 39211401


Formação acadêmica/titulação


2008 - 2012
Doutorado em Computação.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Título: Desenvolvimento Algorítmico e Arquitetural para a Estimação de Movimento na Compressão de Vídeo de Alta Definição, Ano de obtenção: 2012.
Orientador: Sergio Bampi.
Coorientador: Luciano Volcan Agostini.
Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil.
2006 - 2008
Mestrado em Computação.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Título: Arquiteturas de Alto Desempenho e Baixo Custo em Hardware para a Estimação de Movimento em Vídeos Digitais,Ano de Obtenção: 2008.
Orientador: Altamiro Amadeu Susin.
Bolsista do(a): Conselho Nacional de Desenvolvimento Científico e Tecnológico, CNPq, Brasil.
2002 - 2006
Graduação em Bacharelado em Ciência da Computação.
Universidade Federal de Pelotas, UFPEL, Brasil.
Título: Investigação de Algoritmos e Desenvolvimento Arquitetural para a Estimação de Movimento em Compressão de Vídeo Digital.
Orientador: Luciano Volcan Agostini.
1997 - 2001
Curso técnico/profissionalizante em Eletrônica.
Instituto Federal Sul-Rio-Grandense, IFSUL, Brasil.


Pós-doutorado


2015 - 2015
Pós-Doutorado.
Universidade de Coimbra, UC, Portugal.
Bolsista do(a): Coordenação de Aperfeiçoamento de Pessoal de Nível Superior, CAPES, Brasil.
Grande área: Ciências Exatas e da Terra
Grande Área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Arquiteturas de Hardware para a Codificação de Vídeo.


Formação Complementar


2014 - 2014
Developing Software for ARM-based Systems on Chip. (Carga horária: 8h).
Universidade Federal de Pelotas, UFPEL, Brasil.
2014 - 2014
Tecnologias Altera - Qsys System Integration Tool. (Carga horária: 8h).
Universidade Federal de Pelotas, UFPEL, Brasil.
2009 - 2009
Curso Avançado da XI Escola de Microeletrônica.
Universidade Federal de Pelotas, UFPEL, Brasil.
2008 - 2008
Curso Avançado da X Escola de Microeletrônica.
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
2008 - 2008
Núcleo de Línguas Estrangeiras - Inglês. (Carga horária: 60h).
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
2006 - 2006
Curso Avançado da VIII Escola de Microeletrônica. (Carga horária: 40h).
Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
2005 - 2005
Curso Avançado da VII Escola de Microeletrônica.
Universidade de Santa Cruz do Sul, UNISC, Brasil.
2003 - 2005
Inglês.
British House, BH, Brasil.
2004 - 2004
Curso Avançado da VI Escola de Microeletrônica.
Universidade Regional do Noroeste do Estado do Rio Grande do Sul, UNIJUI, Brasil.
2003 - 2003
Curso Avançado da V Escola de Microeletrônica.
Universidade Federal do Rio Grande, FURG, Brasil.
1999 - 1999
Sistema Operacional Linux.
Degraus-cursos de computação, DEGRAUS, Brasil.


Atuação Profissional



Universidade Federal de Pelotas, UFPEL, Brasil.
Vínculo institucional

2009 - Atual
Vínculo: Servidor Público, Enquadramento Funcional: Professor Adjunto, Carga horária: 40, Regime: Dedicação exclusiva.
Outras informações
Professor Adjunto dos cursos de Ciência e Engenharia da Computação do Centro de Desenvolvimento Tecnológico. Orientador no Programa de Pós-Graduação em Computação.

Atividades

06/2017 - Atual
Direção e administração, Centro de Desenvolvimento Tecnológico (CDTec), .

Cargo ou função
Coordenador Adjunto do Programa de Pós-Graduação em Computação.
03/2017 - Atual
Conselhos, Comissões e Consultoria, Reitoria, Pró-Reitoria de Pesquisa e Pós-Graduação.

Cargo ou função
Membro do Comitê Institucional de Bolsas de Iniciação Científica e Tecnológica.
01/2017 - Atual
Ensino, COMPUTAÇÃO, Nível: Pós-Graduação

Disciplinas ministradas
Arquiteturas de Computadores
03/2014 - Atual
Ensino, Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores I
03/2014 - Atual
Ensino, Engenharia de Computação, Nível: Graduação

Disciplinas ministradas
Circuitos Digitais II
10/2013 - Atual
Pesquisa e desenvolvimento , Centro de Desenvolvimento Tecnológico (CDTec), .

10/2013 - Atual
Ensino, COMPUTAÇÃO, Nível: Pós-Graduação

Disciplinas ministradas
Projeto Avançado de Sistemas Digitais
10/2013 - Atual
Ensino, Engenharia de Computação, Nível: Graduação

Disciplinas ministradas
Sistemas Digitais Avançados
05/2013 - Atual
Ensino, Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Arquitetura e Organização de Computadores II
05/2013 - Atual
Ensino, Engenharia de Computação, Nível: Graduação

Disciplinas ministradas
Introdução a Engenharia da Computação
10/2012 - Atual
Ensino, Ciência da Computação, Nível: Graduação

Disciplinas ministradas
Técnicas Digitais
10/2012 - Atual
Ensino, Engenharia de Computação, Nível: Graduação

Disciplinas ministradas
Circuitos Digitais I
10/2012 - 04/2014
Pesquisa e desenvolvimento , Centro de Desenvolvimento Tecnológico (CDTec), .

11/2009 - 10/2013
Pesquisa e desenvolvimento , Centro de Desenvolvimento Tecnológico (CDTec), .

03/2012 - 03/2013
Ensino, Design Digital, Nível: Graduação

Disciplinas ministradas
Tecnologias Aplicadas ao Projeto
10/2009 - 10/2012
Direção e administração, Centro de Artes, Colegiado dos Cursos de Design.

Cargo ou função
Coordenador dos Laboratórios de Produção Gráfica.
03/2011 - 09/2012
Ensino, Cinema de Animação, Nível: Graduação

Disciplinas ministradas
Animação em 3D
Modelagem Geométrica e Visual
03/2010 - 09/2012
Ensino, Design Digital, Nível: Graduação

Disciplinas ministradas
Animação em 3D
Modelagem Geométrica e Visual
10/2009 - 12/2010
Ensino, Design Digital, Nível: Graduação

Disciplinas ministradas
Ergonomia
Tecnologias da Informação
Tecnologias de Animação
10/2009 - 12/2010
Ensino, Design Gráfico, Nível: Graduação

Disciplinas ministradas
Computação Gráfica I
Computação Gráfica II
Ergonomia
10/2009 - 03/2010
Ensino, Cinema e Animação, Nível: Graduação

Disciplinas ministradas
Animação II
3/2003 - 2/2006
Pesquisa e desenvolvimento , Instituto de Física e Matemática, Departamento de Matemática Estatística e Informática.


Universidade Federal do Rio Grande do Sul, UFRGS, Brasil.
Vínculo institucional

2006 - 2011
Vínculo: Colaborador, Enquadramento Funcional: Pesquisador, Carga horária: 12



Linhas de pesquisa


1.
Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento na Compressão de Vídeo Digital

Objetivo: Esta linha de pesquisa visa o desenvolvimento de algoritmos e arquiteturas de hardware eficientes para a estimação de movimento na compressão de vídeo digital de alta definição. O foco atual desta linha de pesquisa é o desenvolvimento de algoritmos rápidos eficientes para a estimação de movimento em vídeos de alta resolução, bem como arquiteturas de hardware de alto desempenho para a codificação de vídeo de alta definição em tempo real..
2.
Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão HEVC com Foco em Vídeo de Alta Definição
3.
Avaliação e Desenvolvimento de Algoritmos de Estimação de Movimento para a Compressão de Vídeo Digital
4.
Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC


Projetos de pesquisa


2017 - Atual
Projeto de Hardware para a Compressão de Vídeo nas Extensões do Padrão HEVC: Aplicações para Dispositivos Móveis
Descrição: Este projeto propõe o desenvolvimento de arquiteturas de hardware eficientes para a compressão de vídeo de alta definição, HD (High Definition) e Ultra HD (Ultra High Definition), em dispositivos móveis com foco no padrão HEVC e suas extensões 3D (3D-HEVC), Screen Content Coding (SCC) e High Dynamic Range (HDR). O projeto de hardware será baseado em estudos para a redução de complexidade e otimização das etapas de codificação do padrão HEVC e suas extensões. Estas otimizações visam à redução do custo computacional do processo de codificação, com foco no desenvolvimento de arquiteturas de hardware dedicadas com alto desempenho e eficiência energética para dispositivos móveis. Existe um grande interesse, tanto na comunidade científica quanto industrial, no tema abordado neste projeto. Atualmente, dispositivos móveis capazes de processar vídeos digitais de alta definição estão amplamente presentes no mercado, e com indicadores de crescimento nos próximos anos, além disso, a capacidade de captura e reprodução de vídeos destes dispositivos vem aumentando rapidamente, sendo que alguns smartphones atuais já são capazes de manipular vídeos em resoluções superiores a HD 1080p (ou Full HD). Para dispositivos móveis, além dos requisitos de desempenho, o consumo de energia é um dos aspectos mais importantes. Neste contexto, o desenvolvimento de arquiteturas de hardware dedicadas para a codificação de vídeo, com elevado desempenho e baixo consumo de energia, é fundamental. O padrão HEVC é o mais novo padrão de compressão de vídeo, podendo dobrar a taxa de compressão do padrão H.264/AVC, mantendo a mesma qualidade visual do vídeo codificado. Além disso, as extensões 3D, SCC e HDR do HEVC estão em fase de desenvolvimento, o que traz a esta proposta amplas oportunidades para a inovação científica e tecnológica, com o desenvolvimento de algoritmos e arquiteturas de hardware dedicadas para o HEVC e suas extensões com foco em dispositivos móveis..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (3) / Mestrado acadêmico: (3) / Doutorado: (1) .
Integrantes: Marcelo Schiavon Porto - Coordenador / Roger Endrigo Carvalho Porto - Integrante / Bruno Zatt - Integrante / Lívia Amaral - Integrante / Luciano Braatz - Integrante.Financiador(es): Conselho Nacional de Desenvolvimento Científico e Tecnológico - Auxílio financeiro.
2016 - Atual
Algoritmos Eficientes para a Codificação de Vídeos em Sistemas Embarcados Adaptativos

Projeto certificado pelo(a) coordenador(a) Luciano Volcan Agostini em 21/02/2017.
Descrição: O objetivo principal deste projeto é ampliar a relação de colaboração do grupo emergente proponente, potencializando os resultados dos trabalhos que vêm sendo desenvolvidos e gerando novas oportunidades de colaboração entre os integrantes da equipe. O foco será nas duas linhas principais que estão sendo aglutinadas: sistemas embarcados e codificação de vídeos..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Mestrado acadêmico: (5) Doutorado: (6) .
Integrantes: Marcelo Schiavon Porto - Integrante / Bruno Zatt - Integrante / Júlio Mattos - Integrante / AGOSTINI, L. - Coordenador / Guilherme Corrêa - Integrante / Antonio Filho - Integrante / Gabriel Nazar - Integrante / Mateus Rutzig - Integrante.Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro.
2016 - Atual
Desenvolvimento de Soluções para a Compressão de Vídeo de Alta Definição em Dispositivos Móveis
Descrição: Este projeto propõe o desenvolvimento de soluções para a compressão de vídeo de alta definição, HD (High Definition) e Ultra HD (Ultra High Definition), em dispositivos móveis com foco no padrão HEVC e suas extensões 3D (3D-HEVC), screen content (SCC) e High Dynamic Range (HDR). O foco principal deste projeto está na redução de complexidade e otimização das etapas de codificação do padrão HEVC e suas extensões visando o desenvolvimento de arquiteturas de hardware. Estas otimizações visam a redução do custo computacional do processo de codificação, com foco no desenvolvimento de arquiteturas de hardware dedicadas com alto desempenho e eficiência energética para dispositivos móveis. Existe um grande interesse, tanto na comunidade científica quanto industrial, no tema abordado neste projeto. O mercado de dispositivos móveis capazes de processar vídeos digitais de alta definição está em franca expansão, além disso, a capacidade de captura e reprodução de vídeos destes dispositivos vem aumentando rapidamente, sendo que alguns smartphones atuais já são capazes de produzir vídeos em resoluções Ultra HD. Para dispositivos móveis, além dos requisitos de desempenho, o consumo de energia é um dos requisitos mais importantes. Neste contexto, o desenvolvimento de arquiteturas de hardware dedicadas para a codificação de vídeo, com elevado desempenho e baixo consumo de energia, é fundamental. O padrão HEVC é o mais novo padrão de compressão de vídeo, podendo dobrar a taxa de compressão do padrão H.264/AVC (padrão adotado pelo Sistema Brasileiro de Televisão Digital - SBTVD), mantendo a mesma qualidade visual do vídeo codificado. Além disso, diversas extensões do HEVC estão em fase de desenvolvimento. Logo, esta proposta apresenta amplas oportunidades para a inovação científica e tecnológica, com o desenvolvimento de algoritmos e arquiteturas de hardware dedicadas para o HEVC e suas extensões com foco em dispositivos móveis. Além dos resultados tecnológicos, científicos e de inovação, acredita-se que este projeto possa contribuir para estreitar a cooperação com as instituições de ensino superior parceiras no país e no exterior, Universidade Federal do Rio Grande do Sul (UFRGS) e Universidade de Coimbra (UC), Portugal. Por fim espera-se gerar recursos humanos capacitados a trabalhar na área de concentração deste projeto bem como gerar diversos trabalhos de conclusão de curso, mestrado e doutorado..
Situação: Em andamento; Natureza: Pesquisa.
Alunos envolvidos: Graduação: (4) / Mestrado acadêmico: (2) / Doutorado: (2) .
Integrantes: Marcelo Schiavon Porto - Coordenador / Sergio Bampi - Integrante / Bruno Zatt - Integrante / Dieison Silveira - Integrante / Vladimir Afonso - Integrante / Gustavo Freitas Sanchez - Integrante / Luciano Volcan Agostini - Integrante / Ruhan Conceição - Integrante / Mateus Melo - Integrante / Guilherme Corrêa - Integrante / Luis Alberto da Silva Cruz - Integrante.Financiador(es): Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul - Auxílio financeiro.
2014 - Atual
Heurísticas, Otimizações Algorítmicas e Projetos Arquiteturais para o Padrão HEVC de Codificação de Vídeos Digitais: Soluções Integradas no Desenvolvimento de Hardware Dedicado para Aplicativos Móveis e Sistemas Embarcados em Geral

Projeto certificado pelo(a) coordenador(a) Luciano Volcan Agostini em 04/11/2016.
Descrição: Este projeto está focado na geração de soluções inovadoras para a compressão de vídeos digitais de acordo com o padrão emergente HEVC - High Efficiency Video Coding. Este padrão é o estado da arte para aplicações que manipulam vídeos digitais. As soluções geradas no escopo deste projeto estarão pautadas por critérios tradicionais como qualidade do vídeo gerado, taxa de compressão e complexidade, mas também irão considerar outros critérios, como o consumo de energia e a facilidade de exploração de paralelismo, cujo objetivo é desenvolver soluções eficientes para a implementação em hardware, em especial, para circuitos integrados direcionados para dispositivos móveis. Neste sentido, serão desenvolvidas novas heurísticas, novos algoritmos otimizados e, também, arquiteturas dedicadas, que serão direcionadas para FPGAs e standard-cells. Então a execução do projeto será capaz de gerar impactos científicos e tecnológicos de grande interesse comercial, com potencial de gerar patentes e publicações relevantes. As ferramentas de codificação do HEVC que serão foco deste projeto serão a predição inter-quadros, as transformadas de tamanho variável e os filtros. Além disso, serão desenvolvidas soluções para o controle dinâmico de complexidade do codificador e para a redução do número de acessos à memória externa. Como resultados esperados da execução deste projeto, além do desenvolvimento de heurísticas, algoritmos e arquiteturas para o HEVC, espera-se a geração de quatro artigos para eventos internacionais ou nacionais qualificados e dois artigos para periódicos qualificados. Também espera-se que seja possível gerar pelo menos duas patentes com os resultados mais inovadores e de maior interesse comercial do projeto. Como resultado mais amplo, pretende-se estreitar os laços de cooperação entre os pesquisadores da UFPel com os pesquisadores da UC (Universidade de Coimbra) e do IPL (Instituto Politécnico de Leiria), ambos em Portugal, do KIT (Karlsruhe Institute of Technology), na Alemanha, e da UFRGS, UFSC e IFSul, contribuindo para a geração de um pólo de desenvolvimento tecnológico em microeletrônica e codificação de vídeo na UFPel. Também se espera que a execução deste projeto possa contribuir com a consolidação do Programa de Pós-Graduação em Computação da UFPel..
Situação: Em andamento; Natureza: Pesquisa.
2014 - Atual
Arquiteturas e Algoritmos para Codificação de Vídeo 3D Segundo o Padrão Emergente 3DV com Foco em Sistemas Móveis Embarcados

Projeto certificado pelo(a) coordenador(a) Bruno Zatt em 19/03/2015.
Descrição: Este projeto tem por objetivo investigar soluções de hardware e software para codificação de vídeos 3D que sejam eficientes em termos de desempenho e energia focando em dispositivos móveis embarcados. Neste projeto iremos utilizar o padrão emergente 3DV, o 3D Video Coding, que codifica sequências de vídeo geradas por múltiplas câmeras que capturam uma cena 3D e os mapas de profundidade associadas a esta cena. Tendo em vista a alta complexidade demanda para efetuar esta codificação em tempo real para altas resoluções iremos focar nos mais complexos módulos do codificador, a estimação de movimento e disparidade, o modo de decisão e o preditor intra-quadro. Inicialmente iremos desenvolver soluções em software otimizadas para processadores embarcados e unidade de processamento gráfico embarcadas que serão prototipadas utilizando uma placa de desenvolvimento específica para dispositivos móveis embarcados. A partir desta prototipação será possível analisar o desempenho e o custo energético de cas um dos algoritmos de codificação estudados, qual arquitetura melhor se encaixa para executar cada algoritmo e quais impactos de mover a execução de uma unidade para outra. Isso permitirá que possamos desenvolver algoritmos para redução e controle de complexidade e energia com base em dados medidos experimentalmente. Conhecendo a necessidade de aceleradores de hardware para módulos que exigem elevado compromisso entre performance e energia, iremos desenvolver e descrever em VHDL o módulo de predição intra-quadro com suporte aos canais de textura e profundidade do codificador 3DV. Além dos resultados tecnológicos e científicos diretos, pretende-se utilizar esta projeto para estreitar a cooperação com as instituições de ensino superior parceiras no país e no exterior, Universidade Federal do Rio Grande do Sul (UFRGS) e Karlsruhe Institute of Technology (KIT), Alemanha. Por fim espera-se gerar recursos humanos capacitados a trabalhar na área de concentração deste projeto bem como gerar diversos trabalhos de conclusão de curso, mestrado e doutorado..
Situação: Em andamento; Natureza: Pesquisa.
2013 - Atual
Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC
Descrição: Este projeto tem como objetivo principal o desenvolvimento de algoritmos e arquiteturas de hardware eficientes para a codificação de vídeo segundo os padrões HEVC e 3D-HEVC. O padrão HEVC é o mais novo padrão de compressão de vídeo, atualmente é o codificador de vídeo estado da arte. O padrão 3D-HEVC está em fase de desenvolvimento, e deve se tornar em breve o padrão referência na codificação de vídeos 3D. Espera-se que os resultados da execução deste projeto também possam auxiliar na afirmação do Sistema Brasileiro de TV Digital e na consolidação do Grupo de Arquiteturas e Circuitos Integrados da UFPel como referência no Brasil e no mundo na área de codificação de vídeo. Também é objetivo deste projeto ampliar as relações de colaboração e cooperação com os grupos de pesquisa do Instituto de Computação e Engenharia Elétrica da UFRGS, e com o Instituto Federal de Educação, Ciência e Tecnologia Sul-rio-grandense. Espera-se também fortalecer as relações entre os alunos de graduação e pós-graduação envolvidos no projeto, bem como a relação deles com os professores pesquisadores e colaboradores..
Situação: Em andamento; Natureza: Pesquisa.
2012 - 2014
Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão HEVC com Foco em Vídeo de Alta Definição
Descrição: Este projeto pretende desenvolver novos algoritmos e arquiteturas de hardware para a estimação de movimento (ME - Motion Estimation) do padrão HEVC (High Efficiency Video Coding), com foco em vídeos de alta definição. O desenvolvimento algorítmico visa à obtenção de novos algoritmos rápidos de ME, que obtenham resultados de qualidade superiores á algoritmos rápidos convencionais, quando aplicados a vídeos de a alta definição. Além disso, estes algoritmos devem ser compatíveis com as especificações do padrão HEVC, e também, devem ser de fácil implementação em hardware. A partir dos algoritmos rápidos de ME desenvolvidos, arquiteturas de hardware dedicadas serão desenvolvidas, com foco em alto desempenho, para aplicações de tempo real com taxa de processamento de 30 quadros pro segundo. Estas arquiteturas também devem apresentar baixo consumo de potência, e baixa utilização de recursos de hardware. As arquiteturas serão descritas em VHDL, validadas e sintetizadas para FPGAs. O golden model será o próprio software de referência do padrão HEVC. Como resultados esperados da execução deste projeto, além da contribuição no desenvolvimento algorítmico e arquitetural para a ME do padrão HEVC, pretende-se ampliar os laços de cooperação entre a UFPel e os pesquisadores da UFRGS. Pelo que será exposto no texto pretende-se demonstrar a relevância da execução deste projeto para o avanço científico e tecnológico nas áreas de concentração do projeto e também para a expansão e qualificação das competências brasileiras em áreas estratégicas, como o Sistema Brasileiro de TV Digital e a Microeletrônica..
Situação: Concluído; Natureza: Pesquisa.
2009 - 2013
Avaliação e Desenvolvimento de Algoritmos de Estimação de Movimento para a Compressão de Vídeo Digital
Descrição: A grande complexidade do processo de estimação fez com que diversos algoritmos rápidos fossem desenvolvidos. Os algoritmos rápidos possuem heurísticas que aceleram o processo de estimação. Estas heurísticas são facilmente implementadas em software, no entanto, seu desenvolvimento em hardware é mais complexo, principalmente devido às dependências de dados e do acesso irregular a memória de dados. A proposta deste trabalho é avaliar e desenvolver algoritmos rápidos de estimação de movimento. As avaliações dos algoritmos podem indicar quais são os melhores para operar com vídeos de alta resolução, e também quais podem ser desenvolvidos em hardware para aumentar o desempenho para aplicações de tempo real. Os algoritmos desenvolvidos devem possuir as vantagens obtidas pelos algoritmos rápidos convencionais, como alto desempenho e baixo custo computacional, no entanto, deve possuir características que facilitem a sua implementação em hardware. Este trabalho também tem como motivação o incentivo do governo federal para o desenvolvimento de tecnologias nacionais para a TV digital. Com isso esperamos contribuir para o desenvolvimento de tecnologia brasileira para a codificação de vídeo digital de alta resolução..
Situação: Concluído; Natureza: Pesquisa.
2009 - 2012
REDE H.264 SBTVD
Descrição: Rede H.264 SBTVD tem como objetivo o desenvolvimento de produtos de interesse nacional na área de codificação de sinais-fonte para o SBTVD (Sistema Brasileiro de TV Digital), sendo composta pelas seguintes entidades: UFRGS, LSITec, COPPE/UFRJ, IME, UFRN, UnB, UFSC, Unicamp e CEITEC. Os produtos que essa rede busca desenvolver são os seguintes: 1. Decodificador de sinais-fonte: desenvolvimento de um componente em linguagem de descição de hardware (HDL) implementado em dispositivo reconfigurável responsável pela decodificação de sinais-fonte para um dispositivo tipo Terminal de Acesso (set-top-box). O sistema a ser desenvolvido deve ser compatível com o padrão de vídeo H.264 de alta definição. O componente decodificador de vídeo H.264 deve permitir igualmente suporte a vídeos de definição padrão (720x480) e alta definição (1920x1080), conforme especificado no SBTVD. 2. Codificador H.264 com suporte a alta definição: desenvolvimento de componente em hardware reconfigurável capaz de efetuar o processo de codificação de sinais de vídeo em tempo real, atendendo à norma H.264. O projeto será desenvolvido sobre lógicas programáveis e testado em placas de desenvolvimento para validação dos algoritmos em tempo real. O dispositivo projetado deve permitir suporte a alta definição (1920x1080), conforme especificado no SBTVD. 3. Codificador H.264 em arquitetura computacional paralela: produto que implementa os algoritmos do padrão H.264 de forma paralela, através de distribuição em multi-tarefa ou em um agregado de máquinas (cluster). O objetivo é executar um codificador H.264 com suporte a alta definição, em tempo real. 4. Codificador/decodificador de áudio: produto de software para implementação decodificador de áudio executando em tempo real no Terminal de Acesso e codificador de áudio em software de acordo com o padrão do SBTVD. 5. Codificador H.264 escalável/alternativo: estudo dos algoritmos de escalabilidade no H.264 e de algoritmos alternativos de codificação de vídeo..
Situação: Concluído; Natureza: Pesquisa.
2004 - 2007
APISE - Desenvolvimento e Prototipação de Arquiteturas para Processamento e Imagens em Sistemas Embarcados

Projeto certificado pelo(a) coordenador(a) José Luís Almada Güntzel em 19/03/2015.
Descrição: O presente projeto tem como objeto de interesse o estudo, a especificação, o desenvolvimento e a prototipação de arquiteturas de hardware para o processamento digital de imagens e vídeo. Mais especificamente, pretende-se desenvolver arquiteturas para a compressão de imagens e vídeo e para o reconhecimento de padrões em imagens. Também pretende-se desenvolver ferramentas computacionais de apoio ao projeto físico destas arquiteturas. Para a compressão de imagens, o padrão JPEG 2000 será investigado e serão desenvolvidas arquiteturas para este padrão. Serão desenvolvidas arquiteturas para a transformada discreta de wavelet (DWT), para a quantização e para a codificação de entropia. Além disso, o padrão de compressão JPEG original [THE 92] também será tratado, com otimizações arquiteturais em trabalhos anteriores. Para a compressão de vídeo, serão investigados os padrões MPEG 4, e H.264. Serão desenvolvidas arquiteturas para o estimador de movimento, para o preditor intra-espacial, para a transformada discreta do cosseno (DCT) e para o Codificador de Palavra Variável Adaptativa ao Contexto (CAVLC) e o Codificador Aritmético Binário Adaptativo ao Contexto (CABAC). Serão desenvolvidas arquiteturas para o reconhecimento de padrões em imagens, baseadas em redes neurais artificiais, incluindo o desenvolvimento de operadores aritméticos (multiplicadores e somadores) integrados e de elevado desempenho. As arquiteturas para compressão de imagens e vídeo e para o reconhecimento de padrões serão implementadas, em um primeiro momento, em dispositivos reconfiguráveis do tipo FPGAs, por conta de sua grande flexibilidade de operação e facilidade para prototipação.Para a compressão de imagens, o padrão JPEG 2000 será investigado e serão desenvolvidas arquiteturas para este padrão. Serão desenvolvidas arquiteturas para a transformada discreta de wavelet (DWT), para a quantização e para a codificação de entropia. Além disso, o padrão de compressão JPEG original [THE 92] também será tratado..
Situação: Concluído; Natureza: Pesquisa.
2003 - 2007
SoCMicro - Sistemas em Chip: Metodologia de Projeto de Circuitos e Micro-Sistemas
Descrição: Este projeto foca o desafio de integração de sistemas de computação em chips. Esta área engloba uma multiplicidade de técnicas e conhecimentos de engenharia de computação e de engenharia elétrica, com vistas a utilizar a capacidade tecnológica da microeletrônica para soluções de hardware originais. As contribuições do projeto estão no desenvolvimento de métodos de projeto de circuitos mistos analógico-digitais, ferramentas computacionais para sistemas-em-chip (SoC) e no desenvolvimento de circuitos integrados CMOS para aplicações específicas. Fazem parte deste projeto a UFRGS, a UFPel e a UCPel. A coordenação é do Prof. Sergio Bampi (UFRGS). A UFPel está encarregada do desenvolvimento de ferramentas para a Análise de Timing e de Metodologias para o Processamento de Imagens. OBS: Projeto aprovado no contexto da Chamada Conjunta MCT/SEPIN - FINEP - CNPq 01/2002 (Programa de Apoio à Pesquisa, Desenvolvimento e Inovação em Tecnologia da Informação - PDI-TI) Processo CNPq 552121/2002-9 Vigência: janeiro/2003 a dezembro/2006 Benefícios: R$ 669.000,00. Recursos destinados à UFPel: R$ 150.000,00 (capital e custeio), uma bolsa DTI-7G e três bolsas de ITI.
Situação: Concluído; Natureza: Pesquisa.
2003 - 2005
SoC-Reuse: Desenvolvimento de Sistemas em Silício Baseados no Reuso de Blocos de Hardware
Descrição: Este projeto investigou o estado da arte das metodologias de reuso de hardware, focando na análise de timing de sistemas em chip (SoCs) baseados no reuso de blocos de hardware de diferentes fabricantes. Como estudo de caso para esta investigação, foram desenvolvidas arquiteturas e operadores direcionados para o processamento de imagens, tanto em nível RTL quanto em nível de leiaute. Os blocos de hardware desenvolvidos seguiram os padrões industriais de reusabilidade (OCP e/ou VCI). OBS: Projeto aprovado no contexto do Edital Universal 2003. Processo CNPq 478579/2003-9. Vigência: outubro/2003 a outubro/2005. Benefícios: R$ 20.000,00 (metade em capital e metde em custeio).
Situação: Concluído; Natureza: Pesquisa.


Projetos de desenvolvimento


2009 - 2011
SoC-SBTVD - Sistema em Chip para o Terminal de Acesso do SBTVD
Descrição: O objetivo deste projeto é a especificação, desenvolvimento e integração de um protótipo de um sistema em silício (SoC) para para terminais de acesso do padrão brasileiro de televisão digital. O SoC será descrito em HDL e validado através de síntese e implementação em componentes reconfiguráveis (FPGAs). O SoC deverá conter os componentes principais necessários à implementação de um receptor, incluindo um processador, um decodificador H.264, decodificador de áudio AAC e demultiplexador. Alguns módulos serão desenvolvidos pelo grupo enquanto outros serão adaptados de distribuições livres ou licenciados.
Situação: Concluído; Natureza: Desenvolvimento.
2008 - 2011
Desenvolvimento e Prototipação de Arquiteturas para Compressão de Vídeo para TV Digital
Descrição: Este projeto pretende investigar soluções em hardware para a compressão escalável de vídeos, seguindo o padrão H.264. O foco da investigação proposta neste projeto estará nos módulos das transformadas diretas e inversas, da quantização direta e inversa, da compensação de movimento com filtragem temporal, do filtro redutor de blocagem, da decimação 2-D, da interpolação 2-D e da estimação de movimento. Para avaliar a complexidade destes módulos do compressor, serão desenvolvidos modelos em software, de onde serão extraídas informações importantes para a definição e projeto do hardware que se seguirá. Após a avaliação em software, serão projetadas arquiteturas para os módulos. Estas arquiteturas serão descritas em VHDL, sintetizadas para FPGAs Xilinx, validadas e prototipadas. Como resultados esperados da execução deste projeto, além dos protótipos funcionais dos módulos anteriormente referenciados, espera-se a geração de dez artigos para eventos internacionais ou nacionais e dois artigos para periódicos. Como resultado mais amplo, pretende-se, com este projeto, estreitar os laços de cooperação entre os pesquisadores da UFPel, da FURG e do CEFET-RS, permitindo a geração de um pólo de desenvolvimento tecnológico em microeletrônica e TV digital nesta região do Rio Grande do Sul.
Situação: Concluído; Natureza: Desenvolvimento.


Revisor de periódico


2012 - Atual
Periódico: Multimedia Tools and Applications
2013 - Atual
Periódico: Signal, Image and Video Processing (Print)
2016 - Atual
Periódico: Journal of Computational Science
2017 - Atual
Periódico: SIGNAL PROCESSING-IMAGE COMMUNICATION
2018 - Atual
Periódico: IEEE TRANSACTIONS ON COMPUTERS
2018 - Atual
Periódico: IEEE Access
2018 - Atual
Periódico: IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY


Revisor de projeto de fomento


2015 - Atual
Agência de fomento: Fundação de Amparo à Ciência e Tecnologia do Estado de Pernambuco


Áreas de atuação


1.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação.
2.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Algoritmos e Arquiteturas para a Estimação de Movimento.
3.
Grande área: Ciências Exatas e da Terra / Área: Ciência da Computação / Subárea: Sistemas de Computação/Especialidade: Arquiteturas para Compressão de Imagens e Vídeo.


Idiomas


Português
Compreende Bem, Fala Bem, Lê Bem, Escreve Bem.
Inglês
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Bem.
Espanhol
Compreende Bem, Fala Razoavelmente, Lê Bem, Escreve Pouco.


Prêmios e títulos


2017
Best Paper Award, SBESC - VII Brazilian Symposium on Computing Systems Engineering., .
2015
Best Paper Award no SIM 2015, pelo artigo "A Hardware Architecture for an HEVC Motion Compensation Luminance Interpolator, 30º Simpósio Sul de Microeletrônica - UFSM.
2015
Best Paper Award no 28th Symposium on Integrated Circuits and Systems Design (SBCCI) pelo artigo "Memory-Aware and High-Throughput Hardware Design for the HEVC Fractional Motion Estimation", IEEE, ACM, SBC e SBMicro.
2015
Co-orientador do trabalho premiado com o terceiro lugar na área de Ciências Exatas e da Terra no XXIV Congresso de Iniciação Científica (aluno Guilherme Povala), Universidade Federal de Pelotas.
2014
Orientador do trabalho premiado com o Primeiro Lugar na área de Engenharias do Encontro de Pós-Graduação da UFPel (aluno Dieison Soares Silveira), Universidade Federal de Pelotas.
2013
Co-orientador do trabalho premiado com o primeiro lugar na área de Ciências Exatas e da Terra no XXII Congresso de Iniciação Científica (aluno José Cláudio de Souza Júnior), Universidade Federal de Pelotas.
2013
Orientador do trabalho premiado com o segundo lugar na área de Engenharias no XXII Congresso de Iniciação Científica (aluno Henrique do Amarilho Maich), Universidade Federal de Pelotas.
2012
Best Paper Award no SForum 2012, pelo artigo "NEW QUARTER RANDOM SEARCH MOTION ESTIMATION ALGORITHM: A GREAT QUALITY-COST TRADE-OFF", SBMicro - Sociedade Brasileira de MIcroeletrônica.
2011
Best Paper Award no SForum 2011, pelo artigo "A Fast Random Based Motion Estimation Search Algorithm", SBMicro - Sociedade Brasileira de MIcroeletrônica.
2011
Co-orientador do trabalho premiado com o terceiro lugar na área de ciências exatas e da terra na modalidade oral no XX Congresso de Iniciação Científica (aluno Marcel Moscarelli Corrêa), Universidade Federal de Pelotas.
2006
Altera Best Paper Award no SPL 2006, pelo artigo "Forward and Inverse 2-D DCT Architectures for H.264/AVC Video Compression Directed to HDTV", SPL 2006 - Southern Programmable Logic Conference.
2004
Prêmio Jovem Pesquisador - Primero lugar na área de engenharias para o trabalho apresentados no XIII CIC - Congresso de Iniciação Científica, Universidade Federal de Pelotas.


Produções



Produção bibliográfica
Artigos completos publicados em periódicos

1.
SILVEIRA, Dieison2018 SILVEIRA, Dieison ; ZATT, Bruno ; AGOSTINI, LUCIANO ; PORTO, MARCELO . Reference frame context-adaptive variable-length coder: a real-time hardware-friendly approach for lossless external memory bandwidth reduction in current video-coding systems. Journal of Real-Time Image Processing, v. 14, p. 249-265, 2018.

2.
AFONSO, VLADIMIR2018 AFONSO, VLADIMIR ; CONCEICAO, RUHAN A. ; SALDANHA, MARIO R. F. ; BRAATZ, LUCIANO A. ; PERLEBERG, MURILO R. ; CORREA, GUILHERME R. ; PORTO, MARCELO S. ; AGOSTINI, LUCIANO V. ; ZATT, Bruno ; SUSIN, ALTAMIRO A. . Energy-Aware Motion and Disparity Estimation System for 3D-HEVC with Run-Time Adaptive Memory Hierarchy. IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS FOR VIDEO TECHNOLOGY, v. 1, p. 1-1, 2018.

3.
ZATT, Bruno2018ZATT, Bruno ; PERLEBERG, MURILO ROSCHILDT ; SUSIN, Altamiro ; AFONSO, VLADIMIR ; PORTO, MARCELO ; CONCEIÇÃO, RUHAN ; AGOSTINI, LUCIANO . Energy and Rate-Aware Design for HEVC Motion Estimation Based on Pareto Efficiency. JICS. JOURNAL OF INTEGRATED CIRCUITS AND SYSTEMS (ED. PORTUGUÊS), v. 13, p. 1-12, 2018.

4.
PENNY, Wagner2018PENNY, Wagner ; GOEBEL, Jones ; PAIM, Guilherme ; PORTO, MARCELO ; AGOSTINI, LUCIANO ; ZATT, Bruno . High-throughput and power-efficient hardware design for a multiple video coding standard sample interpolator. Journal of Real-Time Image Processing, v. 1, p. 1-18, 2018.

5.
SALDANHA, Mário2017SALDANHA, Mário ; SANCHEZ, Gustavo ; ZATT, Bruno ; PORTO, MARCELO ; AGOSTINI, LUCIANO . Energy-aware scheme for the 3D-HEVC depth maps prediction. Journal of Real-Time Image Processing, v. 13, p. 55-69, 2017.

6.
AFONSO, VLADIMIR2016AFONSO, VLADIMIR ; MAICH, Henrique. ; AUDIBERT, Luan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; SUSIN, A . Hardware Implementation for the HEVC Fractional Motion Estimation Targeting Real-Time and Low-Energy. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 11, p. 106-120, 2016.

7.
SANCHEZ, Gustavo2015SANCHEZ, Gustavo ; SALDANHA, Mário ; BALOTA, Gabriel ; ZATT, Bruno ; PORTO, MARCELO ; AGOSTINI, LUCIANO . DMMFast: a complexity reduction scheme for three-dimensional high-efficiency video coding intraframe depth map coding. Journal of Electronic Imaging (Print), v. 24, p. 023011, 2015.

8.
SILVEIRA, Dieison2015 SILVEIRA, Dieison ; POVALA, GUILHERME ; AMARAL, LÍVIA ; ZATT, Bruno ; AGOSTINI, LUCIANO ; PORTO, MARCELO . Efficient reference frame compression scheme for video coding systems: algorithm and VLSI design. Journal of Real-Time Image Processing (Print), v. 1, p. 1-21, 2015.

9.
SANCHEZ, Gustavo2015SANCHEZ, Gustavo ; ZATT, Bruno ; PORTO, MARCELO ; AGOSTINI, LUCIANO . Hardware-friendly HEVC motion estimation: new algorithms and efficient VLSI designs targeting high definition videos. ANALOG INTEGRATED CIRCUITS AND SIGNAL PROCESSING (DORDRECHT. ONLINE), v. 82, p. 135-146, 2015.

10.
CONCEICAO, R.2014CONCEICAO, R. ; SOUZA JR., J. C. ; JESKE, R. G. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . Low-Cost and High-Throughput Hardware Design for the HEVC 16x16 2-D DCT Transform. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 9, p. 25-35, 2014.

11.
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.2013PORTO, Marcelo Schiavon; CRISTANI, Cássio ; DALL'OGLIO, Pargles ; Grellert, Mateus ; Mattos, Júlio ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Iterative Random Search: A New Local Minima Resistant Algorithm for Motion Estimation in High Definition Videos. Multimedia Tools and Applications, v. 63, p. 107-127, 2013.

12.
SANCHEZ, Gustavo2012SANCHEZ, Gustavo ; CORREA, M. ; NOBLE, D. ; PORTO, Marcelo Schiavon ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Hardware Design Focusing in the Tradeoff Cost versus Quality for the H.264/AVC Fractional Motion Estimation targeting High Definition Videos. Analog Integrated Circuits and Signal Processing, v. 73, p. 931-944, 2012.

13.
SANCHEZ, Gustavo2012SANCHEZ, Gustavo ; SAMPAIO, F. ; PORTO, Marcelo Schiavon ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . DMPDS: A FastMotion Estimation Algorithm Targeting High Resolution Videos and Its FPGA Implementation. International Journal of Reconfigurable Computing (Print), v. 2012, p. 12 páginas, 2012.

14.
SANCHEZ, G. F.2012SANCHEZ, G. F. ; PORTO, Marcelo Schiavon ; NOBLE, D. V. ; NOBLE, D. V. ; BAMPI, Sergio ; AGOSTINI, L. . New Motion Estimation Algorithms and its VLSI architectures for Real Time High Definition Video Coding. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 7, p. 37-46, 2012.

15.
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.2012PORTO, Marcelo Schiavon; Altermann, João ; COSTA, E. ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Power Efficient SDS Motion Estimation Architecture Using Dynamic Iteration Control and Hierarchical Adder Compressors for Real Time HDTV Video Coding. Analog Integrated Circuits and Signal Processing, v. 73, p. 919-930, 2012.

16.
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.2011PORTO, Marcelo Schiavon; NOBLE, Diego ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Two Fast Multi-Point Search Algorithms for High Quality Motion Estimation in High Resolution Videos. International Journal of Information Technology, Communications and Convergence (IJITCC), v. 1, p. 410-420, 2011.

17.
Cristani, C.2011Cristani, C. ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Galaxy Random Search: Algoritmo e Arquitetura para Estimação de Movimento em Vídeos de Alta Definição. Revista Eletrônica de Iniciação Científica, v. 11, p. 1-18, 2011.

18.
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.2010PORTO, Marcelo Schiavon; SILVA, André Marcelo Coelho da ; ALMEIDA, S. ; COSTA, E. ; BAMPI, Sergio . Motion Estimation Architecture Using Efficient Adder-Compressors for HDTV Video Coding. JICS. Journal of Integrated Circuits and Systems (Ed. Português), v. 5, p. 78-88, 2010.

19.
AGOSTINI, Luciano Volcan2007AGOSTINI, Luciano Volcan ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, José Luis Almada ; SILVA, Ivan Saraiva da ; BAMPI, Sergio . Forward and Inverse 2-D DCT architectures targeting HDTV for H.264/AVC video compression standard. Latin American Applied Research, v. 1, p. 1, 2007.

20.
ROSA, Leandro Zanetti Paiva da2007ROSA, Leandro Zanetti Paiva da ; PORTO, Marcelo Schiavon ; REDIESS, Fabiane ; PETRY, Rafael ; BAMPI, Sergio ; SUSIN, Altamiro ; AGOSTINI, Luciano Volcan . Avaliação Algorítmica para a Estimação de Movimento na Compressão de Vídeos Digitais. Hífen (PUCRS. Impresso), v. 1, p. 125, 2007.

21.
SILVA, Thaísa Leal da2005SILVA, Thaísa Leal da ; PORTO, Marcelo Schiavon ; ROSA, Leandro Zanetti Paiva da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luis Almada ; SILVA, Ivan Saraiva da ; BAMPI, Sergio ; AGOSINI, Luciano Volcan . Comparison between OCP, PVCI and BVCI Hardware Reuse Interfaces Designed in VHDL and Mapped to FPGAs. Hífen (Uruguaiana), v. 1, p. 61, 2005.

22.
PORTO, Marcelo Schiavon;PORTO, MARCELO;PORTO, M. S.;PORTO, M.;PORTO, MARCELO S.2005PORTO, Marcelo Schiavon; ROSA, Leandro Zanetti Paiva da ; SILVA, Thaísa Leal Sa ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luis Almada ; BAMPI, Sergio ; SILVA, Ivan Saraiva da ; AGOSTINI, Luciano Volcan . Arquiteturas de Cálculo da DCT 2-D para Codecs HDTV Seguindo o Padrão H.264/AVC. Hífen (Uruguaiana), v. 1, p. 69, 2005.

Capítulos de livros publicados
1.
SILVEIRA, Dieison ; POVALA, Guilherme. ; AMARAL, Lívia. ; ZATT, Bruno ; AGOSTINI, L. V. ; PORTO, Marcelo Schiavon . Arquitetura de hardware para um compressor de quadros de referência em codificadores de vídeos digitais. Arquitetura de hardware para um compressor de quadros de referência em codificadores de vídeos digitais. 1ed.Pelotas: Editora UFPel, 2016, v. 1, p. 129-145.

2.
SOUZA JR., J. C. ; CONCEICAO, Ruhan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . ARQUITETURAS DE HARDWARE DEDICADAS PARA AS TRANSFORMADAS DISCRETAS DOS COSSENOS DO PADRÃO HEVC. ARQUITETURAS DE HARDWARE DEDICADAS PARA AS TRANSFORMADAS DISCRETAS DOS COSSENOS DO PADRÃO HEVC. 1ed.Pelotas: Editora UFPel, 2016, v. 1, p. 167-180.

3.
PORTO, Marcelo Schiavon; PORTO, Roger Endrigo Carvalho ; DORNELLES, Robson ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Investigação e Desenvolvimento de Algoritmosos e Arquiteturas para a Estimação de Movimento em Vídeos Digitais. In: Mattos, Júlio C. B.; Rosa Jr, Leomar S.; Pilla, Maurício L.. (Org.). Desafios e Avanços em Computação: Inovações e Tecnologia. 1ed.Pelotas: Editora e Gráfica Universitária - PREC - UFPel, 2009, v. 2, p. 55-117.

Trabalhos completos publicados em anais de congressos
1.
RAMOS, FABIO LUIS LIVI ; ZATT, Bruno ; PORTO, MARCELO ; BAMPI, Sergio . High-Throughput Binary Arithmetic Encoder using Multiple-Bypass Bins Processing for HEVC CABAC. In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018, Florence. 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018. p. 1.

2.
MARTINS, Anderson ; PENNY, Wagner ; WEBER, MATHEUS ; AGOSTINI, LUCIANO ; PORTO, MARCELO ; PALOMINO, Daniel ; MATTOS, JULIO ; ZATT, Bruno . Configurable Cache Memory Architecture for Low-Energy Motion Estimation. In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018, Florence. 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018. p. 1.

3.
BRAATZ, LUCIANO ; ZATT, Bruno ; PALOMINO, Daniel ; AGOSTINI, LUCIANO ; PORTO, MARCELO . High-Throughput and Low-Power Integrated Direct/Inverse HEVC Quantization Hardware Design. In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018, Florence. 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018. p. 1.

4.
AFONSO, VLADIMIR ; SUSIN, Altamiro ; PERLEBERG, MURILO ; CONCEICAO, Ruhan ; CORREA, Guilherme ; AGOSTINI, LUCIANO ; ZATT, Bruno ; PORTO, MARCELO . Hardware-Friendly Unidirectional Disparity-Search Algorithm for 3D-HEVC. In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018, Florence. 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018. p. 1.

5.
PERLEBERG, MURILO ; GOEBEL, Jones ; MELO, Mateus ; AFONSO, Vladimir. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, MARCELO . ASIC Power-Estimation Accuracy Evaluation: A Case Study using Video-Coding Architectures. In: IEEE 9th Latin American Symposium on Circuits & Systems (LASCAS), 2018, Puerto Vallarta. IEEE 9th Latin American Symposium on Circuits & Systems, 2018. v. 1. p. 1-4.

6.
GONCALVES, Paulo ; PORTO, MARCELO ; ZATT, Bruno ; AGOSTINI, L. V. ; CORREA, Guilherme . Octagonal-Axis Raster Pattern for Improved Test Zone Search Motion Estimation. In: IEEE International Conference on Acoustics, Speech and Signal Processing (ICASSP), 2018, Calgary. IEEE International Conference on Acoustics, Speech and Signal Processing, 2018. v. 1. p. 1-4.

7.
CONCEICAO, Ruhan ; PORTO, MARCELO ; ZATT, Bruno ; AGOSTINI, LUCIANO . LF-CAE: Context-Adaptive Encoding for Lenslet Light Fields Using HEVC. In: 2018 25th IEEE International Conference on Image Processing (ICIP), 2018, Athens. 2018 25th IEEE International Conference on Image Processing (ICIP), 2018. p. 3174.

8.
UKER, M. ; AFONSO, Vladimir. ; AUDIBERT, Luan ; SUSIN, Altamiro ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . Low-Power and High-Throughput Architecture for 3D-HEVC Depth Modeling Mode 4. In: 31st Symposium on Integrated Circuits and Systems Design (SBCCI), 2018, Bento Gonçalves. 30th Symposium on Integrated Circuits and Systems Design, 2018. v. 1. p. 1-6.

9.
PERLEBERG, M. ; AFONSO, Vladimir. ; SUSIN, Altamiro ; CONCEICAO, R. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . A Power-Efficient and High-Throughput Hardware Design for 3D-HEVC Disparity Estimation. In: 31st Symposium on Integrated Circuits and Systems Design (SBCCI), 2018, Bento Gonçalves. 31st Symposium on Integrated Circuits and Systems Design, 2018. v. 1. p. 1-6.

10.
BRAATZ, L. ; PALOMINO, Daniel ; ZATT, Bruno ; AGOSTINI, L. V. ; PORTO, Marcelo Schiavon . Low-Power HEVC 1-D IDCT Hardware Architecture. In: 31st Symposium on Integrated Circuits and Systems Design (SBCCI), 2018, Bento Gonçalves. 31st Symposium on Integrated Circuits and Systems Design, 2018. v. 1. p. 1-6.

11.
PALAU, R. ; GOEBEL, Jones ; CORREA, Guilherme ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . A Low-Power 8K@60fps HEVC Deblocking Filter Architecture. In: 8th Workshop on Circuits and Systems Design (WCAS), 2018, Bento Gonçalves. 8th Workshop on Circuits and Systems Design, 2018. v. 1. p. 1-4.

12.
GOEBEL, Jones ; AGOSTINI, L. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . High Throughput Architecture For VP9 Fractional Motion Estimation. In: 31st Symposium on Integrated Circuits and Systems Design (SBCCI), 2018, Bento Gonçalves. 31st Symposium on Integrated Circuits and Systems Design, 2018. v. 1. p. 1-6.

13.
AFONSO, Vladimir. ; SUSIN, A ; AUDIBERT, Luan ; SALDANHA, Mário ; CONCEICAO, R. ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . Low-Power and High-Throughput Hardware Design for the 3D-HEVC Depth Intra Skip. In: IEEE International Symposium on Circuits and Systems, 2017, Baltimore. IEEE International Symposium on Circuits and Systems (ISCAS), 2017. v. 1. p. 1-4.

14.
CORREA, M. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . High-Throughput HEVC Intrapicture Prediction Hardware Design Targeting UHD 8K Videos. In: IEEE International Symposium on Circuits and Systems, 2017, Baltimore. IEEE Iinternational Symposium on Circuits and Systems (ISCAS), 2017. v. 1. p. 1-4.

15.
BRAATZ, L. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . A Multiplierless Parallel HEVC Quantization Hardware for Real-Time UHD 8K Video Coding. In: IEEE International Symposium on Circuits and Systems, 2017, Baltimore. IEEE International Symposium on Circuits and Systems (ISCAS), 2017. v. 1. p. 1-4.

16.
MACHADO, Ítalo ; PENNY, Wagner ; AGOSTINI, L. V. ; PORTO, Marcelo Schiavon ; ZATT, Bruno . Characterizing Energy Consumption in Software HEVC Encoders: HM vs x265. In: IEEE Latin American Symposium on Circuits & Systems, 2017, Bariloche. IEEE Latin American Symposium on Circuits & Systems (LASCAS), 2017. v. 1. p. 1-4.

17.
ALONSO, C. ; RAMOS, F. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; BAMPI, Sergio . Low-power HEVC Binarizer Architecture for the CABAC Block targeting UHD Video Processing. In: 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017, Fortaleza. 30th Symposium on Integrated Circuits and Systems Design, 2017. v. 1. p. 1-6.

18.
BONATTO, L. ; RAMOS, F. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; BAMPI, Sergio . Low-power Multi-Size HEVC DCT Architecture Proposal for QFHD Video Processing. In: 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017, Fortaleza. 30th Symposium on Integrated Circuits and Systems Design, 2017. v. 1. p. 1-6.

19.
RAMOS, F. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; BAMPI, Sergio . Novel Multiple Bypass Bins Scheme for Low-power UHD Video Processing HEVC Binary Arithmetic Encoder Architecture. In: 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017, Fortaleza. 30th Symposium on Integrated Circuits and Systems Design, 2017. v. 1. p. 1-6.

20.
AVILA, Giovanni. ; CONCEICAO, R. ; BUBOLZ, T. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; CORREA, Guilherme . Complexity Reduction of 3D-HEVC Based on Depth Analysis for Background and ROI Classification. In: 25th European Signal Processing Conference (EUSIPCO), 2017, Kos. 25th European Signal Processing Conference. Piscataway: IEEE: Piscataway: IEEE, 2017. v. 1. p. 1066-1070.

21.
BORGES, Alex ; BRAATZ, L. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; CORREA, Guilherme . Segmented Spline Hardware Design for High Dynamic Range Video Pre-Processor. In: 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017, Fortaleza. 30th Symposium on Integrated Circuits and Systems Design, 2017. v. 1. p. 1-6.

22.
Gustavo, SANCHEZ ; SALDANHA, Mário ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; MARCON, C. . Edge-Aware Depth Motion Estimation - A Complexity Reduction Scheme for 3D-HEVC. In: 25th European Signal Processing Conference (EUSIPCO), 2017, Kos. 25th European Signal Processing Conference. Piscataway: IEEE: Piscataway: IEEE, 2017. v. 1. p. 1569-1573.

23.
SILVEIRA, Dieison ; PORTO, Marcelo Schiavon ; BAMPI, Sergio . Performance and Energy Consumption Analysis of the X265 Video Encoder. In: 25th European Signal Processing Conference (EUSIPCO), 2017, Kos. 25th European Signal Processing Conference. Piscataway: IEEE: Piscataway: IEEE, 2017. v. 1. p. 1-4.

24.
GONCALVES, Paulo ; CORREA, Guilherme ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . Multiple Early-Termination Scheme for TZSearch Algorithm based on Data Mining and Decision Trees. In: IEEE 19th International Workshop on Multimedia Signal Processing (MMSP), 2017, Luton. 19th International Workshop on Multimedia Signal Processing, 2017. v. 1. p. 1-6.

25.
PORTO, Roger Endrigo Carvalho ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; ROMA, Nuno ; SOUZA, Leonel . Energy-Efficient Variable Block Size Motion Estimation Design with Approximate Arithmetic Operators. In: IEEE 19th International Workshop on Multimedia Signal Processing (MMSP), 2017, Luton. 19th International Workshop on Multimedia Signal Processing, 2017. v. 1. p. 1-6.

26.
MARTINS, Anderson ; PENNY, Wagner ; WEBER, M. ; PALOMINO, Daniel ; Mattos, Júlio ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; ZATT, Bruno . Cache Memory Energy Efficiency Exploration for the HEVC Motion Estimation. In: VII Brazilian Symposium on Computing Systems Engineering (SBESC), 2017, Curitiba. VII Brazilian Symposium on Computing Systems Engineering, 2017. v. 1. p. 1-8.

27.
MELO, Mateus ; GOEBEL, Jones ; FARIAS, DANIEL ; SANTOS, CRISTIANO ; TAVARES, TATIANA ; CORRÊA, GUILHERME ; ZATT, Bruno ; PORTO, MARCELO . Objective and Subjective Video Quality Assessment in Mobile Devices for Low-Complexity H.264/AVC Codecs. In: the 23rd Brazillian Symposium, 2017, Gramado. Proceedings of the 23rd Brazillian Symposium on Multimedia and the Web - WebMedia '17, 2017. p. 429-433.

28.
BUBOLZ, THIAGO ; CONCEIÇÃO, RUHAN ; ALMEIDA, HEITOR ; MOREIRA, ÉRICK ; ZATT, Bruno ; TAVARES, TATIANA ; PORTO, MARCELO ; CORRÊA, GUILHERME . Video Quality Assessment of Early SKIP/DIS for 3D-HEVC Complexity Reduction. In: the 23rd Brazillian Symposium, 2017, Gramado. Proceedings of the 23rd Brazillian Symposium on Multimedia and the Web - WebMedia '17, 2017. p. 73-79.

29.
SANTOS, CRISTIANO ; CONCEIÇÃO, RUHAN ; AGOSTINI, LUCIANO ; CORRÊA, GUILHERME ; ZATT, Bruno ; PORTO, MARCELO . Rate and Complexity-Aware Coding Scheme for Fixed-Camera Videos Based on Region-of-Interest Detection. In: the 23rd Brazillian Symposium, 2017, Gramado. Proceedings of the 23rd Brazillian Symposium on Multimedia and the Web - WebMedia '17, 2017. p. 409.

30.
SALDANHA, MARIO ; ZATT, Bruno ; PORTO, MARCELO ; AGOSTINI, LUCIANO ; SANCHEZ, Gustavo . Solutions for DMM-1 complexity reduction in 3D-HEVC based on gradient calculation. In: 2016 IEEE 7th Latin American Symposium on Circuits & Systems (LASCAS), 2016, Florianopolis. 2016 IEEE 7th Latin American Symposium on Circuits & Systems (LASCAS). v. 1. p. 211-214.

31.
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PORTO, Marcelo Schiavon; GÜNTZEL, José Luís Almada ; SARAIVA, Ivan ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Investigação de algorítmos e proposta arquitetural para a estimação de movimento direcionada à vídeos de alta resolução. In: XII Workshop Iberchip, 2006, San José. XII Iberchip, 2006. p. 61-64.

103.
AGOSINI, Luciano Volcan ; PORTO, Marcelo Schiavon ; GÜNTZEL, José Luis Almada ; PORTO, Roger Endrigo Carvalho ; BAMPI, Sergio . High Throughput FPGA Based Architecture for H.264/AVC Inverse Transforms and Quantization. In: 49th IEEE International Midwest Symposium on Circuits and Systems, 2006, San Juan. 49th IEEE International Midwest Symposium on Circuits and Systems. Piscataway: IEEE, 2006. v. 1. p. 281-285.

104.
SILVA, André Marcelo Coelho da ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; GÜNTZEL, José Luis Almada ; BAMPI, Sergio ; SARAIVA, Ivan ; AGOSTINI, Luciano Volcan . Design Space Exploration on the H.264 4x4 Hadamard Transform. In: SIM2006 - XXI South Symposium on Microeletronics, 2006, Porto Alegre. SIM2006 - XXI South Symposium on Microeletronics, 2006. p. 125-128.

105.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; GÜNTZEL, José Luis Almada ; SARAIVA, Ivan ; AGOSTINI, Lucinao Volcan ; BAMPI, Sergio . FPGA Prototype of a H.264/AVC Inverse Transform and Quantization Architecture for HDTV. In: SIM2006 - XXI South Symposium on Microeletronics, 2006, Porto Alegre. SIM2006 - XXI South Symposium on Microeletronics, 2006. p. 19-24.

106.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Investigação de Algoritmos e Desenvolvimento Arquitetural para a Estimação de Movimento em Compressão de Vídeo Digital. In: CLEI 2006 - XXXII Conferencia Latinoamericana de Informática, 2006, Santiago do Chile. CLEI 2006 - XXXII Conferencia Latinoamericana de Informática, 2006.

107.
PORTO, Marcelo Schiavon; SILVA, André Marcelo Coelho da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luís Almada ; AGOSTINI, Luciano Volcan . Impactos so Uso de Diferentes Arquiteturas de Somadores em FPGAs Altera. In: XI Workshop Iberchip, 2005, Salvador. XI Workshop Iberchip, 2005.

108.
PORTO, Marcelo Schiavon; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luís Almada ; AGOSTINI, Luciano Volcan . Projeto, Síntese e Simulaçao das Interfaces de Reuso do Padrão OCP (Open Core Protocol). In: XI Workshop Iberchip, 2005, Salvador. XI Workshop Iberchip, 2005.

109.
PORTO, Marcelo Schiavon; SILVA, Thaísa Leal da ; PORTO, Roger Endrigo Carvalho ; AGOSTINI, Luciano Volcan . Design Space Exploration on the H.264 4x4 Hadamard Transform. In: IEEE XXIII NORCHIP CONFERENCE, 2005, Oulu. IEEE XXIII NORCHIP CONFERENCE, 2005.

Resumos expandidos publicados em anais de congressos
1.
MORAES, C. ; GONCALVES, Paulo ; PORTO, Marcelo Schiavon ; CORRÊA, GUILHERME . Low-Complexity TZS Algorithm for Embedded Video Encoders. In: 18th Microelectronics Students Forum (SForum), 2018, Bento Gonçalves. 18th Microelectronics Students Forum, 2018. v. 1. p. 1-4.

2.
LEME, M. ; BRAATZ, L. ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. . Approximate 4x41D-DCT Hardware Architecture Using Imprecise LOA Adder. In: 18th Microelectronics Students Forum (SForum), 2018, Bento Gonçalves. 18th Microelectronics Students Forum, 2018. v. 1. p. 1-4.

3.
BARTH, João ; AUDIBERT, Luan ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; ZATT, Bruno . Hash Indexes Hardware Architechture for the Hash Based Intra Block Copy. In: South Symposium on Microelectronics, 2016, Porto Alegre. South Symposium on Microelectronics, 2016. v. 1. p. 1-4.

4.
GOEBEL, Jones ; PAIM, Guilherme ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . A Modular DCT Architecture for the HEVC Supporting Multiple Block Sizes. In: South Symposium on Microelectronics, 2016, Porto Alegre. South Symposium on Microelectronics, 2016. v. 1. p. 1-4.

5.
MELO, Mateus ; SAMNIOTTO, Gustavo. ; SOARES, Rafael ; PORTO, Marcelo Schiavon . A Parallel Hardware Architecture for SAD Calculation on Motion Estimation. In: South Symposium on Microelectronics, 2016, Porto Alegre. South Symposium on Microelectronics, 2016. v. 1. p. 1-4.

6.
BORGES, Alex ; BARTH, João ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . Hardware Architecture Proposal for the High Dynamic Range Video Pre-Processing. In: South Symposium on Microelectronic, 2015, Santa Maria. South Symposium on Microelectronic, 2015. v. 1. p. 1-4.

7.
MELO, Mateus ; MAICH, Henrique. ; AGOSTINI, Luciano Volcan ; ZATT, Bruno ; PORTO, Marcelo Schiavon . Evaluation of GPU Memory Organization for Motion Estimation Algorithms Using OpenCL. In: South Symposium on Microelectronic, 2015, Santa Maria. South Symposium on Microelectronic, 2015. v. 1. p. 1-4.

8.
PENNY, Wagner ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; ZATT, Bruno . A Hardware Architecture for an HEVC Motion Compensation Luminance Interpolator. In: South Symposium on Microelectronic, 2015, Santa Maria. South Symposium on Microelectronic, 2015. v. 1. p. 1-4.

9.
BALOTA, Gabriel ; SALDANHA, Mário ; Gustavo, SANCHEZ ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Evaluation of 3D-High Efficiency Video Coding Standard. In: 29th South Symposium on Microelectronic, 2014, Alegrete. 29th South Symposium on Microelectronic, 2014. v. 1. p. 1-4.

10.
GOEBEL, Jones ; CAMPOS, Ândrio ; SOUZA, J. CLAUDIO ; CONCEICAO, Ruhan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . HEVC Discrete Cosine Transform Hardware Design Targeting QFHD video. In: 29th South Symposium on Microelectronic, 2014, Alegrete. 29th South Symposium on Microelectronic, 2014. v. 1. p. 1-4.

11.
AUDIBERT, Luan ; MAICH, Henrique. ; AFONSO, Vladimir. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . Hardware Design of Interpolation Filters for the High Efficiency Video Coding. In: 29th South Symposium on Microelectronic, 2014, Alegrete. 29th South Symposium on Microelectronic, 2014. v. 1. p. 1-4.

12.
NOREMBERG, Mateus ; PEGLOW, Guilherme ; Cristani, C. ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, Luciano Volcan . Skip Block SAD Computing Architecture Design Focusing on HEVC Quad-tree Reuse. In: 29th South Symposium on Microelectronic, 2014, Alegrete. 29th South Symposium on Microelectronic, 2014. v. 1. p. 1-4.

13.
MAICH, Henrique. ; AFONSO, Vladimir. ; FRANCO, D. ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . A Hardware Solution for the HEVC Fractional Motion Estimation Interpolation. In: 28th South Symposium on Microelectronic, 2013, Porto Alegre. 28th South Symposium on Microelectronic, 2013. v. 1. p. 1-4.

14.
POVALA, Guilherme. ; AMARAL, Lívia. ; SILVEIRA, Dieison ; Mattos, Júlio ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . A VLSI Architecture for Reference Frame Compression on High Definition Video Coding Systems. In: 28th South Symposium on Microelectronic, 2013, Porto Alegre. 28th South Symposium on Microelectronic, 2013. v. 1. p. 1-4.

15.
SALDANHA, Mário ; BALOTA, Gabriel ; Gustavo, SANCHEZ ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . Hardware-Friendly Motion Estimation Algorithms and its Architectures for High Definition Videos. In: 28th South Symposium on Microelectronic, 2013, Porto Alegre. 28th South Symposium on Microelectronic, 2013. v. 1. p. 1-4.

16.
WREGE, Gustavo ; CONCEICAO, Ruhan ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Hardware Architecture for Motion Estimation on Chrominance Samples. In: 28th South Symposium on Microelectronic, 2013, Porto Alegre. 28th South Symposium on Microelectronic, 2013. v. 1. p. 1-4.

17.
JUNES, Victor ; DALL'OGLIO, Pargles ; REDIESS, Fabiane ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . An architecture for the new Adaptive Loop Filter of the High Efficiency Video Coding. In: 28th South Symposium on Microelectronic, 2013, Porto Alegre. 28th South Symposium on Microelectronic, 2013. v. 1. p. 1-4.

18.
DALL'OGLIO, Pargles ; CRISTANI, Cássio ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . A New Motion Estimation Algorithm for High Definition Videos and its Hardware Design. In: 27th South Symposium on Microelectronics - SIM, 2012, São Miguel das Missões. 27th South Symposium on Microelectronics, 2012. p. 1-4.

19.
CRISTANI, Cássio ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . A New Motion Estimation Algorithm of Low Computational Cost and Focusing on Full HD Videos. In: 27th South Symposium on Microelectronics - SIM, 2012, São Miguel das Missões. 27th South Symposium on Microelectronics, 2012. p. 1-4.

20.
SANCHEZ, Gustavo ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Algorithm and VLSI Design for a High Quality Motion Estimation Focused on High Definition Videos. In: 27th South Symposium on Microelectronics - SIM, 2012, São Miguel das Missões. 27th South Symposium on Microelectronics, 2012. p. 1-4.

21.
REDIESS, Fabiane ; CRISTANI, Cássio ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Architectural Design for the Adaptive Loop Filter of the Emerging High Efficiency Video Coding Standard. In: 27th South Symposium on Microelectronics - SIM, 2012, São Miguel das Missões. 27th South Symposium on Microelectronics, 2012. p. 1-4.

22.
SANCHEZ, Gustavo ; NOBLE, Diego ; PORTO, Marcelo Schiavon ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . A Real Time HDTV Motion Estimation Architecture for the New MPDS Algorithm. In: 26th South Symposium on Microelectronics - SIM, 2011, Novo Hamburgo. 26th South Symposium on Microelectronics, 2011. v. 1. p. 49-52.

23.
Cristani, C. ; SANCHEZ, Gustavo ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Hardware Design for the New Galaxy Random Search Motion Estimation Algorithm Focusing in HD Videos. In: 1st Workshop on Circuits and Systems (WCAS), 2011, João Pessoa. 1st Workshop on Circuits and Systems (WCAS), 2011.

24.
Cristani, C. ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Random Search Motion Estimation Algorithm for High Definition Videos. In: 26th South Symposium on Microelectronics - SIM, 2011, Novo Hamburgo. 26th South Symposium on Microelectronics - SIM, 2011. v. 1.

25.
NOBLE, Diego ; PORTO, Marcelo Schiavon ; SIEDLER, Gabriel ; AGOSTINI, Luciano Volcan . A New Parallel Motion Estimation Algorithm. In: 25th South Symposium on Microelectronics - SIM, 2010, Porto Alegre. 25th South Symposium on Microelectronics - SIM, 2010. v. 1. p. 53-56.

26.
PORTO, Marcelo Schiavon; Altermann, João ; COSTA, E. ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Power Efficient Motion Estimation Architecture Using QSDS Algorithm with Dynamic Iteration Control. In: 25th South Symposium on Microelectronics - SIM, 2010, Porto Alegre. 25th South Symposium on Microelectronics - SIM, 2010. v. 1. p. 41-44.

27.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . A Hardware Architecture for the New SDS-DIC Motion Estimation Algorithm. In: 24th South Symposium on Microelectronics - SIM, 2009, Pelotas. 24th South Symposium on Microelectronics - SIM, 2009. v. 1. p. 259-262.

28.
ROSA, Leandro Zanetti Paiva da ; Matos, Débora ; PORTO, Marcelo Schiavon ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . SDS-DIC Architecture with Multiple Reference Frames for HDTV Motion Estimation. In: 24th South Symposium on Microelectronics - SIM, 2009, Pelotas. 24th South Symposium on Microelectronics - SIM, 2009. v. 1. p. 263-266.

29.
PORTO, Marcelo Schiavon; PORTO, Roger Endrigo Carvalho ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . A Fully Parallel Architecture for the Forward Transforms Block of the H.264/AVC Standard. In: XXII Simpósio Sul de Microeletrônica, 2007, Porto Alegre. XXII Simpósio Sul de Microeletrônica, 2007. v. 1. p. 135-138.

30.
ROSA, Leandro Zanetti Paiva da ; PETRY, Rafael ; REDIESS, Fabiane ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; BAMPI, Sergio . Motion Estimation Algorithms Evaluation. In: XXII Simpósio Sul de Microeletrônica, 2007, Porto Alegre. XXII Simpósio Sul de Microeletrônica, 2007.

31.
PORTO, Marcelo Schiavon; GÜNTZEL, José Luis Almada ; BAMPI, Sergio ; SILVA, Ivan Saraiva da ; AGOSTINI, Luciano Volcan . A Hardware Architecture for Motion Estimation Using Pel Decimation 4:1 and SAD. In: SIM2006 - XXI South Symposium on Microeletronics, 2006, Porto Alegre. XXI South Symposium on Microeletronics, 2006. p. 69-72.

32.
PORTO, Marcelo Schiavon; SILVA, André Marcelo Coelho da ; GÜNTZEL, José Luís Almada ; AGOSTINI, Luciano Volcan . Impacts of Different Adder Architectures in Designs Directed to FPGAs. In: XX Simpósio Sul de Microeletrônica, 2005, Santa Cruz do Sul. XX SIM, 2005.

33.
PORTO, Marcelo Schiavon; ROSA, Leandro Zanetti Paiva da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luís Almada ; AGOSTINI, Luciano Volcan . Design, Synthesis and Simulation of OCP (Open Core Protocol) Hardware Reuse Interface. In: XX Simpósio Sul de Microeletrônica, 2005, Santa Cruz do Sul. XX SIM, 2005.

34.
PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; ROSA, Leandro Zanetti Paiva da ; GÜNTZEL, José Luís Almada ; AGOSTINI, Luciano Volcan . An Integer 2-D DCT Architecture for the H.264/AVC Video Coding Standard. In: XX Simpósio Sul de Microeletrônica, 2005, Santa Cruz do Sul. XX SIM, 2005.

35.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan . Experiments With OCP (Open Core Protocol) Hardware Reuse Interface. In: XIX Simpósio Sul de Microeletrônica, 2004. XIX SIM, 2004.

36.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan . Estudo Sobre o Padrão de reuso de Hardware OCP (Open Core Protocol). In: XII Congresso de Iniciação Científica da UFPel, 2003, Pelotas. XII CIC, 2003.

Resumos publicados em anais de congressos
1.
CONCEICAO, M. ; ZATT, Bruno ; AGUIAR, M. ; PORTO, Marcelo Schiavon . PROTÓTIPO DE HARDWARE PARA UM SISTEMA PARA CONTAGEM DE SPOTS EM IMAGENS DE ELETROFORESE BIDIMENSIONAL. In: XXV Congresso de Iniciação Científica da UFPel, 2016, Pelotas. XXV Congresso de Iniciação Científica da UFPel (CIC), 2016. v. 1. p. 1-4.

2.
GOEBEL, Jones ; CONCEICAO, R. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . PROJETO DE HARDWARE LOW-POWER PARA IDCT DO PADRÃO HEVC. In: XXV Congresso de Iniciação Científica da UFPel (CIC), 2016, Pelotas. XXV Congresso de Iniciação Científica da UFPel, 2016. v. 1. p. 1-4.

3.
MELO, Mateus ; SAMNIOTTO, Gustavo. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . ARQUITETURA PARA A ESTIMAÇÃO DE MOVIMENTO EM MÚLTIPLOS TAMANHOS DE BLOCOS A PARTIR DO CÁLCULO DE SADs PARCIAIS. In: XXV Congresso de Iniciação Científica da UFPel (CIC), 2016, Pelotas. XXV Congresso de Iniciação Científica da UFPel, 2016. v. 1. p. 1-4.

4.
AUDIBERT, Luan ; AFONSO, Vladimir. ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . Arquitetura de Hardware com Elevada Taxa de Processamento para o Modo Planar de Codificação de Vídeos do Padrão HEVC. In: XXV Congresso de Iniciação Científica da UFPel (CIC), 2016, Pelotas. XXV Congresso de Iniciação Científica da UFPel, 2016. v. 1. p. 1-4.

5.
MAICH, Henrique. ; MELO, Mateus ; GOEBEL, Jones ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . Uma Estratégia para Redução do Tempo de Codificação de Vídeos no Padrão HEVC. In: XXIV Congresso de Iniciação Científica da UFPel (CIC), 2015, Pelotas. XXIV Congresso de Iniciação Científica da UFPel, 2015. v. 1. p. 1-4.

6.
BORGES, Alex ; BARTH, João ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . OTIMIZAÇÕES PARA ETAPA DE PRÉ-PROCESSAMENTO NA CODIFICAÇÃO DE VÍDEOS HDR NO PADRÃO HEVC. In: XXIV Congresso de Iniciação Científica da UFPel (CIC), 2015, Pelotas. XXIV Congresso de Iniciação Científica da UFPel, 2015. v. 1. p. 1-4.

7.
MELO, Mateus ; MAICH, Henrique. ; AGOSTINI, L. V. ; ZATT, Bruno ; PORTO, Marcelo Schiavon . AVALIAÇÃO DA HIERARQUIA DE MEMÓRIA EM GPU PARA ALGORITMOS DE ESTIMAÇÃO DE MOVIMENTO UTILIZANDO OPENCL. In: XXIV Congresso de Iniciação Cientifica da UFPel (CIC), 2015, Pelotas. XXIV Congresso de Iniciação Cientifica da UFPel, 2015. v. 1. p. 1-4.

8.
BARTH, João ; BORGES, Alex ; ZATT, Bruno ; AGOSTINI, L. V. ; PORTO, Marcelo Schiavon . PROJETO DE HARDWARE PARA A ETAPA DE PRÉ-PROCESSAMENTO NA CODIFICAÇÃO DE VÍDEOS HDR NO PADRÃO HEVC. In: XXIV Congresso de Iniciação Científica da UFPel (CIC), 2015, Pelotas. XXIV Congresso de Iniciação Científica da UFPel, 2015. v. 1. p. 1-4.

9.
POVALA, Guilherme. ; AMARAL, Lívia. ; SILVEIRA, Dieison ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . COMPRESSOR DE QUADROS DE REFERÊNCIA DE ALTA EFICIÊNCIA PARA CODIFICADORES DE VÍDEO DE ALTA DEFINIÇÃO. In: XXIV Congresso de Iniciação Científica da UFPel (CIC), 2015, Pelotas. XXIV Congresso de Iniciação Científica da UFPel, 2015. v. 1. p. 1-4.

10.
CORREA, M. ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . ARQUITETURA DE BAIXO CUSTO EM ÁREA PARA A PREDIÇÃO INTRAQUADRO MULTIPADRÃO H.264/AVC E HEVC COM FOCO EM VÍDEOS DE ALTA RESOLUÇÃO. In: XVII Encontro de Pós-Graduação da UFPel (ENPOS), 2015, Pelotas. XVII Encontro de Pós-Graduação da UFPel, 2015. v. 1. p. 1-4.

11.
CONCEICAO, R. ; CORREA, Guilherme ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, L. V. . AVALIAÇÃO DA DECISÃO DE MODO DO CODIFICADOR DE VÍDEO 3D-HEVC. In: XVII Encontro de Pós-Graduação da UFPel (ENPOS), 2015, Pelotas. XVII Encontro de Pós-Graduação da UFPel, 2015. v. 1. p. 1-4.

12.
PENNY, Wagner ; MACHADO, Ítalo ; PORTO, Marcelo Schiavon ; AGOSTINI, L. V. ; ZATT, Bruno . AVALIAÇÃO DO CONSUMO ENERGÉTICO DO CODIFICADOR HEVC ATRAVÉS DA VARIAÇÃO DE PARÂMETROS DE CODIFICAÇÃO. In: XVII Encontro de Pós-Graduação da UFPel (ENPOS), 2015, Pelotas. XVII Encontro de Pós-Graduação da UFPel, 2015. v. 1. p. 1-4.

13.
SILVEIRA, Dieison ; POVALA, Guilherme. ; AMARAL, Lívia. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . ARQUITETURA VLSI DE BAIXA POTÊNCIA PARA UM COMPRESSOR DE QUADROS DE REFERÊNCIA. In: XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014, Pelotas. XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014. v. 1. p. 1-4.

14.
SANCHEZ, G. F. ; BALOTA, Gabriel ; SALDANHA, Mário ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . AVALIAÇÃO DO ALGORITMO SIMPLIFIED EDGE DETECTOR NO SOFTWARE DE REFERÊNCIA DO PADRÃO 3D-HEVC. In: XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014, Pelotas. XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014. v. 1. p. 1-4.

15.
REDIESS, Fabiane ; CONCEICAO, Ruhan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . OTIMIZAÇÕES NA FUNÇÃO DE CUSTO INTERNA DO FILTRO SAO DO PADRÃO DE COMPRESSÃO DE VÍDEO HEVC. In: XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014, Pelotas. XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014. v. 1. p. 1-4.

16.
CORREA, M. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . HERANÇA DE PARÂMETROS DE MOVIMENTO NA CODIFICAÇÃO DE VÍDEOS 3D NO FORMATO MÚLTIPLAS VISTAS MAIS PROFUNDIDADE. In: XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014, Pelotas. XVI Encontro de Pós-Graduação UFPel (ENPOS), 2014. v. 1. p. 1-4.

17.
MAICH, Henrique. ; AUDIBERT, Luan ; AFONSO, Vladimir. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . HERANÇA DE PARÂMETROS DE MOVIMENTO NA CODIFICAÇÃO DE VÍDEOS 3D NO FORMATO MÚLTIPLAS VISTAS MAIS PROFUNDIDADE. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

18.
NOREMBERG, Mateus ; PEGLOW, Guilherme ; Cristani, C. ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; ZATT, Bruno . PROJETO DE ARQUITETURA PARA CÁLCULO DO SAD DE BLOCOS SKIP FOCANDO NO REUSO DA ÁRVORE QUADRÁTICA NO HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

19.
AMARAL, Lívia. ; SILVEIRA, Dieison ; POVALA, Guilherme. ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon ; ZATT, Bruno . ANÁLISE DO CONSUMO ENERGÉTICO DA ESTIMAÇÃO DE MOVIMENTO COM REUSO DE DADOS EM CODIFICADORES DE VÍDEOS DIGITAIS. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

20.
CAMPOS, Ândrio ; CONCEICAO, Ruhan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . DESENVOLVIMENTO DE UMA AQUITETURA DO FILTRO ALF PARA O CODIFICADOR DE VIDEO HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

21.
GOEBEL, Jones ; DE SOUZA, J. CLAUDIO ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon ; ZATT, Bruno . ANÁLISE DE REDUÇÃO DO VOLUME DE DADOS PROCESSADOS PELO MÓDULO DAS TRANSFORMADAS DO CODIFICADOR DE VÍDEO HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

22.
BALOTA, Gabriel ; SALDANHA, Mário ; SANCHEZ, G. F. ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; ZATT, Bruno . ANÀLISE DE REDUÇÃO DO VOLUME DE DADOS PROCESSADOS PELO MÓDULO DAS TRANSFORMADAS DO CODIFICADOR DE VÍDEO HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

23.
SALDANHA, Mário ; BALOTA, Gabriel ; SANCHEZ, G. F. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . AVALIAÇÃO SUBJETIVA DA QUALIDADE DO DMMFAST NO PADRÃO EMERGENTE 3D-HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

24.
POVALA, Guilherme. ; SILVEIRA, Dieison ; AMARAL, Lívia. ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . COMPRESSOR DIFERENCIAL DE QUADROS DE REFERÊNCIA SEM PERDAS PARA CODIFICADORES DE VÍDEO DE ALTA DEFINIÇÃO. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

25.
CONCEICAO, Ruhan ; CAMPOS, Ândrio ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . AVALIAÇÃO E OTIMIZAÇÃO DO FILTRO ALF BASEADO NO CODIFICADOR DE VÍDEOS HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

26.
PEGLOW, Guilherme ; NOREMBERG, Mateus ; Cristani, C. ; PORTO, Marcelo Schiavon ; ZATT, Bruno ; AGOSTINI, Luciano Volcan . AVALIAÇÃO DE ALGORITMOS DE ME PARA A CODIFICAÇÃO DE VÍDEOS UHD NO PADRÃO HEVC. In: XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014, Pelotas. XXIII Congresso de Iniciação Científica da UFPel (CIC), 2014. v. 1. p. 1-4.

27.
SOUZA, J. CLAUDIO ; CONCEICAO, Ruhan ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . DESENVOLVIMENTO EM HARDWARE DE ARQUITETURAS OTIMIZADAS PARA AS TRANSFORMADAS DISCR ETAS DOS COSSENOS SEGUNDO O PADRÃO HEVC DE CODIFICAÇÃO DE VÍ DEO. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII CIC, 2013.

28.
MAICH, Henrique. ; AFONSO, Vladimir. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . DESENVOLVIMENTO DE ARQUITETURA PARA ESTIMAÇÃO DE MOVIMENTO FRACIONÁRIA DO PADRÃO HEVC. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII CIC, 2013.

29.
BALOTA, Gabriel ; SALDANHA, Mário ; Gustavo, SANCHEZ ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan ; ZATT, Bruno . ARQUITETURA PARA O ALGORITMO DE DECISÃO GREEDY AND FLETING STEP NA PREDIÇÃO INTRA-QUADRO DE PROFUNDIDADE. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII Congresso de Iniciação Científica da UFPel, 2013. v. 1. p. 1-4.

30.
SALDANHA, Mário ; BALOTA, Gabriel ; Gustavo, SANCHEZ ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . REDUÇÃO DA COMPLEXIDADE DA CODIFICAÇÃO DE MAPAS DE PROFUNDIDADE NO PADRÃO EMERGENTE 3D-HEVC. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII Congresso de Iniciação Científica da UFPel, 2013. v. 1. p. 1-4.

31.
POVALA, Guilherme. ; AMARAL, Lívia. ; SILVEIRA, Dieison ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . DESENVOLVIMENTO DE UM COMPRESSOR DE QUADROS DE REFERÊNCIA UTILIZANDO CODIFICAÇÃO DIFERENCIAL PARA COMPRESSÃO DE VÍDEOS DIGITAIS. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII Congresso de Iniciação Científica da UFPel, 2013. v. 1. p. 1-4.

32.
Cristani, C. ; DALL'OGLIO, Pargles ; PORTO, Marcelo Schiavon ; AGOSINI, Luciano Volcan . AVALIAÇÃO DE ALGORITMOS PARA A ESTIMAÇÃO DE MOVIMENTO APLICADOS NA PRÓXIMA GERAÇÃO DE VÍDEOS EM ULTRA-ALTA DEFINIÇÃO. In: XXII Congresso de Iniciação Científica da UFPel, 2013, Pelotas. XXII Congresso de Iniciação Científica da UFPel, 2013. v. 1. p. 1-4.

33.
SILVEIRA, Dieison ; POVALA, Guilherme. ; AMARAL, Lívia. ; ZATT, Bruno ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . RFCAVLC: UMA SOLUÇÃO EFICIENTE PARA REDUÇÃO DA LARGURA DE BANDA DE MEMÓRIA E ENERGIA EM CODIFICADORES DE VÍDEO. In: XV Encontro de Pós-Graduação da UFPel, 2013, Pelotas. XV Encontro de Pós-Graduação da UFPel, 2013. v. 1. p. 1-4.

34.
Gustavo, SANCHEZ ; BALOTA, Gabriel ; SALDANHA, Mário ; ZATT, Bruno ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . ANÁLISE ESTATÍSTICA SOBRE O USO DA PREDIÇÃO INTRA QUADRO EM MAPAS DE PROFUNDIDADE NO PADRÃO EMERGENTE 3DVC. In: XV Encontro de Pós-Graduação da UFPel, 2013, Pelotas. XV Encontro de Pós-Graduação da UFPel, 2013. v. 1. p. 1-4.

35.
DALL'OGLIO, Pargles ; Cristani, C. ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . HARDWARE DESIGN DE UM NOVO ALGORITMO PARA ESTIMAÇÃO DE MOVIMENTO EM VÍDEOS DE ALTA DEFINIÇÃO. In: XXI Congresso de Iniciação Científica da UFPel, 2012, Pelotas. XXI Congresso de Iniciação Científica da UFPel - CIC, 2012.

36.
GOMES, Ciceli ; HORSKI, Jessica ; REINHARDT, Júlia ; PORTO, Marcelo Schiavon . VIDA CANHOTA NUM MUNDO DESTRO: VISTAS AOS SEGUINTES OBJETOS CADEIRA E TESOURA. In: XII Jornada de Iniciação Científica Uniritter, 2011, São José dos Campos - SP. XII Jornada de Iniciação Científica Uniritter, 2011.

37.
DALL'OGLIO, Pargles ; CRISTANI, Cássio ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . UM NOVO E EFICIENTE ALGORITMO RÁPIDO PARA A ESTIMAÇÃO DE MOVIMENTO EM VÍDEOS DE ALTA DEFINIÇÃO. In: XX Congresso de Iniciação Científica da UFPel, 2011, Pelotas. XX Congresso de Iniciação Científica da UFPel, 2011.

38.
CORREA, M. ; SANCHEZ, Gustavo ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . ARQUITETURA PARA ESTIMAÇÃO DE MOVIMENTO DO PADRÃO H.264/AVC COM ALGORITMO DIAMOND SEARCH E PRECISÃO DE QUARTER-PIXEL. In: XX Congresso de Iniciação Científica da UFPel, 2011, Pelotas. XX Congresso de Iniciação Científica da UFPel, 2011.

39.
PORTO, Marcelo Schiavon; CRISTANI, Cássio ; DALL'OGLIO, Pargles ; Grellert, Mateus ; Mattos, Júlio ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan . Iterative Random Search: A New Local Minima Resistant Algorithm for Motion Estimation in High Definition Videos. In: International Workshop on Advanced Future Multimedia Services, 2011, Jeju, Coréia do Sul. Proceedings of the 2011 FTRA Word Convergence Conference, 2011.

40.
HERRMANN, A. C. ; GOMES, Caroline ; SANTOS, Jaline ; PORTO, Marcelo Schiavon . ANÁLISE ERGONÔMICA DA USABILIDADE E DO LEIAUTE DO AMBIENTE DE APRENDIZAGEM MOODLE: UM ESTUDO CENTRADO NO ALUNO. In: XIX Congresso de Iniciação Científica da UFPel, 2010, Pelotas. XIX Congresso de Iniciação Científica da UFPel, 2010.

41.
SANTOS, Morgana ; LIMA, Laura ; GONÇALVES, Felipe ; PORTO, Marcelo Schiavon . REESTRUTURA ERGONÔMICA DOS BOXES DE CAIXAS DE SUPERMERCADOS. In: XIX Congresso de Iniciação Científica da UFPel, 2010, Pelotas. XIX Congresso de Iniciação Científica da UFPel, 2010.

42.
SIEDLER, Gabriel ; NOBLE, Diego ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . INVESTIGAÇÃO DE ALGORITMOS RÁPIDOS MULTI-PONTO PARA A ESTIMAÇÃO DE MOVIMENTO DE VÍDEOS EM ALTA RESOLUÇÃO. In: XIX Congresso de Iniciação Científica da UFPel, 2010, Pelotas. XIX Congresso de Iniciação Científica da UFPel, 2010.

43.
CABREIRA, Arthur ; PORTO, Marcelo Schiavon . Deficiências ergonômicas do sistema de transporte público pelotense e suas consequências para os usuários. In: VI Semana de Extensão, Pesquisa e Pós-Graduação do UniRitter, 2010, Porto Alegre. VI Semana de Extensão, Pesquisa e Pós-Graduação do UniRitter, 2010.

44.
PORTO, Marcelo Schiavon; SILVA, Thaísa L da ; PORTO, Roger Endrigo Carvalho ; GÜNTZEL, José Luiz Almada ; AGOSTINI, Luciano Volcan . Design and Comparison between PVCI, BVCI and OCP Hardware Reuse Interfaces Mapped to FPGA. In: V Student Forum on Microelectronics, 2005, Florianópolis. SForum, 2005.

45.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan . Algoritmos e Arquiteturas para a Estimação de Movimento na Compressão de Vídeos Digitais. In: IX Congresso de Iniciação Científica da UFPel, 2005, Pelotas. IX CIC, 2005.

46.
PORTO, Marcelo Schiavon; PORTO, Roger Endrigo Carvalho ; AGOSTINI, Lucinao Volcan . Desenvolvimento de Hardware Dedicado para a Quantização Direta e Inversa segundo o Padrão de Compressão de Vídeo H.264. In: IX Congresso de Iniciação Científica da UFPel, 2005, Pelotas. IX CIC, 2005.

47.
ROSA, Leandro Zanetti Paiva da ; PORTO, Roger Endrigo Carvalho ; PORTO, Marcelo Schiavon ; SILVA, Thaísa Leal da ; SILVA, André Marcelo Coelho da ; AGOSTINI, Luciano Volcan . Exploração do Espaço de Projeto de Hardware para as Transformadas Discretas do Padrão de Compressão de Vídeo H.264. In: IX Congresso de Iniciação Científica da UFPel, 2005, Pelotas. IX CIC, 2005.

48.
SILVA, Thaísa Leal da ; PORTO, Marcelo Schiavon ; AGOSTINI, Luciano Volcan . Comparação entre as Interfaces OCP, PVCI e BVCI para o Reuso de Blocos de Hardware Implementadas em VHDL e Mapeadas para FPGAs. In: IX Congresso de Iniciação Científica da UFPel, 2005, Pelotas. IX CIC, 2005.

49.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan . Experimentos com o Padrão de Reuso de Hardware OCP (Open Core Protocol). In: X IBERCHIP Workshop, 2004, Cartagena de Indias. X IBERCHIP Workshop, 2004.

50.
PORTO, Marcelo Schiavon; ROSA, Leandro Zanetti Paiva da ; AGOSTINI, Luciano Volcan . Descrição e Validação das Interfaces de Reuso do Padrão OCP (Open Core Protocol). In: XIII Congresso de Iniciação Científica da UFPel, 2004, Pelotas. XIII CIC, 2004.


Produção técnica
Produtos tecnológicos
1.
CONCEICAO, M. ; ZATT, Bruno ; AGUIAR, M. ; PORTO, Marcelo Schiavon . Protótipo de Hardware em FPGA para um Sistema de Contagem de Spots em Imagens de Eletroforese Bidimensional. 2016.

2.
JACOBI, Ricardo ; SUSIN, A ; SILVA, Ivan Saraiva da ; PORTO, Marcelo Schiavon . Protótipo do terminal de acesso do Sistema Brasileiro de TV Digital (SBTVD). 2011.

3.
BESKOW, M. ; SANES, R. ; PORTO, Marcelo Schiavon . Protótipo de um jogo institucional para a marca Grêmio. 2011.

4.
SUSIN, A ; BAMPI, Sergio ; AGOSTINI, Luciano Volcan ; PORTO, Marcelo Schiavon . Protótipo de codificador de vídeo H.264/AVC para o Sistema Brasileiro de TV Digital (SBTVD). 2011.

5.
SUSIN, A ; BAMPI, Sergio ; PORTO, Marcelo Schiavon . Protótipo de decodificador de vídeo H.264/AVC para o Sistema Brasileiro de TV Digital (SBTVD). 2006.



Patentes e registros



Programa de computador
1.
ZATT, Bruno ; CORREA, Guilherme ; AGOSTINI, L. V. ; PORTO, Marcelo Schiavon ; CONCEICAO, Ruhan . HEVC 3D ANALYZER. 2017.
Patente: Programa de Computador. Número do registro: BR5120170009-3, data de registro: 21/07/2017, título: "HEVC 3D ANALYZER" , Instituição de registro: INPI - Instituto Nacional da Propriedade Industrial.



Bancas



Participação em bancas de trabalhos de conclusão
Mestrado
1.
SOARES, Rafael; PORTO, Marcelo Schiavon; MARQUES, Felipe de Souza; ROSA JR., L. S.; CAMARGO, V.. Participação em banca de Vitor Gonçalves de Lima. Balanced Secure Triple Track Logic: Proposta de uma nova topologia segura contra ataques DPA e DEMA utilizando técnicas de uniformização de consumo. 2018. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

2.
PORTO, Marcelo Schiavon; BEDREGAL, B.; RIBEIRO, R.. Participação em banca de Alexandre Lemke. Interpretações da Lógica Fuzzy Intuicionista via Computação Quântica. 2017. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

3.
PORTO, Marcelo Schiavon; SUSIN, Altamiro; ROESLER, V.; ZATT, Bruno; BAMPI, Sergio. Participação em banca de MATEUS GRELLERT DA SILVA. Complexity Analysis and Complexity Control in High Efficiency Video Coding. 2014. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

4.
PORTO, Marcelo Schiavon; SUSIN, Altamiro; ROESLER, V.; ZATT, Bruno; BAMPI, Sergio. Participação em banca de CAUANE BLUMENBERG SILVA. Adaptive Tiling Algorithm Based on Highly Correlated Picture Regions for the HEVC Standard. 2014. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

5.
PORTO, Marcelo Schiavon; Mattos, Júlio; REIS, André. Participação em banca de Daniel Munari Vilchez Palomino. Algorithm and Hardware Based Architectural Design Targeting the Intra-Frame Prediction of the HEVC Video Coding Standard. 2013. Dissertação (Mestrado em Computação) - Universidade Federal do Rio Grande do Sul.

6.
PORTO, Marcelo Schiavon; Mattos, Júlio; ROSA, V.. Participação em banca de Vladimir Afonso. Desenvolvimento De Uma Arquitetura Para Estimação De Movimento Fracionária Segundo O Padrão HEVC. 2013. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

7.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan; Mattos, Júlio; GÜNTZEL, José Luís Almada; ZATT, Bruno. Participação em banca de Ricardo Garcia Jeske. Implementações em Hardware Visando Baixo Custo e Alto Desempenho das Transformadas DCT do Padrão Emergente de Codificação de Vídeos HEVC. 2013. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas.

Teses de doutorado
1.
BAMPI, Sergio; PORTO, Marcelo Schiavon; ZATT, Bruno; REIS, André; DUTT, N.. Participação em banca de Felipe Martin Sampaio. Energy-Efficient Memory Architecture Design and Management for Parallel Video Coding. 2018. Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul.

2.
PORTO, Marcelo Schiavon; SUSIN, Altamiro; DINIZ, C.; BAMPI, Sergio. Participação em banca de Eduarda Rodrigues Monteiro. Caracterização Energética da Codificação de Vídeo de Alta Eficiência (HEVC) em Processador de Propósito Geral. 2017. Tese (Doutorado em Computação) - Universidade Federal do Rio Grande do Sul.

Qualificações de Doutorado
1.
PORTO, Marcelo Schiavon; REIS, A.; MORAES, F.. Participação em banca de Felipe Martin Sampaio. Energy-Efficient Memory Architectures for Parallel Video Coding on Embedded Manycore Systems. 2017. Exame de qualificação (Doutorando em Computação) - Universidade Federal do Rio Grande do Sul.

2.
PORTO, Marcelo Schiavon; BAMPI, Sergio; SUSIN, A; ROESLER, V.. Participação em banca de EDUARDA RODRIGUES MONTEIRO. Caracterização Energética da Codificação de Vídeo de Alta Eficiência (HEVC) em Processador de Propósito Geral. 2016. Exame de qualificação (Doutorando em Computação) - Universidade Federal do Rio Grande do Sul.

Monografias de cursos de aperfeiçoamento/especialização
1.
NEVES, M.; VANCONCELLOS, L.; HEIDRICH, F.; PORTO, Marcelo Schiavon. Participação em banca de Marcus Freitas Neves. Dimensão, Resolução e Proporção de Imagens e de Pixel na Renderização de Modelos Tridimensionais Digitais. 2012. Monografia (Aperfeiçoamento/Especialização em Arquitetura e Urbanismo) - Universidade Federal de Pelotas.

Trabalhos de conclusão de curso de graduação
1.
Araújo, Ricardo; CONCEICAO, R.; PORTO, Marcelo Schiavon. Participação em banca de Pargles Wenz Dall?Oglio.Estudo e Implementação de Estratégias para Redução de Complexidade do Codificador de Vídeo HEVC Baseadas em Aprendizado de Máquina. 2017. Trabalho de Conclusão de Curso (Graduação em Ciência da Computação) - Universidade Federal de Pelotas.

2.
PORTO, Marcelo Schiavon; MATTOS, JULIO; SOARES, Rafael; RUZICKI, Julio. Participação em banca de Lisandro Luiz da Silva.Estudo do Acesso à Memória em Processadores Embarcados ARM. 2014. Trabalho de Conclusão de Curso (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas.

3.
PORTO, Marcelo Schiavon; CARDOZO, G.; SCHNEIDER, C.. Participação em banca de João Manuel Rodríguez Corrêa.Motion Design: Análise sobre metodologias para o desenvolvimento de diretrizes projetuais. 2013. Trabalho de Conclusão de Curso (Graduação em Design Digital) - Universidade Federal de Pelotas.

4.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan; Mattos, Júlio; ZATT, Bruno. Participação em banca de Mateus Grellert da Silva.Heurísticas para Redução de Complexidade na Predição Inter-Quadros do Padrão de Codificação de Vídeo Emergente HEVC. 2013. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas.

5.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan; MARQUES, Felipe de Souza; PILLA, Mauricio Lima. Participação em banca de Felipe Martin Sampaio.ARQUITETURA DE HARDWARE PARA ESTIMAÇÃO DE MOVIMENTO E DE DISPARIDADE BASEADA EM REUSO DE DADOS PARA CODIFICAÇÃO DE VÍDEOS DE MÚLTIPLAS VISTAS. 2011. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas.

6.
PORTO, Marcelo Schiavon; MASCHIO, Alexandre; ROSA, Guilherme. Participação em banca de Violeta Ferlauto Schuch.DESIGN DIGITAL E MODELAGEM TRIDIMENSIONAL: O CENÁRIO 3D COMO INTERFACE DE INTERAÇÃO. 2011. Trabalho de Conclusão de Curso (Graduação em Design Digital) - Universidade Federal de Pelotas.

7.
RAMOS, Maria; HALLAL, Dalila; PORTO, Marcelo Schiavon. Participação em banca de Max Timm Beskow.Advergaming: o uso de jogos como estrat´pegia de marketing. 2011. Trabalho de Conclusão de Curso (Graduação em Administração) - Universidade Federal de Pelotas.

8.
PORTO, Marcelo Schiavon; AGOSTINI, Luciano Volcan; Mattos, Júlio; ROSA JR., L. S.. Participação em banca de Robson S. S. Dornelles.Arquitetura para a Estimação de Movimento VBSME Integrada à Compensação de Movimento com Modo de Decisão Rápido para o Padrão H.264/AVC. 2010. Trabalho de Conclusão de Curso (Graduação em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas.



Participação em bancas de comissões julgadoras
Concurso público
1.
PORTO, Marcelo Schiavon; ROSA, Guilherme; TANAKA, M.. Concurso público para Professor Assistente na área de: Modelagem e animação 3D aplicadas a animação e ao design. 2013. Universidade Federal de Pelotas.

2.
NUNES, João; PORTO, Marcelo Schiavon; ROSA, Guilherme. Seleção de Professor Temporário - Design Digital. 2012. Universidade Federal de Pelotas.

3.
PORTO, Marcelo Schiavon; NUNES, João; MÜLLING, Tobias. Seleção de Professor Temporário - Design Digital. 2012. Universidade Federal de Pelotas.

4.
NUNES, João; PELLEGRIN, José; PORTO, Marcelo Schiavon. Seleção de Professor Temporário - Design Digital. 2011. Universidade Federal de Pelotas.

Outras participações
1.
PORTO, Marcelo Schiavon; ROSA, Guilherme. Seleção de alunos bolsistas para monitoria - Design Digital. 2012. Universidade Federal de Pelotas.

2.
NUNES, João; PORTO, Marcelo Schiavon. Seleção de Alunos Bolsistas para Monitoria - Design Digital. 2011. Universidade Federal de Pelotas.



Eventos



Participação em eventos, congressos, exposições e feiras
1.
30th Symposium on Integrated Circuits and Systems Design. 2017. (Congresso).

2.
IEEE International Symposium on Circuits and Systems (ISCAS)). A Multiplierless Parallel HEVC Quantization Hardware for Real-Time UHD 8K Video Coding. 2017. (Congresso).

3.
IEEE LATIN AMERICAN SYMPOSIUM ON CIRCUITS AND SYSTEMS (LASCAS).Solutions for DMM-1 Complexity Reduction in 3D-HEVC Based on Gradient Calculation. 2016. (Simpósio).

4.
IEEE International Conference on Image Processing (ICIP). COMPLEXITY REDUCTION FOR 3D-HEVC DEPTH MAPS INTRA-FRAME PREDICTION USING SIMPLIFIED EDGE DETECTOR ALGORITHM. 2014. (Congresso).

5.
2013 IEEE International Conference on Multimedia and Expo (ICME). A lossless approach for external memory bandwidth reduction in video coding systems and its VLSI architecture. 2013. (Congresso).

6.
VIII Southern Programmable Logic Conference. 2012. (Congresso).

7.
24th Symposium on Integrated Circuits and Systems Design (SBCCI).An Efficient ME Architecture for High Definition Vdeos Using the New MPDS Algorithm. 2011. (Simpósio).

8.
22st Symposium on Integrated Circuits and System Design. High Performance Motion Estimation Architecture Using Efficient Adder-Compressors. 2009. (Congresso).

9.
24th South Symposium on Microelectronics.A Hardware Architecture for the New SDS-DIC Motion Estimation Algorithm. 2009. (Simpósio).

10.
XI Escola de Microeletrônica. 2009. (Outra).

11.
XIV Semana Acadêmica do Curso de Ciência da Computação.Princípios de Codificação de Vídeo Digital: Algoritmos e Arquiteturas para a Estimação de Movimento. 2009. (Outra).

12.
XV Workshop Iberchip. Arquitetura de Alto Desempenho para o Algoritmo de Estimação de Movimento SDS-DIC com Múltiplos Quadros de Referência. 2009. (Congresso).

13.
21st Symposium on Integrated Circuits and System Design. Architectural Design for the New QSDS with Dynamic Iteration Control Motion Estimation Algorithm Targeting HDTV. 2008. (Congresso).

14.
X Escola de Microeletrônica. 2008. (Congresso).

15.
XXIII Simpósio Sul de Microeletrônica.A High Throughput Diamond Search Architecture for HDTV Motion Estimation. 2008. (Simpósio).

16.
XIII Brazilian Symposium on Multimedia and the Web. Investigation of Motion Estimation Algorithms Targeting High Resolution Digital Video Compression. 2007. (Congresso).

17.
VIII Escola de Microeletrônica. 2006. (Congresso).

18.
XXI Simpósio Sul de Microeletrônica.A Hardware Architecture for Motion Estimation with Pel Decimation Algorithm. 2006. (Simpósio).

19.
VII Escola de Microeletrônica. 2005. (Outra).

20.
XI WORKSHOP IBERCHIP.XI WORKSHOP IBERCHIP. 2005. (Outra).

21.
XX Simpósio Sul de Microeletrônica.XX Simpósio Sul de Microeletrônica. 2005. (Simpósio).

22.
IX Semana Acadêmica do Curso de Ciência da Computação. 2004. (Outra).

23.
VI Escola de Microeletrônica Sul. 2004. (Outra).

24.
XII CIC - Congresso de Iniciação Científica. XIII CIC - Congresso de Iniciação Científica. 2004. (Congresso).

25.
XIX Simpósio Sul de Microeletrônica.XIX Simpósio Sul de Microeletrônica. 2004. (Simpósio).

26.
Escola de Microeletrônica Sul. 2003. (Outra).

27.
Semana acadêmica. 2003. (Congresso).

28.
Simpósio Sul de Microeletrônica. 2003. (Simpósio).

29.
XII CIC- Concresso de Iniciação Científica. XII CIC - Congresso de Iniciação Científica. 2003. (Congresso).

30.
VII Semana Acadêmica do Curso de Ciência da Computação. 2002. (Outra).

31.
II Mostra Técnica do Curso de Eletrônica.II Mostra Técnica do Curso de Eletrônica. 2000. (Outra).

32.
I Mostra Técnica do Curso de Eletrônica.I Mostra Técnica do Curso de Eletrônica. 1999. (Outra).


Organização de eventos, congressos, exposições e feiras
1.
PORTO, MARCELO; PALOMINO, Daniel . Finance Chair - Chip in the Pampa 2018 (SBCCI, SBMicro, SForum, WCAS, INSCIT e FEEC). 2018. (Congresso).

2.
PORTO, Marcelo Schiavon; VIDAL, C. . Program Chair - Workshop of Undergraduate Works at SIBGRAPI 2017 ? 30th Conference on Graphics, Patterns and Images. 2017. (Congresso).

3.
PORTO, Marcelo Schiavon; ZATT, Bruno . Program Chair - 19th Simpósio Sul de Microeletrônica (SIM). 2017. (Congresso).



Orientações



Orientações e supervisões em andamento
Dissertação de mestrado
1.
Murilo Roschildt Perleberg. Ainda sem título. Início: 2018. Dissertação (Mestrado profissional em COMPUTAÇÃO) - Universidade Federal de Pelotas. (Orientador).

2.
Jones William Göebel. A definir.. Início: 2017. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

3.
Alex Machado Borges. A definir.. Início: 2017. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Coorientador).

Tese de doutorado
1.
Isis Duarte Bender. Ainda sem título. Início: 2018. Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas. (Orientador).

2.
Luciano de Almeida Braatz. Ainda sem título. Início: 2018. Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas. (Orientador).

3.
Roberta de Carvalho Nobre Palau. A definir.. Início: 2017. Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas. (Coorientador).

4.
Ruhan Avila Conceição. Soluções para a Redução e Controle de Complexidade na Codificação de Vídeos 3D. Início: 2016. Tese (Doutorado em Computação) - Universidade Federal de Pelotas. (Coorientador).

5.
Cristiano Flores dos Santos. Desenvolvimento de Algoritmos para a Redução de Complexidade na Codificação de Vídeo. Início: 2016. Tese (Doutorado em Computação) - Universidade Federal de Pelotas. (Orientador).

6.
Carlos Michel Betemps. Processamento de Vídeo em Sistemas Embarcados Heterogêneos. Início: 2016. Tese (Doutorado em COMPUTAÇÃO) - Universidade Federal de Pelotas. (Coorientador).

7.
Wagner Ishizaka Penny. Controle Dinâmico de Energia para o Codificadores de Vídeo em Sistemas Embarcados Móveis. Início: 2016. Tese (Doutorado em Computação) - Universidade Federal de Pelotas. (Coorientador).

8.
Fábio Luís Livi Ramos. Projeto de Arquiteturas de Hardware Dedicadas Eficientes para a Codificação de Entropia. Início: 2015. Tese (Doutorado em PPGC - Programa de Pós Graduação em Computação UFRGS) - Universidade Federal do Rio Grande do Sul. (Coorientador).

9.
Roger Endrigo Carvalho Porto. Projeto de Arquiteturas de Hardware para a Codificação de Vídeo com Eficiência Energética com Uso de Operadores Imprecisos. Início: 2015. Tese (Doutorado em Computação) - Universidade Federal de Pelotas. (Orientador).

Iniciação científica
1.
Ihan Belmonte Bender. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. Início: 2018. Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

2.
Giordano Estêvão Borges Leal. Projeto de Hardware para a Compressão de Vídeo nas Extensões do Padrão HEVC: Aplicações para Dispositivos Móveis. Início: 2017. Iniciação científica (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).

3.
Mateus Terribele Leme. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. Início: 2017. Iniciação científica (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. (Orientador).


Orientações e supervisões concluídas
Dissertação de mestrado
1.
Luciano Almeida Braatz. Energy/Quality-Aware Hardware Solutions for the Residual Coding Loop Components of the High Efficiency Video Coding Standard. 2018. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, . Orientador: Marcelo Schiavon Porto.

2.
Lívia Silva do Amaral. Projeto e Gerenciamento Dinâmico de uma Memória de Busca para a Estimação de Movimento na Codificação de Vídeo. 2018. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, . Orientador: Marcelo Schiavon Porto.

3.
Mário Roberto de Freitas Saldanha. Redução do Tempo de Codificação de Mapas de Profundidade do 3D-HEVC Usando Árvores de Decisão Estáticas Construídas Através de Data Mining. 2018. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, . Coorientador: Marcelo Schiavon Porto.

4.
Ruhan Ávila da Conceição. Early Skip/DIS: Uma Heurística para Redução de Complexidade no Codificador de Mapas de Profundidade do 3D-HEVC. 2016. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Coorientador: Marcelo Schiavon Porto.

5.
Wagner Ishizaka Penny. Controlador Dinâmico de Energia para o Codificador HEVC Baseado em Frentes de Pareto. 2016. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, . Coorientador: Marcelo Schiavon Porto.

6.
Fabiane Rediess. Desenvolvimento de Arquiteturas de Hardware Eficientes para os Filtros do Padrão HEVC. 2015. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, . Coorientador: Marcelo Schiavon Porto.

7.
Dieison Soares Silveira. Algoritmos e Arquiteturas de Hardware para a Compressão de Quadros de Referência em Codificadores de Vídeo Digitais. 2015. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Orientador: Marcelo Schiavon Porto.

8.
Gustavo Freitas Sanchez. DMMFast: Esquema de Redução de Complexidade para a Predição Intra de Mapas de Profundidade no Padrão Emergente 3D-HEVC. 2014. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Coordenação de Aperfeiçoamento de Pessoal de Nível Superior. Coorientador: Marcelo Schiavon Porto.

9.
Marcel Moscarelli Corrêa. Desenvolvimento de Heurísticas para Redução de Complexidade da Extensão 3D do Padrão HEVC. 2014. Dissertação (Mestrado em COMPUTAÇÃO) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Coorientador: Marcelo Schiavon Porto.

Trabalho de conclusão de curso de graduação
1.
Jones William Goebel. Projeto de Hardware Dedicado Modular para a DCT-2D do Padrão HEVC. 2017. Trabalho de Conclusão de Curso. (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

2.
José Cláudio de Souza Júnior. Arquitetura Multitamanho para a Decodificação de Resíduos do Padrão HEVC. 2016. Trabalho de Conclusão de Curso. (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

3.
Alex Machado Borges. Otimização e Projeto de Hardware Dedicado para o Pré-Processamento de Vídeo em High Dynamic Range (HDR). 2016. Trabalho de Conclusão de Curso. (Graduação em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

4.
Gabriel Machado Balota. Desenvolvimentode um IP-Core para Estimação deMovimento em Vídeos de Alta Definição. 2016. Trabalho de Conclusão de Curso. (Graduação em Bachareledo em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

5.
GABRIEL LEITÃO CARDOSO. Uma ferramenta para avaliação visual de algoritmos de estimação de movimento. 2015. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

6.
Henrique do Amarilho Maich. Estimação de Movimento Paralela para Codificação de Vídeos de Alta Resolução Utilizando GPU em System on Chip Embarcado. 2015. Trabalho de Conclusão de Curso. (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

7.
Gustavo Wrege Gonçalves. Exploração do espaço de projeto arquitetural para o módulo da Quantização do padrão de codificação de vídeo HEVC. 2014. Trabalho de Conclusão de Curso. (Graduação em Engenharia de Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

8.
Marcel Moscarelli Corrêa. DESENVOLVIMENTO DE ARQUITETURAS PARA A INTERPOLAÇÃO DE SUB SAMPLES DE LUMINÂNCIA E CROMINÂNCIA DO PADRÃO DE CODIFICAÇÃO DE VÍDEO EMERGENTE HEVC. 2013. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

9.
Jéssica Barboza dos Santos. Amazing Aha: uma valorização do jogo a partir do design de produtos e do uso da tecnologia QR Code. 2013. Trabalho de Conclusão de Curso. (Graduação em Design Digital) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

10.
Dieison Soares Silveira. Projeto e Implementação de um Compressor de Quadros de Referência para Codificadores de Vídeos Digitais. 2013. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

11.
Gustavo Freitas Sanchez. Implementação e Análise de Algoritmos para a Estimação de Movimento em Vídeos de Alta Definição no Padrão Emergente HEVC. 2012. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

12.
Max Tim Beskow. Análise, projeto e desenvolvimento de jogo institucional para a marca Grêmio. 2011. Trabalho de Conclusão de Curso. (Graduação em Design Digital) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

13.
Nicolas de Lima Peter. Projeto de Design e Direção de Arte em Social Games. 2011. Trabalho de Conclusão de Curso. (Graduação em Design Gráfico) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

14.
Renan Corrêa Sanes. Análise, projeto e desenvolvimento de jogo institucional para a marca Grêmio. 2011. Trabalho de Conclusão de Curso. (Graduação em Design Digital) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

15.
Diego Vrague Noble. Desenvolvimento e Exploração de novos algoritmos para a estimação de movimento em vídeos de alta definição. 2010. Trabalho de Conclusão de Curso. (Graduação em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

Iniciação científica
1.
Murilo Roschildt Perleberg. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2018. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

2.
Marília Pit dos Santos. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2017. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

3.
Mariana Ucker. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2017. Iniciação Científica. (Graduando em Engenharia Elétrica) - Instituto Federal Sul-Rio-Grandense, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

4.
Alex Machado Borges. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2016. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

5.
Luan Pizzamiglio Audibert. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2016. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

6.
Henrique Maich. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2015. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: Marcelo Schiavon Porto.

7.
João Henrique Pfingstag Barth. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2015. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

8.
Jones William Goebel. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2015. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: Marcelo Schiavon Porto.

9.
Matheus Konradt Conceição. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2015. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas, Fundação de Amparo à Pesquisa do Estado do Rio Grande do Sul. Orientador: Marcelo Schiavon Porto.

10.
Mario Roberto de Freitas Saldanha. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2014. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

11.
Luan Pizzamiglio Audibert. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2014. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

12.
Guilherme Nunes Peglow. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2014. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

13.
Mateus Santos de Melo. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Compressão de Vídeo Digital nos Padrões HEVC e 3D-HEVC. 2014. Iniciação Científica. (Graduando em Engenharia de Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

14.
Pargles Wenz Dall'Oglio. Avaliação e Desenvolvimento de Algoritmos de Estimação de Movimento para a Compressão de Vídeo Digital. 2013. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

15.
Cássio Rodrigo Cristani. Avaliação e Desenvolvimento de Algoritmos de Estimação de Movimento para a Compressão de Vídeo Digital. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

16.
Gustavo Freitas Sanchez. Avaliação e Desenvolvimento de Algoritmos de Estimação de Movimento para a Compressão de Vídeo Digital. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

17.
Gabriel Machado Balota. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

18.
Dieison Soares Silveira. Desenvolvimento de Algoritmos e Arquiteturas de Hardware para a Estimação de Movimento do Padrão Emergente HEVC com Foco em Vídeo de Alta Definição. 2012. Iniciação Científica. (Graduando em Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

19.
Gabriel Siedler. Desenvolvimento algoritmico para a estimação de movimento. 2010. Iniciação Científica. (Graduando em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

20.
Gabriel Cardoso. Desenvolvimento algoritmico para a estimação de movimento. 2010. Iniciação Científica. (Graduando em Bacharelado em Ciência da Computação) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

Orientações de outra natureza
1.
Ítalo Dombrowski Machado. Projeto de Hardware para a Compressão de Vídeo nas Extensões do Padrão HEVC: Aplicações para Dispositivos Móveis. 2018. Orientação de outra natureza. (Ciência da Computação) - Universidade Federal de Pelotas, Conselho Nacional de Desenvolvimento Científico e Tecnológico. Orientador: Marcelo Schiavon Porto.

2.
Ana Cláudia Herrmann. ANÁLISE ERGONÔMICA DA USABILIDADE E DO LEIAUTE DO AMBIENTE DE APRENDIZAGEM MOODLE: UM ESTUDO CENTRADO NO ALUNO. 2010. Orientação de outra natureza. (Design Digital) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.

3.
Morgana Santos. REESTRUTURA ERGONÔMICA DOS BOXES DE CAIXAS DE SUPERMERCADOS. 2010. Orientação de outra natureza. (Design Digital) - Universidade Federal de Pelotas. Orientador: Marcelo Schiavon Porto.



Educação e Popularização de C & T



Organização de eventos, congressos, exposições e feiras
1.
PORTO, Marcelo Schiavon; ZATT, Bruno . Program Chair - 19th Simpósio Sul de Microeletrônica (SIM). 2017. (Congresso).




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